[实用新型]一种窄脉宽信号展宽电路、信号处理系统有效
| 申请号： | 202222731428.6 | 申请日： | 2022-10-17 |
| 公开（公告）号： | CN218897211U | 公开（公告）日： | 2023-04-21 |
| 发明（设计）人： | 张仁富;张小龙 | 申请（专利权）人： | 荣湃半导体（上海）有限公司 |
| 主分类号： | H03K5/04 | 分类号： | H03K5/04;H03K5/1252 |
| 代理公司： | 上海申新律师事务所 31272 | 代理人： | 党蕾 |
| 地址： | 200120 上海市浦东新区中*** | 国省代码： | 上海;31 |
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| 摘要： | |||
| 搜索关键词： | 一种 窄脉宽 信号 展宽 电路 处理 系统 | ||
1.一种窄脉宽信号展宽电路，其特征在于，包括：一反相电路、一延时反相电路和一逻辑控制电路；
所述反相电路的第一输入端连接一输入信号，所述反相电路的第二输入端连接所述逻辑控制电路的第一输出端，所述反相电路的第三输入端连接所述逻辑控制电路的第二输出端；
所述延时反相电路的输入端连接所述反相电路的输出端；
所述逻辑控制电路的第一输入端连接所述反相电路的输出端，所述逻辑控制电路的第二输入端连接所述延时反相电路的输出端。
2.根据权利要求1所述的窄脉宽信号展宽电路，其特征在于，所述延时反相电路被配置为执行一预设延时时间的延时。
3.根据权利要求1所述的窄脉宽信号展宽电路，其特征在于，所述反相电路为CMOS反相器。
4.根据权利要求1所述的窄脉宽信号展宽电路，其特征在于，所述逻辑控制电路包括：一第一逻辑门、一第二逻辑门、一第一晶体管和一第二晶体管；
所述第一逻辑门的输入端分别连接所述反相电路的输出端和所述延时反相电路的输出端，所述第一逻辑门的输出端连接所述第一晶体管的栅极，所述第一晶体管的源极连接电源端，所述第一晶体管的漏极作为所述逻辑控制电路的第一输出端；
所述第二逻辑门的输入端分别连接所述反相电路的输出端和所述延时反相电路的输出端，所述第二逻辑门的输出端连接所述第二晶体管的栅极，所述第二晶体管的源极接地，所述第二晶体管的漏极作为所述逻辑控制电路的第二输出端。
5.根据权利要求4所述的窄脉宽信号展宽电路，其特征在于，所述第一逻辑门为或非门。
6.根据权利要求4所述的窄脉宽信号展宽电路，其特征在于，所述第二逻辑门为与非门。
7.根据权利要求4所述的窄脉宽信号展宽电路，其特征在于，所述第一晶体管为PMOS管。
8.根据权利要求4所述的窄脉宽信号展宽电路，其特征在于，所述第二晶体管为NMOS管。
9.根据权利要求1所述的窄脉宽信号展宽电路，其特征在于，所述延时反相电路包括：一延时模块和一反相器；所述延时模块的输入端连接所述反相电路的输出端，所述延时模块的输出端连接所述反相器，所述反相器作为所述延时反相电路的输出端。
10.一种信号处理系统，其特征在于，包括如权利要求1-9任意一项所述的窄脉宽信号展宽电路，还包括：通过一信号传输系统与所述窄脉宽信号展宽电路连接的一滤波器。
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