[发明专利]EUV级衬底、EUV掩模基版、EUV掩模版及其制造方法在审
申请号: | 202211076680.6 | 申请日: | 2022-09-05 |
公开(公告)号: | CN115291470A | 公开(公告)日: | 2022-11-04 |
发明(设计)人: | 季明华;董于虎;黄早红;任新平 | 申请(专利权)人: | 上海传芯半导体有限公司 |
主分类号: | G03F1/38 | 分类号: | G03F1/38;G03F1/22;G03F1/24;G03F1/68 |
代理公司: | 上海思捷知识产权代理有限公司 31295 | 代理人: | 王宏婧 |
地址: | 200000 上海市浦东新区中国(上海)*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | euv 衬底 掩模基版 模版 及其 制造 方法 | ||
1.一种EUV级衬底的制造方法,其特征在于,包括:
提供空白石英基板;
对所述空白石英基板的表层交替注入钛离子和氧离子,并进行热处理,以使得所述空白石英基板的表层形成为含氧化钛硅酸盐的石英膜层;
对所述含氧化钛硅酸盐的石英膜层的表面进行平坦化处理,进而形成EUV级衬底,且所述EUV级衬底表面在工作温度下的热膨胀系数小于或等于0.1ppm/℃。
2.如权利要求1所述的EUV级衬底的制造方法,其特征在于,所述空白石英基板为DUV级或更低等级的石英基板,在所述工作温度下的热膨胀系数小于或等于1ppm/℃。
3.如权利要求1所述的EUV级衬底的制造方法,其特征在于,注入钛离子和氧离子的能量范围分别为10KeV~1MeV,注入剂量范围为1014 cm-3~1015cm-3;和/或,所述热处理包括高温退火处理的步骤,所述高温退火处理的温度大于或等于1000℃,退火时间大于或等于1min。
4.如权利要求1所述的EUV级衬底的制造方法,其特征在于,对所述空白石英基板的表层交替注入钛离子和氧离子之前或之后或过程中,且在进行所述热处理之前,还对所述空白石英基板的表层注入掺杂剂,所述掺杂剂包括B、Al、Mg、Ca、Nb、Ta、Mn、Cu、Sn、F、Cl中的至少一种。
5.如权利要求1所述的EUV级衬底的制造方法,其特征在于,所述平坦化处理包括:旋涂膜层平坦化和/或化学机械平坦化。
6.如权利要求5所述的EUV级衬底的制造方法,其特征在于,所述旋涂膜层平坦化包括形成旋涂碳层的方式。
7.如权利要求6所述的EUV级衬底的制造方法,其特征在于,所述旋涂碳层的厚度小于或等于20nm。
8.如权利要求1所述的EUV级衬底的制造方法,其特征在于,所述含氧化钛硅酸盐的石英膜层的厚度范围为0.1μm~3μm。
9.如权利要求1所述的EUV级衬底的制造方法,其特征在于,所述含氧化钛硅酸盐的石英膜层中的钛含量自下而上逐渐增加。
10.一种EUV掩模基版的制造方法,其特征在于,包括:
采用如权利要求1~9中任一项所述的EUV级衬底的制造方法,形成EUV级衬底;
在所述EUV级衬底上依次形成反射膜堆栈层和吸收层,以形成EUV掩模基版。
11.如权利要求10所述的EUV掩模基版的制造方法,其特征在于,
在形成所述反射膜堆栈层之后且在形成所述吸收层之前,还包括:在所述反射膜堆栈层上形成覆盖层;以及,
在形成所述吸收层之后,还包括:在所述EUV级衬底背向所述反射膜堆栈层的表面上形成背面导电层。
12.一种EUV掩模版的制造方法,其特征在于,包括:
采用权利要求10或11所述的EUV掩模基版的制造方法,形成EUV掩模基版;
蚀刻所述EUV掩模基版的吸收层,以所述吸收层中形成第一图案;
蚀刻所述第一图案外围的所述EUV掩模基版的吸收层和反射膜堆栈层,且蚀刻停止在所述EUV掩模基版的EUV级衬底的表面上,以形成第二图案。
13.一种EUV级衬底,其特征在于,所述EUV级衬底表面的热膨胀系数小于或等于0.1ppm/℃,且所述EUV级衬底包括:
空白石英基板;
含氧化钛硅酸盐的石英膜层,形成在空白石英基板的表层上。
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G03F 图纹面的照相制版工艺,例如,印刷工艺、半导体器件的加工工艺;其所用材料;其所用原版;其所用专用设备
G03F1-00 用于图纹面的照相制版的原版,例如掩膜,光掩膜;其所用空白掩膜或其所用薄膜;其专门适用于此的容器;其制备
G03F1-20 .用于通过带电粒子束(CPB)辐照成像的掩膜或空白掩膜,例如通过电子束;其制备
G03F1-22 .用于通过100nm或更短波长辐照成像的掩膜或空白掩膜,例如 X射线掩膜、深紫外
G03F1-26 .相移掩膜[PSM];PSM空白;其制备
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G03F1-38 .具有辅助特征的掩膜,例如用于校准或测试的特殊涂层或标记;其制备