[发明专利]一种大功率放电管芯片制造工艺在审
申请号: | 202110587509.0 | 申请日: | 2021-05-27 |
公开(公告)号: | CN113314410A | 公开(公告)日: | 2021-08-27 |
发明(设计)人: | 崔文荣 | 申请(专利权)人: | 江苏晟驰微电子有限公司 |
主分类号: | H01L21/329 | 分类号: | H01L21/329 |
代理公司: | 北京天盾知识产权代理有限公司 11421 | 代理人: | 丁桂红 |
地址: | 226600 江苏省南*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 大功率 放电 芯片 制造 工艺 | ||
本发明属于芯片制造技术领域,尤其是一种大功率放电管芯片制造工艺,针对现有的放电管芯片制作方式复杂,且制作芯片漏电流高,电容值高,高温反偏性能弱,抗浪涌能力弱的问题,现提出如下方案,其包括以下步骤:S1:扩散前处理;S2:氧化;S3:单向光刻;S4:低温氧化;S5:离子注入;S6:氧化表面处理;S7:光刻处理;S8:测试,所述S1中准备并采用N型单晶硅片,通过酸、SC3#配方清洗工序,对硅片表面进行化学处理。本发明设计成正面TSS,背面TVS与AK系列TVS合并封装成一种保护器件,漏电流低,电容值低,高温反偏性能强,抗浪涌能力强。
技术领域
本发明涉及芯片制造技术领域,尤其涉及一种大功率放电管芯片制造工艺。
背景技术
半导体放电管广泛应用于通讯交换设备中的程控交换机、电话机、传真机、配线架、通讯接口、通讯发射设备等一切需要防雷保护的领域,以保护其内部的1C免受瞬间过电压的冲击和破坏。
现有的放电管芯片制作方式复杂,且制作芯片漏电流高,电容值高,高温反偏性能弱,抗浪涌能力弱。
发明内容
本发明的目的是为了解决现有的放电管芯片制作方式复杂,且制作芯片漏电流高,电容值高,高温反偏性能弱,抗浪涌能力弱的缺点,而提出的一种大功率放电管芯片制造工艺。
为了实现上述目的,本发明采用了如下技术方案:
一种大功率放电管芯片制造工艺,包括以下步骤:
S1:扩散前处理;
S2:氧化;
S3:单向光刻;
S4:低温氧化;
S5:离子注入;
S6:氧化表面处理;
S7:光刻处理;
S8:测试。
优选的,所述S1中准备并采用N型单晶硅片,通过酸、SC3#配方清洗工序,对硅片表面进行化学处理。
优选的,所述S2中把扩散前处理的硅片在1150℃的氧化炉中氧化形成一层氧化层。
优选的,所述S3中把氧化后的硅片进行涂胶、曝光、显影、去氧化层等工序,在正面刻出一次扩散图形。
优选的,所述S4中光刻完成后,对硅片表面再次进行低温氧化形成很薄的氧化层。
优选的,所述S5中低温氧化完成后对硅片表面进行离子注入,然后注入磷,磷利用120h推结成型。
优选的,所述S6中氧化表面处理具体包括以下步骤:
第一,对硅片表面进行硼氧化和镓扩散,在硅片表面,用硼涂布源工艺进行涂布,在高温时,沉积100分钟左右,可得到合适的低浓度沉积层,借助后道推进流程,将稼深度推到本产品所需的合适深度,形成稼层区;
第二,进行单向发射区光刻,在正面刻出一次扩散图形;
第三,磷预扩,对硅表面进行气态磷预扩;
第四,硼预扩,对硅表面进行硼涂布,在高温时,沉积60-80min,然后漂净氧化层;
第五,发射区扩散,硼氧化。
优选的,所述S7中光刻处理包括以下步骤:
第一,在硅表面进行沟槽光刻;
第二,在硅表面接触区进行光刻;
第三,利用高温蒸发金属;
第四,金属光刻。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造