[发明专利]一种基于浮动地址系统的信号同步方法及装置在审
申请号: | 202110171629.2 | 申请日: | 2021-02-08 |
公开(公告)号: | CN114911741A | 公开(公告)日: | 2022-08-16 |
发明(设计)人: | 毛国梁;包智杰 | 申请(专利权)人: | 南京宏泰半导体科技有限公司 |
主分类号: | G06F13/42 | 分类号: | G06F13/42 |
代理公司: | 南京北辰联和知识产权代理有限公司 32350 | 代理人: | 卫麟 |
地址: | 210000 江苏省南京市浦口区*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 基于 浮动 地址 系统 信号 同步 方法 装置 | ||
本申请提供一种基于浮动地址系统的信号同步方法及装置。本申请针对现有并行总线、背板同步线同步方法所存在的同步信号产生过程复杂、效率低、不容易使用,并且产生信号的同步性差的不足,通过为并行总线所连接的各电路模块配置相应浮动地址,然后通过浮动地址广播功能,根据浮动地址的匹配关系相应触发同一浮动地址所对应的各个电路模块,而解决传统并行总线系统中无法简单、高速、低成本实现在不同地址上、不同电路模块板卡间并行寻址的问题。本发明能够通过总线仲裁器和译码发生器之间的配合,产生高并行度的同步信号。
技术领域
本申请涉及并行总线背板系统领域,具体而言涉及一种基于浮动地址系统的信号同步方法及装置。
背景技术
集成电路自动测试设备、基于并行总线背板的仪器仪表,需要在不同槽位板卡之间实现信号同步,或驱动不同板卡并行发生信号。现有的同步技术通常采用以下两种方式实现:
第一种方式基于一般并行总线的单点寻址的特点,采用连续选中不同槽位板卡的任意地址的方法,驱动不同板卡在相互临近的若干个时间点产生相同的信号。这种方式能够实现伪并行信号发生或信号同步。但是,由于这类方法需要多次操作总线,因此具有PC写总线耗费时间长,信号同步性差等缺点。
另一种方式下,可通过在背板建立同步线,在同步线上跑同步时钟或同步触发信号,设置各板卡同时连接同步线,根据同步总线上的触发信号实现不同板卡间的信号同步。但是,这种方法存在同步线占用背板总线资源,产生同步信号过程复杂,实现成本高等缺点。
发明内容
本申请针对现有技术的不足,提供一种基于浮动地址系统的信号同步方法及装置,本申请基于一般并行总线架构,通过浮动地址广播机制,可以实现低成本,高速,高并行度的同步信号发生。本申请具体采用如下技术方案。
首先,为实现上述目的,提出一种基于浮动地址系统的信号同步方法,其步骤包括:第一步,为并行总线所连接的各电路模块配置译码发生器;第二步,通过并行总线中的第一地址段将并行总线所连接的任意个需要同步触发的电路模块配置为具有相同的浮动地址,并将所述浮动地址存储于对应电路模块的译码发生器中;第二步,通过并行总线中的第二地址段寻址,触发译码发生器根据并行总线中的浮动地址选通匹配于该浮动地址的电路模块,通过选通信号触发对应的电路模块产生同步信号。
可选的,如上任一所述的基于浮动地址系统的信号同步方法,其中,同一时刻下,所述并行总线结构中的第一地址段具有交互信号时,第二地址段空闲;同一时刻下,所述并行总线结构中的第二地址段具有交互信号时,第一地址段空闲。
可选的,如上任一所述的基于浮动地址系统的信号同步方法,其中,第二步中还包括:通过并行总线中的第一地址段将并行总线所连接的任意个不需要同步触发的电路模块配置为具有相互不同的浮动地址,并将所述浮动地址存储于对应电路模块的译码发生器中。
可选的,如上任一所述的基于浮动地址系统的信号同步方法,其中,第一步中,具体为并行总线所连接的每一个电路模块分别配置一个译码发生器;每一个所述译码发生器均分别存储对应于一个电路模块的浮动地址值,每一个所述译码发生器均分别比较并行总线中第二地址段上的浮动地址是否匹配于其所存储的浮动地址值,在浮动地址匹配时输出选通信号。
可选的,如上任一所述的基于浮动地址系统的信号同步方法,其中,所述第一地址段为并行总线中的低位地址段,所述第二地址段为并行总线中的高位地址段。
同时,为实现上述目的,本申请还提供一种基于浮动地址系统的信号同步装置,其包括:总线仲裁器,其用于通过并行总线中的第一地址段进行寻址而将并行总线所连接的任意个需要同步触发的电路模块配置为具有相同的浮动地址;译码发生器,用于存储各电路模块所被配置的浮动地址,还用于根据所述浮动地址是否匹配于并行总线中第二地址段的寻址信号而输出选通信号至对应的电路模块,所述选通信号能够触发所述电路模块产生同步信号。
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