[发明专利]封装件及其形成方法在审
申请号: | 202011627702.4 | 申请日: | 2020-12-31 |
公开(公告)号: | CN112802764A | 公开(公告)日: | 2021-05-14 |
发明(设计)人: | 李维平 | 申请(专利权)人: | 上海易卜半导体有限公司 |
主分类号: | H01L21/56 | 分类号: | H01L21/56;H01L23/31;H01L25/16;H01L23/488;H01L21/60 |
代理公司: | 北京市中伦律师事务所 11410 | 代理人: | 童剑雄 |
地址: | 201700 上海市青浦区*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 封装 及其 形成 方法 | ||
本发明公开了一种封装件及其形成方法。一种形成封装件的方法,所述方法包括:在载体的上方放置芯片层,所述芯片层包括多个芯片联接器和正面朝下的多个芯片,其中在所述多个芯片联接器上方的表面具有多个第一凸点;在所述载体的上方对所述芯片层进行模塑处理以形成塑封结构;对所述塑封结构进行减薄处理,以暴露出所述多个第一凸点;在经减薄的塑封结构上方添加金属层;去除所述载体以形成封装件主体,并在所述封装件主体的下方添加重布线层和第二凸点;以及分割所述封装件主体以形成多个所述封装件。
技术领域
本发明涉及半导体技术领域,尤其涉及一种封装件及其形成方法。
背景技术
目前,半导体集成电路所需的功能越来越多,所需的计算速度越来越快,在这种形势下,业界已经开始在芯片堆叠技术的研发上增加投入,以探索在芯片堆叠技术中更有效的解决方案。然而,传统的晶圆级封装(WLP)技术无法实现芯片的堆叠。而在传统的芯片堆叠技术中,堆叠大多是在最终组装中完成的,并且需要利用硅片通孔(TSV,ThroughSilicon Via)、玻璃基板通孔(TGV,Through Glass Via)、塑封层通孔(TMV,Through MoldVia)或者引线键合(Wire-bond)等技术来实现堆叠芯片间的竖直联接。传统堆叠技术的封装工艺较复杂并且成本较高。
发明内容
本发明实施例提供一种形成封装件的方案,该封装件包含堆叠的多个芯片。
本发明的第一方面提供了一种形成封装件的方法,所述方法包括:在载体的上方放置芯片层,所述芯片层包括多个芯片联接器和正面朝下的多个芯片,其中在所述多个芯片联接器上方的表面具有多个第一凸点;在所述载体的上方对所述芯片层进行模塑处理以形成塑封结构;对所述塑封结构进行减薄处理,以暴露出所述多个第一凸点;在经减薄的塑封结构上方添加金属层;去除所述载体以形成封装件主体,并在所述封装件主体的下方添加重布线层和第二凸点;以及分割所述封装件主体以形成多个所述封装件。
所述多个芯片联接器可以是有源联接器件或无源联接器件。
所述多个芯片联接器可以被设置成在竖直方向上包含至少一个导电通道。
所述封装件可以包括至少一个被分割的芯片联接器、第一芯片和被分割的金属层,其中,所述第一芯片能够通过所述至少一个被分割的芯片联接器和所述重布线层电联接至所述被分割的金属层。
所述多个芯片联接器由一种或多种半导体材料、一种或多种无机材料、一种或多种有机材料和/或一种或多种金属材料形成。
在所述金属层内可以集成如下电子器件中的一种或多种:I/O端口、无源器件、射频天线、电磁干扰屏蔽器件和散热器件。
所述多个芯片联接器可以由如下的一种或多种半导体材料形成:硅、碳化硅、砷化镓和氮化镓。
所述多个芯片联接器可以由如下的一种或多种无机材料形成:玻璃和陶瓷。
所述多个芯片联接器可以由如下的一种或多种封装基板的制程和材料形成:印刷电路基板、塑封基板和柔性电路基板。
所述多个芯片联接器可以由金属基板的制程和材料形成,所述金属基板采用如下的一种或多种金属材料及其合金材料:铜、铝和铁。
在所述金属层的上方可以放置并组装如下电子器件中的一种或多种:集成电路模块、微机电系统、光电器件和无源器件。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造