[发明专利]双列直插式存储器模块(DIMM)可编程加速卡在审
申请号: | 201910649573.X | 申请日: | 2019-07-18 |
公开(公告)号: | CN110851378A | 公开(公告)日: | 2020-02-28 |
发明(设计)人: | S·拉加瓦;D·苏巴雷迪;K·普拉萨德;A·那拉马尔普;H·古普塔 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F13/12 | 分类号: | G06F13/12;G06F13/16;G06F13/42 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 刘文灿 |
地址: | 美国加*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 双列直插式 存储器 模块 dimm 可编程 加速卡 | ||
1.一种卡,包括:
可编程集成电路,其具有被配置为充当硬件加速资源的软逻辑,其中,所述卡具有双列直插式存储器模块(DIMM)外形规格,其中,所述可编程集成电路接收来自主中央处理单元(CPU)的请求,并且其中,所接收的请求中的至少一些被路由到所述硬件加速资源以进行加速;以及
存储器,其耦合到所述可编程集成电路。
2.如权利要求1所述的卡,其中,所述可编程集成电路经由主存储器接口耦合到所述主CPU。
3.如权利要求2所述的卡,其中,所述主存储器接口包括双倍数据速率(DDR)接口。
4.如权利要求3所述的卡,其中,所述主存储器接口包括事务DDR(DDR-T)接口或非易失性双列直插式存储器模块(NVDIMM)接口。
5.如权利要求2所述的卡,其中,所述主CPU经由处理器接口耦合到另一处理器,并且其中,通过所述主存储器接口的数据传输快于通过所述处理器接口的数据传输。
6.如权利要求5所述的卡,其中,通过所述主存储器接口的所述数据传输比通过所述处理器接口的所述数据传输快至少一千倍。
7.如权利要求1所述的卡,其中,所述存储器包括非易失性存储器和易失性存储器中的至少一个。
8.如权利要求1-7中任一项所述的卡,其中,所述可编程集成电路还包括:
存储器控制器,其被配置为转换从所述主CPU接收的所述请求;以及
请求解码器,其被配置为对所转换的请求进行解码并且将所解码的请求路由到所述卡内的合适的目的地。
9.如权利要求8所述的卡,其中,所述可编程集成电路还包括:
控制电路,其被配置为协调进出所述可编程集成电路的数据流。
10.如权利要求9所述的卡,其中,所述可编程集成电路还包括:
输入-输出组件,其被配置为与形成在所述卡上或所述卡外部的不同类型的外围设备接合。
11.一种操作计算机卡的方法,包括:
用所述计算机卡来接收来自主中央处理单元(CPU)的请求,其中,所述计算机卡具有双列直插式存储器模块(DIMM)外形规格;
使用所述计算机卡中的硬件加速资源来处理所接收的请求中的至少一些并且生成对应的经处理的数据;以及
将所述经处理的数据存储到所述计算机卡中的存储器中。
12.如权利要求11所述的方法,还包括:
用所述计算机卡上的存储器控制器来将所接收的请求转换成分组。
13.如权利要求12所述的方法,还包括:
用所述计算机卡上的解码器来对从所述存储器控制器接收的所转换的请求进行解码并且将所解码的请求路由到所述计算机卡中的合适位置。
14.如权利要求11-13中任一项所述的方法,其中,使用所述计算机卡中的所述硬件加速资源来处理所接收的请求中的至少一些包括使用所述硬件加速资源来执行从由以下各项构成的组中选择的定制功能:压缩/解压缩、加密/解密、编码/解码、以及匹配。
15.如权利要求12所述的方法,还包括:
用所述计算机卡上的所述存储器控制器来将响应发送回到所述主CPU。
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