[实用新型]一种实现平稳切换的时钟切换电路有效
| 申请号： | 201820232482.7 | 申请日： | 2018-02-09 |
| 公开（公告）号： | CN208015698U | 公开（公告）日： | 2018-10-26 |
| 发明（设计）人： | 孙永明 | 申请（专利权）人： | 长沙泰科阳微电子有限公司 |
| 主分类号： | H03K5/135 | 分类号： | H03K5/135;H03K5/1252 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 410000 湖南省长沙市经济技术开发区*** | 国省代码： | 湖南;43 |
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| 摘要： | |||
| 搜索关键词： | 与门 时钟信号CLK 触发器 时钟切换电路 本实用新型 时钟切换 逻辑系统 频率时钟 时钟毛刺 输出信号 或门 保证 | ||
1.一种实现平稳切换的时钟切换电路，其特征在于，包括时钟信号CLK-SEL、时钟信号CLK-0、时钟信号CLK-1、时钟信号CLK-O、与门F1、与门F2、与门F3、与门F4、或门F5、与门F6、与门F7、与门F8、触发器T1、触发器T2、触发器T3和触发器T4，其中，所述时钟信号CLK-SEL分别与所述与门F1的输入端及所述与门F6的第二输入端连接，所述与门F1的输出端与所述与门F2的第一输入端连接，所述与门F2的第二输入端与所述触发器T4的输出端QN4连接，所述与门F2的输出端与所述触发器T1的输入端D1连接，所述时钟信号CLK-0分别与所述触发器T1的输入端CLK1、所述与门F3的输入端及所述与门F4的第二输入端连接，所述触发器T1的输出端Q1与所述触发器T2的输入端D2连接，所述与门F3的输出端与所述触发器T2的输入端CLK2连接，所述触发器T2的输出端Q2与所述与门F4的第一输入端连接，所述触发器T2的输出端QN2与所述与门F6的第一输入端连接，所述与门F4的输出端与所述或门F5的第一输入端连接，所述或门F5的输出端与所述时钟信号CLK-O连接，所述与门F6的输出端与所述触发器T3的输入端D3连接，所述时钟信号CLK-1分别与所述触发器T3的输入端CLK3、所述与门F7的输入端及所述与门F8的第二输入端连接，所述触发器T3的输出端Q3与所述触发器T4的输入端D4连接，所述与门F7的输出端与所述触发器T4的输入端CLK4连接，所述触发器T4的输出端Q4与所述与门F8的第一输入端连接，所述与门F8的输出端与所述或门F5的第二输入端连接。
2.根据权利要求1所述的一种实现平稳切换的时钟切换电路，其特征在于，所述触发器T2的输出端Q2与所述触发器T4的输出端Q4分别均输出时钟信号CLK-EN。
3.根据权利要求1所述的一种实现平稳切换的时钟切换电路，其特征在于，所述触发器T1与所述触发器T2、所述触发器T3及所述触发器T4均为T型触发器。
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