[发明专利]冲击工频接地阻抗综合测试装置有效
申请号: | 201811404676.1 | 申请日: | 2018-11-23 |
公开(公告)号: | CN109557372B | 公开(公告)日: | 2023-10-03 |
发明(设计)人: | 郝泽超;李妍;郝孝智;刘璞;李云飞;付亚平;侯晋华 | 申请(专利权)人: | 山西德智科技有限公司 |
主分类号: | G01R27/02 | 分类号: | G01R27/02 |
代理公司: | 太原晋科知识产权代理事务所(特殊普通合伙) 14110 | 代理人: | 郑晋周 |
地址: | 030021 山西省太原市晋源区*** | 国省代码: | 山西;14 |
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摘要: | |||
搜索关键词: | 冲击 接地 阻抗 综合测试 装置 | ||
本发明涉及防雷接地技术领域,提出了一种冲击工频接地阻抗综合测试装置,包括中央处理器、电源模块、第一高压开关、高压直流升压模块、充放电电容C0、第二高压开关、第三高压开关、工频地网阻抗测量电路、残压检测电路、低频去极化电路、地网波形采集电路、冲击电流采集电路、数据处理电路,测试装置上设置有端子C、端子E、端子P1和端子P2;高压直流升压模块、低频去极化电路、第一高压开关、第二高压开关和第三高压开关的控制端与中央处理器的输出端连接;充放电电容C0与第一高压开关的常闭触点串联后连接高压直流升压模块的输出两端之间。本发明通过模拟雷电冲击脉冲波形对接地网进行冲击,可以实现接地装置的冲击和工频接地阻抗的检测。
技术领域
本发明涉及防雷接地技术领域,具体涉及一种冲击工频接地阻抗综合测试装置。
背景技术
随着科学技术的发展,微电子设备不断普及应用,雷电危害明显上升。雷电防护其实质是将雷电冲击脉冲有效地引入大地。衡量的标准就是接地装置的冲击接地阻抗值,它最能真实、科学的反应接地装置的特性和接地效果,对雷电防护具有重要意义。冲击接地阻抗是指冲击电流或雷电流从接地装置向周围大地流散时,接地体与接地介质(土壤、岩石以及降阻剂等)所呈现的阻抗值。在实际应用中,冲击接地阻抗用于表征接地装置的防雷特性。而工频接地阻抗是指为接地体在工频电流下的阻抗,在对接地装置进行测量时,由于受不平衡零序电流以及射频等各种干扰,使得测试结果产生很大的误差。特别是大型接地网的接地阻抗一般很小(一般在0 .5Ω以下),干扰带来的相对误差更大。现有的阻抗测试装置,只能测量其中一种工频接地阻抗,不能实现对接地网的冲击阻抗的准确测试。
发明内容
本发明克服现有技术存在的不足,所要解决的技术问题为:提供一种便携式冲击工频接地阻抗综合测试装置,可以在实现对接地网工频阻抗测试的基础上,进一步地实现对接地网的冲击阻抗测试。
为了解决上述技术问题,本发明采用的技术方案为:冲击工频接地阻抗综合测试装置,包括中央处理器、电源模块、第一高压开关、高压直流升压模块、充放电电容C0、第二高压开关、第三高压开关、工频地网阻抗测量电路、残压检测电路、低频去极化电路、地网波形采集电路、冲击电流采集电路、数据处理电路,所述测试装置上设置有端子C、端子E、端子P1和端子P2,所述端子C用于连接远方电流极,所述端子E和端子P2用于并联连接被测地网参考点,所述端子P1用于连接远方电位极;所述电源模块用于供电,所述高压直流升压模块、低频去极化电路、第一高压开关、第二高压开关和第三高压开关的控制端与所述中央处理器的输出端连接;所述充放电电容C0与所述第一高压开关的常闭触点串联后连接所述高压直流升压模块的输出两端之间,所述充放电电容C0还与所述第一高压开关的常开触点串联后,一端经所述第二高压开关的第一常开触点与端子C连接,另一端经所述第二高压开关的第二常开触点与接地体地网连接,所述残压检测电路的输入端分别与所述充放电电容C0的两端连接,输出端与所述中央处理器连接,所述冲击电流采集电路设置在所述第一高压开关的常开触点与所述第二高压开关的第一常开触点之间,用于采集充放电电容C0放电时流入远方电流极的电流,所述地网波形采集电路的输入端分别与所述端子P2和端子P1连接,用于采集充放电电容C0放电时远方电位极与接地体地网之间的电压;所述地网波形采集电路和冲击电流采集电路的采集信号经所述数据处理电路后输出到中央处理器;所述低频去极化电路的输出端分别通过第三高压开关的常开触点与所述端子C和端子E连接,所述工频地网阻抗测量电路输出的正弦波工频测试信号分别通过第三高压开关的常开触点与所述端子C和端子E连接,所述工频地网阻抗测量电路测试信号输出端与所述中央处理器的输入端连接。
所述的一种冲击工频接地阻抗综合测试装置,还包括高压取样电路和隔离变换电路,所述高压取样电路的输入端与所述高压直流升压模块的输出端连接,所述高压取样电路的输出端经所述隔离变换电路后与所述中央处理器连接。
所述的一种冲击工频接地阻抗综合测试装置,还包括显示单元,所述显示单元输入端与所述中央处理器的输出端连接。
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