[发明专利]加速器结构在审
| 申请号： | 201810988366.2 | 申请日： | 2018-08-28 |
| 公开（公告）号： | CN109582611A | 公开（公告）日： | 2019-04-05 |
| 发明（设计）人： | R·古普塔;A·V·阿南塔拉曼;S·R·范多伦;A·贾甘纳坦 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F13/12 | 分类号： | G06F13/12;G06F13/16 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 邬少俊;王英 |
| 地址： | 美国加*** | 国省代码： | 美国;US |
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| 摘要： | |||
| 搜索关键词： | 耦合到 加速器 互连 加速器结构 存储器 通信 存储器访问操作 一级高速缓存 结构控制器 主机设备 相干 偏置 主机 配置 检查 | ||
1.一种用于提供相干加速器结构的结构控制器，包括：
主机互连，其通信地耦合到主机设备；
存储器互连，其通信地耦合到加速器存储器；
加速器互连，其通信地耦合到具有最后一级高速缓存(LLC)的加速器；以及
LLC控制器，其被配置为对存储器访问操作提供偏置检查。
2.如权利要求1所述的结构控制器，还包括：结构相干引擎(FCE)，其被配置为使得能够将所述加速器存储器映射到主机结构存储器地址空间，其中，所述结构控制器被配置为经由所述FCE将主机存储器访问操作引导至所述加速器存储器。
3.如权利要求2所述的结构控制器，其中，所述FCE与所述LLC控制器物理地分离。
4.如权利要求3所述的结构控制器，还包括直接旁路总线，其用于将所述LLC连接到所述存储器互连并绕过所述FCE。
5.如权利要求1所述的结构控制器，其中，所述结构控制器被配置为在多个n个独立片中提供所述结构。
6.如权利要求5所述的结构控制器，其中，n＝8。
7.如权利要求5所述的结构控制器，其中，所述n个独立片包括n个独立LLC控制器，所述n个独立LLC控制器经由水平互连被互连并经由相应的垂直互连通信地耦合到相应的存储器控制器。
8.如权利要求7所述的结构控制器，还包括：功率管理器，其被配置为确定所述LLC控制器空闲，并且将所述水平互连断电并使相应的垂直互连和主机互连保持在活动状态。
9.如权利要求1所述的结构控制器，其中所述LLC是3级高速缓存。
10.如权利要求1至9中任一项所述的结构控制器，其中，所述主机互连是符合英特尔加速器链路(IAL)的互连。
11.如权利要求1至9中任一项所述的结构控制器，其中，所述主机互连是PCIe互连。
12.如权利要求1至11中任一项所述的结构控制器，其中，所述结构控制器是集成电路。
13.如权利要求1至11中任一项所述的结构控制器，其中，所述结构控制器是知识产权(IP)块。
14.一种加速器装置，包括：
加速器，其包括最后一级高速缓存(LLC)；以及
结构控制器，其用于提供相干加速器结构，所述结构控制器包括：
主机互连，其将所述加速器通信地耦合到主机设备；
存储器互连，其将所述加速器和所述主机设备通信地耦合到加速器存储器；
加速器互连，其将所述加速器结构通信地耦合到所述LLC；以及
LLC控制器，其被配置为对存储器访问操作提供偏置检查。
15.如权利要求14所述的加速器装置，其中，所述结构控制器还包括结构相干引擎(FCE)，其被配置为使得能够将所述加速器存储器映射到主机结构存储器地址空间，其中，所述结构控制器被配置为经由所述FCE将主机存储器访问操作引导至所述加速器存储器。
16.如权利要求15所述的加速器装置，其中，所述FCE与所述LLC控制器物理地分离。
17.如权利要求16所述的加速器装置，其中，所述结构控制器还包括直接旁路总线，其用于将所述LLC连接到所述存储器互连并绕过所述FCE。
18.如权利要求14所述的加速器装置，其中，所述结构控制器被配置为在多个n个独立片中提供所述结构。
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