[发明专利]半导体器件及其形成方法有效
申请号: | 201810096015.0 | 申请日: | 2018-01-31 |
公开(公告)号: | CN110098146B | 公开(公告)日: | 2020-12-25 |
发明(设计)人: | 周飞 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路新技术研发(上海)有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L21/336;H01L23/538;H01L29/78 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 徐文欣;吴敏 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 半导体器件 及其 形成 方法 | ||
1.一种半导体器件的形成方法,其特征在于,包括:
提供基底;
形成栅极结构、源漏掺杂层和介质层,栅极结构位于基底上,源漏掺杂层位于栅极结构两侧的基底中,介质层位于基底、源漏掺杂层和栅极结构上,所述源漏掺杂层中具有源漏离子;
在栅极结构两侧的介质层中形成暴露出源漏掺杂层表面的第一通孔,所述第一通孔暴露出源漏掺杂层的顶部,
在第一通孔底部的源漏掺杂层表面掺杂第一离子,第一离子的导电类型和源漏离子的导电类型相同;
掺杂第一离子后,对所述源漏掺杂层进行第一退火处理,在源漏掺杂层内的表面形成接触掺杂区;
第一退火处理后,在第一通孔底部的接触掺杂区内形成第二通孔,且所述第二通孔的深度小于所述接触掺杂区厚度;
在所述第一通孔和第二通孔内形成插塞。
2.如权利要求1所述的半导体器件的形成方法,其特征在于,所述插塞的形成步骤包括:形成第二通孔后,在所述第一通孔内、第二通孔内和介质层上形成插塞材料层;形成插塞材料层后,平坦化所述插塞材料层,暴露出介质层顶部表面,在第一通孔和第二通孔内形成插塞。
3.如权利要求1所述的半导体器件的形成方法,其特征在于,在第一通孔底部的源漏掺杂层表面掺杂第一离子的工艺包括离子注入工艺。
4.如权利要求3所述的半导体器件的形成方法,其特征在于,当所述半导体器件的类型为P型器件时,所述第一离子的类型为P型离子,所述第一离子包括:硼离子、BF2+离子或铟离子;当所述半导体器件的类型为N型器件时,所述第一离子的类型为N型离子,所述第一离子包括:包括磷离子、砷离子或锑离子。
5.如权利要求4所述的半导体器件的形成方法,其特征在于,所述第一离子的类型为N型离子;所述离子注入工艺的参数包括:采用的离子为砷离子,注入能量为1KeV~15KeV,注入剂量为1.0E15atom/cm2~2.0E16atom/cm2;或者,所述离子注入工艺的参数包括:采用的离子为锑离子,注入能量为2KeV~30KeV,注入剂量为5.0E14atom/cm2~3.0E16atom/cm2。
6.如权利要求4所述的半导体器件的形成方法,其特征在于,所述第一离子的类型为P型离子;所述离子注入工艺的参数包括:采用的离子为硼离子,注入能量为0.5KeV~8KeV,注入剂量为8.0E14atom/cm2~3.0E16atom/cm2;或者,所述离子注入工艺的参数包括:采用的离子为BF2+离子,注入能量为1KeV~10KeV,注入剂量为8.0E14atom/cm2~3.0E16atom/cm2。
7.如权利要求1所述的半导体器件的形成方法,其特征在于,所述第一退火处理包括激光退火或尖峰退火。
8.如权利要求1所述的半导体器件的形成方法,其特征在于,还包括:在第一退火处理后,第二通孔形成前,对所述第一通孔底部的接触掺杂区进行第二离子注入,在接触掺杂区内的表面形成非晶掺杂区。
9.如权利要求8所述的半导体器件的形成方法,其特征在于,所述第二离子注入的掺杂离子为第二离子。
10.如权利要求8所述的半导体器件的形成方法,其特征在于,所述非晶掺杂区的厚度大于所述第二通孔的深度。
11.如权利要求10所述的半导体器件的形成方法,其特征在于,所述非晶掺杂区的厚度小于接触掺杂区的厚度。
12.如权利要求9所述的半导体器件的形成方法,其特征在于,所述第二离子包括锗离子。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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