[发明专利]层叠配线膜及薄膜晶体管元件在审
申请号: | 201780029216.2 | 申请日: | 2017-05-10 |
公开(公告)号: | CN109155243A | 公开(公告)日: | 2019-01-04 |
发明(设计)人: | 志田阳子;后藤裕史 | 申请(专利权)人: | 株式会社神户制钢所 |
主分类号: | H01L21/285 | 分类号: | H01L21/285;C22C9/01;C22C9/04;C22C9/05;C23C14/14;C23C14/34;H01L21/28;H01L29/417;H01L29/423;H01L29/49 |
代理公司: | 北京同立钧成知识产权代理有限公司 11205 | 代理人: | 马爽;臧建明 |
地址: | 日本兵库县神户市*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 配线膜 电阻 合金层 配线层 薄膜晶体管元件 层间绝缘膜 高温热处理 成膜 群组 下层 剥离 上层 金属 自由 | ||
1.一种层叠配线膜,其特征在于,具备:包含电阻为10μΩcm以下的Cu或Cu合金的配线层、以及设于所述配线层的上层及下层中的至少一者的包含Cu与X元素的Cu-X合金层,
所述X元素为选自由Al、Mn、Zn以及Ni所组成的X群组中的至少一种,
构成所述Cu-X合金层的金属为下述(1)~(5)中的任一组成系,
配线图案的宽度为10μm以下:
(1)只包含所述X群组中的一种元素,其含量为6at%以上且27at%以下。
(2)包含4at%以上且15at%以下的Al,进而包含5at%以上且10at%以下的Mn。
(3)包含5at%以上且10at%以下的Zn,进而包含5at%以上且26at%以下的Mn。
(4)包含4at%以上且14at%以下的Zn,进而包含5at%以上且15at%以下的Al。
(5)包含5at%以上且10at%以下的Al,进而包含2at%以上且10at%以下的Ni。
2.根据权利要求1所述的层叠配线膜,其中构成所述Cu-X合金层的金属为下述(1')~(5')中的任一组成系,
配线图案的宽度为5μm以下:
(1')只包含所述X群组中的一种元素,其含量为6at%以上且14at%以下。
(2')包含4at%以上且9at%以下的Al,进而包含5at%以上且10at%以下的Mn。
(3')包含5at%以上且10at%以下的Zn,进而包含5at%以上且10at%以下的Mn。
(4')包含4at%以上且14at%以下的Zn,进而包含5at%以上且10at%以下的Al。
(5')包含5at%以上且10at%以下的Al,进而包含6at%以上且10at%以下的Ni。
3.根据权利要求1或2所述的层叠配线膜,其为层叠于基板的层叠配线膜,且在层叠于所述基板之侧的表面进而具有包含Ti的密接层。
4.根据权利要求1或2所述的层叠配线膜,其中所述配线层的膜厚为50nm以上且1000nm以下,所述Cu-X合金层的膜厚为5nm以上且200nm以下。
5.根据权利要求3所述的层叠配线膜,其中所述配线层的膜厚为50nm以上且1000nm以下,所述Cu-X合金层的膜厚为5nm以上且200nm以下。
6.一种薄膜晶体管元件,其特征在于,包含如权利要求1所述的层叠配线膜及氧化物半导体。
7.一种薄膜晶体管元件,其特征在于,包含如权利要求2所述的层叠配线膜及低温多晶硅半导体或氧化物半导体。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造