[发明专利]非易失性存储装置有效
申请号: | 201710148010.3 | 申请日: | 2017-03-13 |
公开(公告)号: | CN107437431B | 公开(公告)日: | 2022-08-30 |
发明(设计)人: | 吉本裕平;加藤佳一 | 申请(专利权)人: | 新唐科技日本株式会社 |
主分类号: | G11C13/00 | 分类号: | G11C13/00 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 徐殿军 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 非易失性 存储 装置 | ||
1.一种非易失性存储装置,其特征在于,具备:
存储单元阵列,由能够利用电阻值的变化来保持数据的电阻变化型的多个存储单元构成;
读出电路,进行如下读出动作,该读出动作是从上述存储单元阵列中以由处于相同的电阻状态的多个存储单元构成的存储组为单位,基于依存于上述多个存储单元的各自的电阻值的放电现象或充电现象而取得时间信息的读出动作;以及
数据生成电路,基于通过上述读出电路的读出动作得到的上述多个存储单元的上述时间信息的各自的升序或降序中的位次,生成个体识别信息。
2.如权利要求1所述的非易失性存储装置,其特征在于,
上述读出电路对上述多个存储单元中的至少两个以上的存储单元同时读出上述时间信息。
3.如权利要求1所述的非易失性存储装置,其特征在于,
上述数据生成电路具有数据变换电路,该数据变换电路进行如下数据变换:将上述存储组内的上述多个存储单元中的至少一个设定为参照存储单元,在上述多个存储单元中的除了上述参照存储单元以外的数据生成用存储单元的时间信息的上述位次比上述参照存储单元的时间信息的上述位次小的情况下对上述数据生成用存储单元分配第1数据,在上述数据生成用存储单元的时间信息的上述位次比上述参照存储单元的时间信息的上述位次大的情况下对上述数据生成用存储单元分配第2数据;
上述数据生成电路基于由上述数据变换电路进行了数据变换后的数据,生成上述个体识别信息。
4.如权利要求1所述的非易失性存储装置,其特征在于,
上述数据生成电路具有数据变换电路,该数据变换电路进行如下数据变换:将上述存储组内的上述多个存储单元中的至少一个设定为参照存储单元,当将上述多个存储单元中的除了上述参照存储单元以外的数据生成用存储单元的时间信息与上述参照存储单元的时间信息比较时,在上述数据生成用存储单元的时间信息比上述参照存储单元的时间信息小的情况下对上述数据生成用存储单元分配第1数据,当上述数据生成用存储单元的时间信息比上述参照存储单元的时间信息大的情况下对上述数据生成用存储单元分配第2数据;
上述数据生成电路基于由上述数据变换电路进行了数据变换后的数据,生成上述个体识别信息。
5.如权利要求3或4所述的非易失性存储装置,其特征在于,
上述参照存储单元被分配给与上述存储组内的上述多个存储单元的时间信息中的上位第M个时间信息对应的存储单元,其中M为2以上。
6.如权利要求3或4所述的非易失性存储装置,其特征在于,
上述数据变换电路对上述参照存储单元分配上述第1数据。
7.如权利要求3或4所述的非易失性存储装置,其特征在于,
上述参照存储单元被分配给与上述存储组内的上述多个存储单元的地址中的上位第N个地址对应的存储单元,其中N是自然数。
8.如权利要求3或4所述的非易失性存储装置,其特征在于,
上述第1数据及上述第2数据中的一方是偶数,另一方是奇数;
上述数据生成电路具有数据处理电路,该数据处理电路进行如下数据处理:计算通过上述数据变换电路而分配给上述多个存储单元的第1数据与第2数据的合计,如果合计的数量是奇数则输出第1数据,如果是偶数则输出第2数据;
上述数据生成电路基于由上述数据处理电路进行了数据处理后的数据,生成上述个体识别信息。
9.如权利要求3或4所述的非易失性存储装置,其特征在于,
上述数据生成电路具有数据处理电路,该数据处理电路进行如下数据处理:计算通过上述数据变换电路而分配给上述多个存储单元的第1数据的个数和第2数据的个数,如果上述第1数据的个数比上述第2数据的个数多则输出第1数据,如果上述第1数据的个数比上述第2数据的个数少则输出上述第2数据;
上述数据生成电路基于由上述数据处理电路进行了数据处理后的数据,生成上述个体识别信息。
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