[发明专利]用于在可调整地可分割存储器阵列中存储数据的系统和方法有效

专利信息
申请号: 201410240980.2 申请日: 2014-05-30
公开(公告)号: CN104217756B 公开(公告)日: 2017-10-20
发明(设计)人: R·霍;M·哈塞尔;W·贝克;T·利伯曼 申请(专利权)人: 英飞凌科技股份有限公司
主分类号: G11C16/06 分类号: G11C16/06;G11C16/24
代理公司: 北京市金杜律师事务所11256 代理人: 王茂华
地址: 德国诺伊*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 可调 整地 分割 存储器 阵列 存储 数据 系统 方法
【说明书】:

技术领域

本公开内容总体涉及电子存储器系统,并且更具体地涉及用于在可调整地可分割存储器阵列中存储数据的系统和在可调整地可分割存储器阵列中存储数据的方法。

背景技术

现代微控制器系统通常包括若干类型的适于存储不同类型数据的存储器。常规地,微控制器包括易失性存储器(RAM)分区和非易失性存储器分区,比如ROM、EPROM、EEPROM或者闪速存储器。易失性存储器分区用作微控制器的主要存储器并且被用来存储器正在被执行的程序以及其它。非易失性存储器分区用来存储器程序数据和操作参数数据。

这样的微控制器的非易失性存储器系统有时被分割成两个物理上分离的分区。这样的微控制器系统例如在汽车行业中采用。通常将非易失性存储器的两个物理上分离的分区用来存储两种不同类型的数据:程序数据和应用数据。因此,可以提供非易失性存储器的第一分区以存储程序数据,并且提供非易失性存储器的第二分区以存储应用数据。程序数据通常仅被写入存储器一次,并且在它已经被写入之后从存储器被读取许多次。相反,应用数据被反复地向存储器写入和从存储器读取。由于非易失性存储器的两个分区是物理上分离的,因此这两个分区可以彼此独立地被访问。可以例如从第一分区读取数据的第一部分,而同时向第二分区写入数据的第二部分。

为了最佳利用对两个存储器分区的独立访问,两个分区中的一个分区应当专门用于存储程序数据,而另一分区应当专门用于存储应用数据。继而程序数据和应用数据可以彼此独立地被访问。然而,在汽车行业中的微控制器的许多应用中并非如此,并且程序数据并非是与应用数据清楚地分离的。例如,电机控制表经常被存储在被设置为存储程序数据的存储器分区中。

当在微控制器正在执行程序的同时需要访问存储在被设置为存储程序数据的存储器分区中的数据(比如上文提到的电机控制表)时,问题出现。由于电机控制表被存储在也包含程序数据(即在执行程序期间频繁访问的程序代码)的存储器分区中,因此访问电机控制表经常需要中断对程序代码的读取访问。这导致低效的程序执行和总体效率降低。

为了解决上述问题,通常应用以下两个方式中的一个方式。或者是闪速存储器被设计成允许对闪速存储器的访问被很快速地中断。为了实现快速中断,设置在闪速存储器中的读出放大器需要不断地工作,因而不断地提取电流。除此之外,允许快速中断所需的电路装置需要额外的空间。或者是增大被布置在微控制器的闪速存储器与微处理器之间的第二快速高速缓存存储器。高速缓存存储器通常由SRAM组成,该SRAM需要许多空间并且提取许多电流。

利用第一方式,中断的缺点减小但是没有消除。利用第二方式可以减小中断的频率。影响中断频率的因素是正在被执行的程序、高速缓存命中率和高速缓存的大小。利用第二方式,仍存在中断,但是它们会较不频繁地出现。

出于这些及其它原因,需要在可调整地可分割存储器阵列中存储数据的改善的系统和/或方法。

发明内容

根据本公开的一个方面,提供了一种用于在可调整地可分割存储器阵列中存储数据的系统,所述系统包括:

多个存储器单元,所述多个存储器单元被布置成具有行和列的阵列,

多条个位线,以及

多个开关,

其中每条个位线被电耦合至一列成列的存储器单元,并且

其中每条个位线包括开关,所述开关被配置成允许通过断开所述开关来允许分割相应的所述位线被分割。

在一个实施方式中,每条个位线包括至少两个开关。

在一个实施方式中,所述开关以如下方式被分组成多组成组的开关:每组开关位于相邻两行存储器单元之间。

在一个实施方式中,每组开关被配置成在第一配置和第二配置之间可转移转变,其中在所述第一配置中,所述组成组的开关的所有开关闭合,并且在所述第二配置中,所述组成组的开关的所有开关断开。

在一个实施方式中,所述系统被配置成确保同时一次仅有一组开关采用所述第二配置。

在一个实施方式中,还包括第一组读出放大器和第二组读出放大器,其中所述第一组读出放大器被布置在所述多个存储器单元的上方,并且所述第二组读出放大器被布置在所述多个存储器单元的下方。

根据本公开的另一方面,提供了一种用于在可调整地可分割存储器阵列中存储数据的系统,所述系统包括:

多个连续单元阵列,以及

一组成组的数据线,

其中每个连续单元阵列被耦合至所述组成组的数据线,并且

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