[发明专利]双沟渠式整流器及其制造方法有效
申请号: | 201310739980.2 | 申请日: | 2013-12-27 |
公开(公告)号: | CN104241283B | 公开(公告)日: | 2017-08-11 |
发明(设计)人: | 金勤海 | 申请(专利权)人: | 竹懋科技股份有限公司;金勤海 |
主分类号: | H01L27/08 | 分类号: | H01L27/08;H01L21/822 |
代理公司: | 北京三友知识产权代理有限公司11127 | 代理人: | 贾磊 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 沟渠 整流器 及其 制造 方法 | ||
1.一种双沟渠式整流组件,其特征在于,所述组件包含:
多个主沟渠平行形成于重掺杂的n+半导体基板上的n-外延层内,所述多个主沟渠内具有主沟渠氧化层形成于所述主沟渠底部及侧壁;
多个凹陷区间隔形成于所述多个主沟渠间的主平台的n-外延层内,所述多个凹陷区内具有副沟渠栅极氧化层形成于所述凹陷区底部及侧壁;
一导电型杂质掺杂的第一多晶硅层形成于所述主沟渠内;
一导电型杂质掺杂的第二多晶硅层形成于所述凹陷区内以形成MOS结构,所述MOS结构包含所述第二多晶硅层,所述副沟渠栅极氧化层,所述外延层,由所述外延层为底向上顺序形成;
多个p型本体区形成于所述凹陷区两侧平台下的n-外延层内;
一顶部金属层覆盖于包括所述第一及第二多晶硅层、p型本体区的半导体基板正面以作为阳极,一底部金属层作为阴极形成于所述重掺杂的n+半导体基板的背面。
2.根据权利要求1所述的双沟渠式整流组件,其特征在于,所述p型本体区的每一个还包含形成两个n+离子注入区于所述p型本体区且邻接于所述MOS结构的两侧。
3.根据权利要求1所述的双沟渠式整流组件,其特征在于,所述组件还包含一金属硅化物层形成于所述第二多晶硅层,所述n-外延层上,以连接所述顶部金属层。
4.一种双沟渠式整流组件,其特征在于,所述组件包括:
多个主沟渠平行形成于重掺杂的n+半导体基板上的n-外延层内,所述多个主沟渠内具有主沟渠氧化层形成于所述主沟渠底部及侧壁;
多个凹陷区间隔形成于所述多个主沟渠间的主平台的n-外延层内,所述多个凹陷区内具有副沟渠栅极氧化层形成于所述凹陷区底部及侧壁及凹陷区两侧的平台上;
一导电型杂质掺杂的第一多晶硅层形成于所述主沟渠内,所述第一多晶硅层上也形成有副沟渠栅极氧化层;
一导电型杂质掺杂的第二多晶硅层形成于所述凹陷区并溢出至平台之上,且高过于主沟渠的第一多晶硅层上的副沟渠栅极氧化层上,所述第二多晶硅层被图案化成多列与所述主沟渠走向相垂直的多个MOS结构列,所述的MOS结构列,包含所述第二多晶硅层,所述副沟渠栅极氧化层,所述外延层,由所述外延层为底向上顺序形成及所述第二多晶硅层,所述副沟渠栅极氧化层,所述第一多晶硅层,由所述第一多晶硅层为底向上顺序形成;
多个p型本体区形成于所述MOS结构列相邻的平台下的n-外延层内;
一顶部金属层覆盖于包括所述MOS结构列及相邻的本体区的半导体基板正面以作为阳极,一底部金属层作为阴极形成于所述重掺杂的n+半导体基板的背面。
5.根据权利要求4所述的双沟渠式整流组件,其特征在于,所述p型本体区的每一个还包含形成两个n+离子注入区于所述p型本体区且邻接于所述MOS结构列的两侧。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的