[发明专利]闪存存储单元的形成方法有效
申请号: | 201310315247.8 | 申请日: | 2013-07-24 |
公开(公告)号: | CN103367262A | 公开(公告)日: | 2013-10-23 |
发明(设计)人: | 曹子贵;贾敏 | 申请(专利权)人: | 上海宏力半导体制造有限公司 |
主分类号: | H01L21/8247 | 分类号: | H01L21/8247 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 骆苏华 |
地址: | 201203 上海市浦*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 闪存 存储 单元 形成 方法 | ||
1.一种闪存存储单元的形成方法,其特征在于,包括:
提供若干批次半导体结构,所述半导体结构包括:衬底,所述衬底具有若干平行排列的浮栅区,相邻浮栅区之间具有隔离区,所述衬底的浮栅区表面具有隧穿氧化层、以及位于隧穿氧化层表面的浮栅层,所述衬底的隔离区内具有隔离结构,所述隔离结构的表面等于或高于浮栅层表面,所述隔离结构具有相邻的第一区域和第二区域;
依次刻蚀若干批次半导体结构的隔离结构的第二区域,使隔离结构的第二区域表面低于第一区域表面,其中,每一待刻蚀批次的刻蚀时间的确定方法包括:测试待刻蚀批次前一批次的隔离结构刻蚀速率,测试待刻蚀批次在刻蚀之前的隔离结构的厚度,通过待刻蚀批次前一批次的隔离结构刻蚀速率、以及待刻蚀批次在刻蚀之前的隔离结构的厚度获得待刻蚀批次的刻蚀时间;
在刻蚀若干批次半导体结构的隔离结构的第二区域之后,在浮栅层和隔离结构表面形成牺牲层,所述牺牲层具有第一开口,所述第一开口暴露出部分浮栅层以及第一区域的隔离结构表面。
2.如权利要求1所述的闪存存储单元的形成方法,其特征在于,所述每一待刻蚀批次的刻蚀时间的确定方法为:
测试待刻蚀批次在刻蚀之前的隔离结构第二区域的厚度,获取隔离结构第一厚度Tn;
测试待刻蚀批次前一批次的隔离结构刻蚀速率,获取隔离结构第一刻蚀速率γn-1;
采用隔离结构第一厚度Tn和隔离结构第一刻蚀速率γn-1获取待刻蚀批次的刻蚀时间tn=(Tn-Ttarget)/γn-1,其中,Ttarget为待刻蚀批次的隔离结构第二区域刻蚀后的预设厚度。
3.如权利要求2所述的闪存存储单元的形成方法,其特征在于,测试所述待刻蚀批次前一批次的刻蚀速率的方法为:
测试待刻蚀批次前一批次的隔离结构刻蚀之前的厚度,获取隔离结构第二厚度Tn-1;
测试待刻蚀批次前一批次的隔离结构刻蚀之后的厚度,获取隔离结构第三厚度Ttn-1;
采用隔离结构第二厚度Tn-1和隔离结构第三厚度Ttn-1获取待刻蚀批次前一批次的刻蚀速率γn-1=(Tn-1-Ttn-1)/tn-1,其中,所述tn-1为待刻蚀批次刻蚀隔离结构的时间。
4.如权利要求1所述的闪存存储单元的形成方法,其特征在于,还包括:
在第一开口的侧壁表面形成第一侧墙;
以第一侧墙和牺牲层为掩膜刻蚀浮栅层和隧穿氧化层直至暴露出衬底为止,形成第二开口,并在第二开口的侧壁表面形成第二侧墙;
在形成第二侧墙之后,在第一开口和第二开口内形成源线层;
在形成源线层之后,去除牺牲层并以第一侧墙和源线层刻蚀浮栅层直至暴露出隧穿氧化层;
在以第一侧墙和源线层刻蚀浮栅层之后,在第一侧墙、源线层和浮栅层两侧形成字线层,所述字线层与浮栅层之间通过绝缘层电隔离。
5.如权利要求4所述的闪存存储单元的形成方法,其特征在于,所述字线层的形成工艺为:在刻蚀所述浮栅层之后,采用热氧化工艺在浮栅层暴露出的侧壁表面和源线层表面形成绝缘层;在形成绝缘层之后,沉积形成字线薄膜,所述字线薄膜覆盖衬底、浮栅层、第一侧墙和源线层表面;回刻蚀所述字线薄膜,去除源线层和衬底表面的字线薄膜,形成字线层。
6.如权利要求5所述的闪存存储单元的形成方法,其特征在于,还包括:在形成字线层之前,以第一侧墙和源线层刻蚀浮栅层和隧穿氧化层直至暴露出衬底为止,所述热氧化工艺还在衬底表面形成绝缘层。
7.如权利要求4述的闪存存储单元的形成方法,其特征在于,在形成字线层之后,在源线层、字线层和浮栅层两侧的衬底内形成漏区。
8.如权利要求4所述的闪存存储单元的形成方法,其特征在于,在形成源线层之前,在第二开口底部的衬底内形成源区。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造