[发明专利]电路板及其制造方法有效
| 申请号: | 201310109972.X | 申请日: | 2013-03-29 |
| 公开(公告)号: | CN103369811A | 公开(公告)日: | 2013-10-23 |
| 发明(设计)人: | 照井诚;小松大基;国枝雅敏 | 申请(专利权)人: | 揖斐电株式会社 |
| 主分类号: | H05K1/00 | 分类号: | H05K1/00;H05K3/46 |
| 代理公司: | 北京林达刘知识产权代理事务所(普通合伙) 11277 | 代理人: | 刘新宇 |
| 地址: | 日本*** | 国省代码: | 日本;JP |
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| 摘要: | |||
| 搜索关键词: | 电路板 及其 制造 方法 | ||
技术领域
本发明涉及一种电路板及其制造方法,详细地说涉及一种局部具有高密度布线的电路板及其制造方法。
背景技术
作为用于安装IC芯片(半导体元件)的多层印刷电路板,已知以下电路板:在具有通孔导体的树脂性芯基板上交替地层叠层间绝缘层和导体层,通过通路孔导体对导体层之间进行连接。
近年来,随着IC芯片的精细化、高集成化,形成于封装基板的最上层的焊盘数量正在增加。由于该焊盘数量增加而焊盘不断细间距化。随着这种焊盘的细间距化,封装基板的布线间距也在迅速地细线化(例如,参照专利文献1)。
在该电路板中,其内部局部形成了高密度的布线。具体地说,在电路板的层间绝缘层内部,在由硅、玻璃等耐热性基材构成且热膨胀系数低的基板上配置有形成了这种高密度的布线层的电子部件。而且,通过这种结构,应对上述焊盘的细间距化的趋势。
专利文献1:国际公开第2007/129545号
发明内容
发明要解决的问题
然而,在该电路板中,安装的半导体元件全部集中于上述电子部件的布线层。即,电源系统和信号系统的布线全部集中于电子部件的高密度布线层,因此认为电特性会产生问题。
另外,在存在电子部件的区域形成高密度布线,在电子部件周边的不存在电子部件的区域不存在导体而仅存在树脂,因此认为电子部件容易受到树脂的热膨胀、收缩的影响,构成电路板的耐热性基材会产生裂纹。
本发明是鉴于这种情形而完成的,目的在于提供一种具有高可靠性的电路板。
用于解决问题的方案
本发明所涉及的电路板的特征在于,具备:第一绝缘层;第一导体图案,其形成在上述第一绝缘层上;第二绝缘层,其设置在上述第一绝缘层上和上述第一导体图案上,该第二绝缘层具有开口部;布线结构体,其收容在上述开口部内,具有第三绝缘层以及上述第三绝缘层上的第二导体图案;第三导体图案,其形成在上述第二绝缘层上;以及通路导体,其形成在上述第二绝缘层的内部,连接上述第一导体图案和上述第三导体图案。
优选上述第二导体图案的图案宽度小于上述第一导体图案的图案宽度。
优选邻接的上述第二导体图案之间的间隔小于邻接的第一导体图案之间的间隔。
优选形成在上述布线结构体上的导体焊盘的上表面与上述第三导体图案的上表面位于同一平面上。
优选在上述开口部的底部设置有位于上述布线结构体的下方的导体部。
优选在上述导体部与上述布线结构体之间插入有粘接层。
优选上述布线结构体不经由导电层而与上述开口部的底面接触。
优选上述导体部的在上述开口部的内部的一部分被去除。
优选上述导体部具有凹部,该凹部具有平坦的底面,在该底面上配置有上述布线结构体。
优选在上述导体部形成有成为从下层绝缘层产生的气体的排出路径的贯通孔。
优选上述导体部的俯视观察时的投影面积大于上述布线结构体的俯视观察时的投影面积。
优选上述布线结构体的上述第二导体图案经由形成在上述布线结构体的上方的电布线与外部的半导体芯片电连接。
优选具备至少两个上述布线结构体,配置于上述电路板上的一个半导体芯片经由各上述布线结构体与分别不同的半导体芯片电连接。
优选设置第四绝缘层以覆盖上述第二导体图案,在上述第四绝缘层上设置有与安装焊盘相连接的导体焊盘,该安装焊盘用于安装第一半导体元件和第二半导体元件。
优选上述安装焊盘具备用于与上述第一半导体元件相连接的第一焊盘以及用于与上述第二半导体元件相连接的第二焊盘,上述第一焊盘之间的间隔小于上述第二焊盘之间的间隔。
优选上述第二导体图案为连接上述第一半导体元件和上述第二半导体元件的信号线。
优选上述第二导体图案的表示线宽和线距之比的L/S为1μm/1μm以上且5μm/5μm以下。
本发明的第二观点所涉及的电路板的制造方法的特征在于,具有以下步骤:在第一绝缘层上形成第一导体图案;在上述第一绝缘层上和上述第一导体图案上形成第二绝缘层;在上述第二绝缘层的内部形成通路导体;在上述第二绝缘层中形成开口部;在上述第二绝缘层上形成第三导体图案;在上述开口部的内部收容布线结构体,该布线结构体具有第三绝缘层和该第三绝缘层上的第二导体图案;以及通过上述第二绝缘层的内部的通路导体连接上述第三导体图案和上述第一导体图案。
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