[发明专利]一种数据处理方法和装置有效
申请号: | 201210379871.X | 申请日: | 2012-10-09 |
公开(公告)号: | CN103714038B | 公开(公告)日: | 2019-02-15 |
发明(设计)人: | 石欣琢 | 申请(专利权)人: | 中兴通讯股份有限公司 |
主分类号: | G06F15/167 | 分类号: | G06F15/167;G06F12/084 |
代理公司: | 北京安信方达知识产权代理有限公司 11262 | 代理人: | 李健;龙洪 |
地址: | 518057 广东省深圳市南山*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 数据处理 方法 装置 | ||
1.一种数据处理方法,包括:
接收到数据总线输入的数据后,根据该数据的去向指示和数据有效位段指示,将所述数据总线输入的数据写入上行侧共享缓存中,具体包括:每次写入时,将上一次写入结束位置+1作为本次写入的起始位置;
所述上行侧共享缓存由N块指定位宽的随机存储器RAM组成,每块RAM被在逻辑上划分成Y个RAM段;
按照固定时隙顺序轮询所述上行侧共享缓存,将所述上行侧共享缓存中的数据读出,输出到对应的各个通道中;所述按照固定时隙顺序轮询所述上行侧共享缓存,将所述上行侧共享缓存中的数据读出包括以下方式:
当N≥Y时,每个轮询周期为N个时隙,每个时隙访问Y个RAM段;
当N<Y时,每个轮询周期为Y个时隙,每个时隙访问N个RAM段。
2.如权利要求1所述的方法,其特征在于:所述将所述数据总线输入的数据写入上行侧共享缓存中的过程中,还包括:
按通道记录当拍数据尾部的写入位置。
3.一种数据处理装置,包括:
上行侧写入控制模块,用于接收到数据总线输入的数据后,根据该数据的去向指示和数据有效位段指示,将所述数据总线输入的数据写入上行侧共享缓存中,具体包括:每次写入时,将上一次写入结束位置+1作为本次写入的起始位置;所述上行侧共享缓存由N块指定位宽的随机存储器RAM组成,每块RAM被在逻辑上划分成Y个RAM段;
上行侧读出控制模块,用于按照固定时隙顺序轮询将所述上行侧共享缓存中的数据读出,输出到对应的各个通道中;按照固定时隙顺序轮询将所述上行侧共享缓存中的数据读出包括以下方式:当N≥Y时,每个轮询周期为N个时隙,每个时隙访问Y个RAM段;当N<Y时,每个轮询周期为Y个时隙,每个时隙访问N个RAM段。
4.如权利要求3所述的装置,其特征在于:
所述上行侧写入控制模块,将所述数据总线输入的数据写入上行侧共享缓存中的过程中还用于:按通道记录当拍数据尾部的写入位置。
5.一种数据处理方法,包括:
将各通道输出的数据存入下行侧共享缓存中;所述下行侧共享缓存由N块指定位宽的随机存储器RAM组成,每块RAM被在逻辑上划分成Y个RAM段;
所述将各通道输出的数据存入下行侧共享缓存中包括:按照固定时隙顺序轮询所述下行侧共享缓存各RAM块中的各RAM段,若当前轮询到的RAM段列有空余,则将对应通道待输出的数据存入该RAM段列;
所述按照固定时隙顺序轮询所述下行侧共享缓存各RAM块中的各RAM段包括以下方式:当N≥Y时,每个轮询周期为N个时隙,每个时隙访问Y个RAM段;当N<Y时,每个轮询周期为Y个时隙,每个时隙访问N个RAM段;
根据调度顺序将数据从所述下行侧共享缓存中读出,输出到数据总线上,具体包括:每次读出时,上一次读出结束位置+1作为本次读的起始位置。
6.如权利要求5所述的方法,其特征在于:所述根据调度顺序将数据从所述下行侧共享缓存中读出包括:
计算每一个RAM段列总体缓存的数据量,当该RAM段列缓存的数据量大于等于当前调度指示所需的数据量时,依据调度位段长度指示将本次调度输出的数据从各RAM段中读出。
7.一种数据处理装置,包括:
下行侧写入控制模块,用于将各通道输出的数据存入下行侧共享缓存中;所述下行侧共享缓存由N块指定位宽的随机存储器RAM组成,每块RAM被在逻辑上划分成Y个RAM段;所述下行侧写入控制模块具体用于,按照固定时隙顺序轮询所述下行侧共享缓存各RAM块中的各RAM段,若当前轮询到的RAM段列有空余,则将对应通道待输出的数据存入该RAM段列;按照固定时隙顺序轮询所述下行侧共享缓存各RAM块中的各RAM段包括以下方式:当N≥Y时,每个轮询周期为N个时隙,每个时隙访问Y个RAM段;当N<Y时,每个轮询周期为Y个时隙,每个时隙访问N个RAM段;
下行侧读出控制模块,用于根据调度顺序将数据从所述下行侧共享缓存中读出,输出到数据总线上,具体包括:每次读出时,上一次读出结束位置+1作为本次读的起始位置。
8.如权利要求7所述的装置,其特征在于:
所述下行侧读出控制模块,具体用于计算每一个RAM段列总体缓存的数据量,当该RAM段列缓存的数据量大于等于当前调度指示所需的数据量时,依据调度位段长度指示将本次调度输出的数据从各RAM段中读出。
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