[发明专利]具特性转换功能的快闪记忆装置无效
申请号: | 200710080142.3 | 申请日: | 2007-02-14 |
公开(公告)号: | CN101246414A | 公开(公告)日: | 2008-08-20 |
发明(设计)人: | 罗海槎 | 申请(专利权)人: | 亮发科技股份有限公司 |
主分类号: | G06F3/06 | 分类号: | G06F3/06 |
代理公司: | 北京科龙寰宇知识产权代理有限责任公司 | 代理人: | 孙皓晨 |
地址: | 台湾省台北市内湖*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 特性 转换 功能 记忆 装置 | ||
技术领域
本发明涉及的是一种闪存,特别涉及的是一种具特性转换功能的快闪记忆装置。
背景技术
近几年来,闪存(flash memory)已成为大多数可携式记忆装置(portable memorydevice)所使用的记忆媒介。例如USB随身碟(USB Flash Disk,俗称硅碟机或拇指哥)、以及包括小尺寸闪存(Compact Flash,CF)、记忆棒(Memory Stick,MS)、安全数字(Secure Digital,SD)、多媒体卡(Multi Media Card,MMC)等各种规格的快闪记忆卡(flash memory card)、使用CF或USB接口的微型硬盘(micro hard disk)、或者是采用USB或PCMCIA接口且装置在外接盒中的薄型2.5英时硬盘机等等,以满足现代人对于「信息可移植性」与日遽增的渴望。另外,在许多使用嵌入式内存的可携式电子装置中,例如近年流行的MP3播放器,也多是使用闪存。
也由于闪存的技术进展快速,所以每隔一段时间,即会有新一世代的产品问世。然而,对于可携式装置的制造厂商而言,新一世代的闪存,其特性(characteristic)(如脚位定义,工作电压等等)往往与过去的不同,造成厂商若要升级使用新的闪存,相关的硬件电路便需重新设计。另外,不同厂牌的闪存也常会有不同的特性,也会造成厂商想使用别的厂牌的闪存时,需要重新设计相关硬件。这种由于升级闪存或更换厂牌而造成需重新设计电路的现象,会延缓厂商的设计导入周期(design-incycle),连带提高制造成本,并且可能因延误生产而损与市场商机。
发明内容
因此,本发明的目的之一,在于提供一种具特性转换功能的快闪记忆装置,其可对具有不同特性的快闪记忆单元进行特性转换,以使得外接主机不需改变硬件设计,即能存取所述的快闪记忆单元,而无兼容性问题。
本发明的另一目的,在于提供一种具特性转换功能的快闪记忆装置,其可利用软件组态的方式进行快闪记忆单元的特性转换,以增加产品设计上的弹性,如此制造厂商在使用不同特性的快闪记忆单元时,不需改变硬件设计,而可加速设计导入周期。
为实现上述目的,本发明采用的技术方案在于,提供种快闪记忆装置,其具有一第一特性,所述的快闪记忆装置包含:
一快闪记忆单元,具有一第二特性;以及
一特性转换单元,耦接至所述的快闪记忆单元,用以执行所述的第一特性与所述的第二特性之间的转换,以使一主机依据所述的第一特性存取所述的快闪记忆单元。
较佳的,所述的特性转换单元包含:
一第一快闪记忆接口,耦接至所述的主机;
一第二快闪记忆接口,耦接至所述的快闪记忆单元;以及
一控制电路,耦接在所述的第一与第二快闪记忆接口之间,用以控制所述的第一与第二快闪记忆接口的运作,以达成所述的第一特性与所述的第二特性之间的转换。
较佳的,所述的第一特性为一第一脚位定义,所述的第二特性为一第二脚位定义;所述的第一快闪记忆接口包含一交换电路,用以执行所述的第一脚位定义与所述的第二脚位定义之间的转换。
较佳的,所述的第一快闪记忆接口还包含一组态单元,用以提供组态信息,所述的交换电路是依据所述的组态信息执行所述的第一脚位定义与所述的第二脚位定义之间的转换。
较佳的,所述的控制电路是从所述的快闪记忆单元读取所述的第二特性所对应的所述的组态信息,并写入所述的组态单元的一缓存器中。
较佳的,所述的第一特性为一第一工作电压,所述的第二特性为一第二工作电压;所述的控制电路包含一电压调整器,用以执行所述的第一工作电压与所述的第二工作电压之间的转换。
较佳的,所述的第一特性为一第一讯号时序,所述的第二特性为一第二讯号时序;所述的控制电路包含一时序转换电路,用以执行所述的第一讯号时序与所述的第二讯号时序之间的转换。
较佳的,所述的第一特性为一第一指令集,所述的第二特性为一第二指令集;所述的第一快闪记忆接口包含一指令解译单元,用以从所述的主机接收所述的第一指令集的指令,并产生一对应的解译讯号;所述的第二快闪记忆接口包含一指令产生单元,用以依据所述的解译讯号,产生所述的第二指令集的对应指令。
较佳的,所述的第一特性为不执行坏区块管理,所述的第二特性为执行坏区块管理;所述的控制电路包含:
一对应表,储存所述的快闪记忆单元的各区块的逻辑地址与实体地址间的对应关系;以及
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