[发明专利]放大器电路及用于校正差分时钟信号的占空因数的方法无效
| 申请号： | 200580046607.2 | 申请日： | 2005-11-02 |
| 公开（公告）号： | CN101103529A | 公开（公告）日： | 2008-01-09 |
| 发明（设计）人： | 帕特里克·海涅 | 申请（专利权）人： | 奇梦达股份公司 |
| 主分类号： | H03K5/00 | 分类号： | H03K5/00 |
| 代理公司： | 北京康信知识产权代理有限责任公司 | 代理人： | 章社杲;吴贵明 |
| 地址： | 德国*** | 国省代码： | 德国;DE |
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| 摘要： | |||
| 搜索关键词： | 放大器 电路 用于 校正 时钟 信号 因数 方法 | ||
1.一种放大器电路，用于利用MOS晶体管对(T1、T2)构成的差分放大器级(1)将差分时钟信号(CLt、CLc)的占空因数校正到为50％的理想值，所述MOS晶体管对的栅极端子对接收待校正的时钟信号(CLt、CLc)，并且所述MOS晶体管对的源极/漏极端子发送具有校正的占空因数的时钟信号(ACLt、ACLc)，并且所述MOS晶体管对具有校正信号输入端子对，所述校正信号输入端子对接收检测器级产生的模拟占空因数校正信号(DCt、DCc)，所述检测器作为积分器接通并且与所述差分放大器级的源极/漏极端子对连接，其特征在于，校正信号输入端子对由所述MOS晶体管对(T1、T2)的彼此电隔离的衬底端子(S1、S2)构成，从而占空因数校正信号(DCc、DCt)分别在相反方向上影响所述晶体管对(T1、T2)的MOS晶体管的各个衬底电压和开启电压。
2.根据权利要求1所述的放大器电路，其特征在于，所述MOS晶体管对(T1、T2)具有两个NMOS晶体管。
3.根据权利要求1或2所述的放大器电路，其特征在于，所述两个MOS晶体管(T1、T2)的源极/漏极端子也分别与一个电源(IQ1、IQ2、IQ3)连接。
4.根据权利要求1所述的放大器电路，其特征在于，串联多个所述差分放大器级，以扩大校正范围。
5.一种方法，该方法用于利用具有MOS晶体管对(T1、T2)的差分放大器(1)将差分时钟信号(CLt、CLc)的占空因数校正到为50％的理想值，其包括以下步骤：
-将待校正的时钟信号(CLt、CLc)施加给所述MOS晶体管对(T1、T2)的各自的栅极端子；
-通过分别对真时钟信号和互补时钟信号(ACLt、ACLc)求积分产生差分模拟占空因数校正信号(DCt、DCc)，其中所述真时钟信号和互补时钟信号由所述差分放大器的每个MOS晶体管在其源极/漏极端子发送，并且
-将这样产生的所述差分占空因数校正信号(DCt、DCc)施加给所述差分放大器(1)的校正信号输入端子对，其特征在于，所述差分占空因数校正信号分别施加给所述MOS晶体管对(T1、T2)的彼此电隔离的衬底端子(S1、S2)，所述衬底端子构成所述差分放大器(1)的校正信号输入端子对，从而分别在相反方向上影响所述晶体管对的MOS晶体管(T1、T2)的衬底电压和开启电压。
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