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- [发明专利]数据输出电路-CN202310085879.3在审
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李思曼;严允柱
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长鑫存储技术有限公司
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2023-01-17
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2023-05-02
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G11C7/10
- 本公开实施例公开了一种数据输出电路,所述数据输出电路包括:选择电路,用于根据接收到的第一代码选择输出第一控制信号,或选择输出第二控制信号;驱动电路,连接所述选择电路,所述驱动电路用于接收第一数据信号并根据所述第一控制信号输出第一电平,或根据第二控制信号输出第二电平;所述第一电平包括电源电压;所述第二电平大于所述第一电平。本公开实施例利用第一代码来选择输出合适的控制信号,驱动电路根据该控制信号以产生合适的输出电压。
- 数据输出电路
- [发明专利]数据输出电路-CN201910104356.2有效
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金熙埈;黄敏淳
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爱思开海力士有限公司
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2019-02-01
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2022-11-04
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G11C7/10
- 数据输出电路。一种数据输出电路包括:电压发生电路,其被配置为生成电位电平比第一电源电压和第二电源电压的电平高的操作电压;预驱动器电路,其被配置为根据校准码信号和操作电压生成上拉代码信号和下拉代码信号;数据预驱动器电路,其被配置为根据数据信号和第一电源电压生成并输出内部数据;以及主驱动器电路,其被配置为根据内部数据和第二电源电压生成输出数据,其中,所述主驱动器电路的驱动强度根据上拉代码信号和下拉代码信号来调整。
- 数据输出电路
- [发明专利]数据输入/输出电路-CN200910146400.2无效
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崔勋;郑镇一
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海力士半导体有限公司
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2009-06-26
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2010-03-10
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G11C7/10
- 一种数据输入/输出电路,包括:输出单元,用于响应于延迟锁相环中产生的内部时钟输出第一数据选通信号和第一数据;第一传输线单元,其具有时钟树结构,用于将内部时钟传输到输出单元;第二传输线单元,用于将来自延迟锁相环的内部时钟传输到第一传输线单元;占空比校正单元,其互连于第一传输线单元与第二传输线单元之间,用于校正内部时钟的占空比;数据选通信号输入单元,用于从半导体存储器设备的外部接收第二数据选通信号并产生内部数据选通信号;以及多个数据输入单元,用于响应于内部数据选通信号输出第二数据。
- 数据输入输出电路
- [发明专利]数据输出缓冲电路-CN97125597.0无效
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金东均
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LG半导体株式会社
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1997-12-24
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1998-10-14
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G11C7/00
- 一种数据输出缓冲电路,包括噪声产生抑制部分,检测加到输入和输出数据的输入/输出端子的信号的电平,输出第一和第二噪声产生抑制信号;上拉晶体管,具有连接到输入/输出端子的源极和连接到电源端的漏极;下拉晶体管,与输入/输出端子相连的上拉和下拉晶体管的二个源极串联连接到上拉晶体管;第一和第二驱动部分,驱动上拉和下拉晶体管;箝位晶体管,用第一噪声产生抑制信号导通,抑制由上拉晶体管的栅极和源极间的电压差引起的衬底偏置的增加
- 数据输出缓冲电路
- [发明专利]数据输出电路和方法-CN200910006037.4无效
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李康悦
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海力士半导体有限公司
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2009-01-22
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2010-06-16
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G11C7/10
- 提供了一种数据输出电路和方法,所述电路包括:选通信号控制块,被配置成通过将第一选通信号延迟特定的延迟量而产生至少一个第一延迟选通信号;输入/输出读出放大块,被配置成响应于所述第一选通信号和所述第一延迟选通信号而放大第一并行数据信号,以产生具有与所述第一并行数据信号的比特数量相同的比特数量的第二并行数据信号;存储块,被配置成响应于第二选通信号和第二延迟选通信号来锁存所述第二并行数据信号;以及并行到串行转换块,被配置成顺序地输出被锁存在所述存储块内的所述第二并行数据信号,其中,所述第一选通信号用于产生所述第二并行数据信号中的首先被输出的数据信号。
- 数据输出电路方法
- [实用新型]图像数据输出电路及显示电路-CN201921748278.1有效
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肖永贵;胡渊
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深圳市富满电子集团股份有限公司
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2019-10-17
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2020-04-03
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G09G3/32
- 本实用新型提供的图像数据输出电路,灰度计数器的输出端连接至第一比较器的一输入端,外部输入数据的高M位输入到第一比较器的另一输入端,第一比较器的输出端连接至或门的一输入端;子帧计数器的输出端连接至第二比较器的一输入端,外部输入数据的低N位输入到第二比较器的另一输入端,第二比较器的输出端连接至或门的另一输入端;所述外部输入数据为M+N位;灰度计数器的输出端连接至行计数器的时钟端,行计数器的输出端连接至子帧计数器的时钟端;或门的输出端接LED屏的列驱动端,该电路无需调高显示计数时钟频率,充分的保证了原有LED屏器件特性,解决了闪屏现象,完整的显示出超10Bit的图像数据,提升了LED屏显示效果。
- 图像数据输出电路显示
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