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- [发明专利]分频器和电子设备-CN202010133975.7有效
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张卫波;廖英豪
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深圳市紫光同创电子有限公司
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2020-02-28
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2023-03-10
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H03L7/181
- 本申请提供一种分频器和电子设备，分频器包括：分频比选择模块，用于响应于分频比选择信号中的第二信号，将第一电平设置值作为分频比设置值输出，响应于分频比选择信号中的第一信号，将第二电平设置值作为分频比设置值输出；分频器模块，用于获取分频比设置值输出，根据上次所获取到的分频比设置值进行分频，并生成分频比选择信号以及分频后的时钟信号，输出生成的分频比选择信号至分频比选择模块，分频后的时钟信号中当前电平的持续时间除以分频前的时钟信号的一个周期持续时间为上次获取到的分频比设置值，分频后的时钟信号中当前电平的持续时间结束时，分频比选择信号中的第一信号和第二信号进行切换，分频后的时钟信号中的两种电平进行切换。
- 分频器电子设备
- [发明专利]一种扩展分频比的可编程分频器-CN201710746347.4有效
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李巍;徐媛媛
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复旦大学
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2017-08-26
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2020-12-18
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H03L7/18
- 本发明属于分频器集成电路技术领域，具体涉及一种扩展分频比的可编程分频器。本发明可编程分频器包括：n个级联的2/3分频单元，其中前n‑1级为不带分频比扩展位的2/3分频单元，最后一级为带有分频比扩展位的2/3分频单元；分频比后总分频范围为；对最后一级带有分频比扩展位的2/3分频单元，通过采用带复位端rst的锁存器和对锁存器进行时序调换的方法，保证扩展分频比的可编程分频器在扩展分频比边界处切换时工作正常相比已有的技术，本发明克服了传统可编程分频器在扩展分频比边界处切换时存在的分频失效问题，结构简单且性能可靠；可以应用于宽带小数分频频率综合器中。
- 一种扩展分频可编程分频器
- [发明专利]小数分频系统-CN201310073355.9有效
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荣蓉;许刚
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上海山景集成电路股份有限公司
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2013-03-07
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2013-06-26
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H03K23/64
- 本发明提供一种小数分频系统。该小数分频系统至少包括：基于预设的分频比变化率及分频比的小数部分来产生相应的数字序列的序列产生电路；基于序列产生电路输出的数字序列来输出包含2种控制信号的控制信号流的delta-sigma调制器；基于delta-sigma调制器输出的控制信号流的当前控制信号由预定的各分频比中确定一种作为当前分频比的分频比控制电路；基于所确定的当前分频比来对待分频的频率信号进行当前分频的分频器；其中，在预定数量个待分频的频率信号的周期时间，输出的2种控制信号的个数比基于分频比的小数部分来确定。
- 小数分频系统
- [发明专利]半导体集成电路-CN201280004099.1有效
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满仲健
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夏普株式会社
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2012-01-12
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2013-08-21
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H03L7/183
- 在包含了能工作振荡出多种频率的本机振荡器（109）、振荡出规定的基准频率的基准信号振荡器（107）、和将上述本机振荡器的输出信号分频成上述基准频率的n倍的可变分频器（110）的半导体集成电路中，具备根据所被提供的直流电位来控制上述可变分频器的分频比的第1分频比设定部（103、104、118）、和根据是否有脉冲信号的提供来控制上述可变分频器的分频比的第2分频比设定部（104、105、118）；通过上述第1分频比设定部或上述第2分频比设定部对上述可变分频器实施的分频比控制，上述本机振荡器的本振频率被设定成期望的频率；上述直流电位介由电流镜电路（119）而提供到上述第1分频比设定部。
- 半导体集成电路
- [发明专利]同步系统以及分频电路-CN201410455012.3有效
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山下和宪
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株式会社巨晶片
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2014-09-09
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2017-10-31
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H03K23/00
- 本发明提供一种同步系统以及分频电路。该同步系统具备分频电路，以通过分频比设定信号而被设定的第1分频比，将基准时钟进行分频而生成分频时钟；第1设备，与所述基准时钟同步动作；第2设备，与分频时钟同步动作；分频比检测电路，每隔分频时钟的1个周期，输出与基准时钟同步而进行计数的计数值，并且，根据计数值检测分频时钟的分频比并作为第2分频比输出；及解码器，根据计数值以及第2分频比而生成选通信号，所述选通信号用于控制第1设备对第2设备输入输出信号的时刻第1设备根据选通信号并经由与分频时钟同步动作的总线，与第2设备进行通信。
- 同步系统以及分频电路
- [发明专利]片上时钟校准装置及校准方法-CN201811031597.0有效
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樊骕研;杨焰文;李育强
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深圳全志在线有限公司
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2018-09-05
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2022-02-15
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H03L7/08
- 本发明公开一种片上时钟校准装置及校准方法，该装置包括RC振荡电路、分频校准电路和基准高频时钟源，分频校准电路包括定时计数器、分频比计算模块以及高频时钟启动模块；定时计数器接收分频器输出的低频时钟信号，并且间歇性的向高频时钟启动模块输出启动信号；高频时钟启动模块接收启动信号后，启动基准高频时钟源；基准高频时钟源启动后向分频比计算模块输出高频时钟信号；分频比计算模块接收原始RC时钟信号以及高频时钟信号，并计算分频比，将分频比的数值输出至分频器；分频器基于分频比对原始RC时钟信号进行分频并输出校准后的低频时钟信号。
- 时钟校准装置方法
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