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- [发明专利]快闪存储器-CN00119249.3有效
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田中智晴;柴田升;丹沢彻
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株式会社东芝
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2000-06-28
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2001-01-10
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G11C16/06
- 一种快闪存储器,可内部自动校正错误,与现有产品具有互换性。它包括存储器段;指令接口3,接受外部指令产生控制信号;电路7,由写入指令信号激活,产生控制信号;错误校正电路11,由写入数据输入指令信号激活,与外部输入的第一信号同步,接受外部输入的写入数据,由写入指令激活,与控制信号同步,产生检查数据;电路17,相对各个存储器单元设置,将写入数据或检查数据取入暂存;写入电路13－15,由写入指令激活,将存储的写入数据和检查数据写入存储器段。
- 闪存
- [发明专利]快闪存储器-CN200510065564.4有效
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田中智晴;柴田昇;丹沢徹
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株式会社东芝
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2000-06-28
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2005-10-12
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G11C16/06
- 一种快闪存储器，可内部自动校正错误，与现有产品具有互换性。它包括：存储器段；指令接口3，接受外部指令产生控制信号；电路7，由写入指令信号激活，产生控制信号；错误校正电路11，由写入数据输入指令信号激活，与外部输入的第一信号同步，接受外部输入的写入数据，由写入指令激活，与控制信号同步，产生检查数据；电路17，相对各个存储器单元设置，将写入数据或检查数据取入暂存；写入电路13～15，由写入指令激活，将存储的写入数据和检查数据写入存储器段。
- 闪存
- [发明专利]操作快闪存储器芯片的方法-CN200510136886.3有效
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郑畯燮;杨中燮
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海力士半导体有限公司
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2005-12-27
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2007-03-21
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G11C16/06
- 一种用于操作封装的快闪存储器模块的方法，包括：向在封装的快闪存储器模块中排列的多个快闪存储器芯片的第一快闪存储器芯片施加第一编程或擦除命令和与第一命令相关联的第一地址；向在封装的快闪存储器模块中排列的多个快闪存储器芯片的第二快闪存储器芯片施加第二编程或擦除命令和与第二命令相关联的第二地址，第二命令在第一快闪存储器芯片完成第一命令之前被施加到第二快闪存储器芯片；以及确定是否第一快闪存储器芯片已经完成第一命令。如果确定第一快闪存储器芯片还没有完成第一命令，则查看是否第二快闪存储器芯片已经完成第二命令。如果确定第一快闪存储器芯片已经完成第一命令，则查看是否所完成的第一命令对应于第一快闪存储器芯片的最后页面。
- 操作闪存芯片方法
- [发明专利]快闪存储器控制器及方法-CN202211281238.7在审
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吕祖汉;颜孝昌
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慧荣科技股份有限公司
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2022-10-19
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2023-09-05
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G06F3/06
- 本发明涉及一种用于储存装置中并通过特定通信接口耦接于储存装置的快闪存储器装置的快闪存储器控制器及方法。该快闪存储器控制器的方法包括：提供耦接到快闪存储器装置的输入/输出电路；向快闪存储器装置发送一数据切换设定特征信号以启用、关闭或设置该快闪存储器装置的数据切换操作；快闪存储器装置的数据切换操作是用于使快闪存储器装置控制快闪存储器装置的数据暂存器选择第一数据单元和第二数据单元并将其传送到快闪存储器装置的输入/输出控制电路，以使输入/输出控制电路因应于快闪存储器控制器发送的特定读取命令或数据切换命令，通过特定通信接口将第一数据单元和第二数据单元依序地传输至快闪存储器控制器。
- 闪存控制器方法
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