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[发明专利]一种开关器件并联均流系统-CN201810241776.0在审
发明人：王树明 -专利权人：维谛技术有限公司
申请日： 2018-03-22 - 公布日： 2019-10-01 - 主分类号： H02M1/088 文献下载
摘要：一种开关器件并联均流系统，包括：开关器件并联模块和变压器均流模块，所述开关器件并联模块包括至少两个彼此并联的开关器件，所述变压器均流模块包括至少一个变压器，所述开关器件的第一端均连接所述变压器均流模块的输入端，所述开关器件的控制端均连接所述变压器均流模块的输出端以控制流过所述开关器件的电流相等，所述开关器件的第二端接地。实施本发明的开关器件并联均流系统，通过将并联开关器件的控制端连接到变压器的副边线圈两端，强制使得并联开关器件的电流相等，进一步地，本发明的开关器件并联均流系统可以灵活适用于各种类型的开关器件并联模块的均流进一步地，开关器件的开关时间同样被强制同步。
开关器件并联开关器件变压器均流均流系统并联开关控制端相等副边线圈强制同步第一端端接地输出端输入端并联灵活

[实用新型]一种开关器件并联均流系统-CN201820394756.2有效
发明人：王树明 -专利权人：维谛技术有限公司
申请日： 2018-03-22 - 公布日： 2018-09-28 - 主分类号： H02M1/088 文献下载
摘要：一种开关器件并联均流系统，包括：开关器件并联模块和变压器均流模块，所述开关器件并联模块包括至少两个彼此并联的开关器件，所述变压器均流模块包括至少一个变压器，所述开关器件的第一端均连接所述变压器均流模块的输入端，所述开关器件的控制端均连接所述变压器均流模块的输出端以控制流过所述开关器件的电流相等，所述开关器件的第二端接地。实施本实用新型的开关器件并联均流系统，通过将并联开关器件的控制端连接到变压器的副边线圈两端，强制使得并联开关器件的电流相等，进一步地，本实用新型的开关器件并联均流系统可以灵活适用于各种类型的开关器件并联模块的均流进一步地，开关器件的开关时间同样被强制同步。
开关器件并联开关器件变压器均流均流系统本实用新型并联开关控制端相等副边线圈强制同步第一端端接地输出端输入端并联灵活

[发明专利]一种多器件并联功率模块的布局电路板-CN202010008671.8在审
发明人：赵斌;柯俊吉;张浩然;赵志斌 -专利权人：华北电力大学
申请日： 2020-01-06 - 公布日： 2020-04-24 - 主分类号： H01L25/16 文献下载
摘要：本发明公开一种多器件并联功率模块的布局电路板。所述多器件并联功率模块的布局电路板中，第一莲花形BNC接口(包括所述负载正极输出端子和所述负载负极输出端子)位于PCB板中心，碳化硅器件并联模块中的多个并联碳化硅器件以所述第一莲花形BNC接口为圆心采用圆周布局；退耦合电容并联模块中的多个并联退耦合电容以所述第一莲花形BNC接口为圆心采用圆周布局，优化了并联器件的排列位置，使得电路寄生参数匹配，降低了电路杂散电感的分布差异并消除了电流耦合效应，能够改变多器件并联功率模块的暂态电流不平衡，实现较好的并联碳化硅器件的均流特性。
一种器件并联功率模块布局电路板

[实用新型]一种多器件并联功率模块的布局电路板-CN202020015518.3有效
发明人：赵斌;柯俊吉;张浩然;赵志斌 -专利权人：华北电力大学
申请日： 2020-01-06 - 公布日： 2020-06-12 - 主分类号： H01L25/16 文献下载
摘要：本实用新型公开一种多器件并联功率模块的布局电路板。所述多器件并联功率模块的布局电路板中，第一莲花形BNC接口(包括所述负载正极输出端子和所述负载负极输出端子)位于PCB板中心，碳化硅器件并联模块中的多个并联碳化硅器件以所述第一莲花形BNC接口为圆心采用圆周布局；退耦合电容并联模块中的多个并联退耦合电容以所述第一莲花形BNC接口为圆心采用圆周布局，优化了并联器件的排列位置，使得电路寄生参数匹配，降低了电路杂散电感的分布差异并消除了电流耦合效应，能够改变多器件并联功率模块的暂态电流不平衡，实现较好的并联碳化硅器件的均流特性。
一种器件并联功率模块布局电路板

[发明专利]一种基于SVG的电路图到盲文转换方法及系统-CN202010666199.7在审
发明人：许存禄;苏伟;高伟;林和;吴尽昭 -专利权人：兰州大学
申请日： 2020-07-10 - 公布日： 2020-10-23 - 主分类号： G06F40/58 文献下载
摘要：本发明涉及一种基于SVG的电路图到盲文转换方法及系统，所述方法至少包括：基于SVG文件生成电路图中元器件的基本属性；基于所述基本属性生成元器件类，并判断是否包含并联电路；若包含并联电路，则基于所述元器件类进行并联电路处理以生成并联电路类，其中，所述元器件类和并联电路类为至少描述元器件和并联电路的类型、ASCII码、空间位置关系的有序集合；基于所述元器件类和/或并联电路类进行主电路处理以生成盲文ASCII码电路图。
一种基于 svg 电路图盲文转换方法系统

[发明专利]智能电表集成电路的串并联等效故障压缩方法-CN202211019237.5在审
发明人：杨成林;张棋皓;王厚军;田书林 -专利权人：电子科技大学
申请日： 2022-08-24 - 公布日： 2022-12-13 - 主分类号： G01R35/04 文献下载
摘要：本发明公开了一种智能电表集成电路的串并联等效故障压缩方法，构建集成电路的网表文件，根据网表文件构建器件与网络节点的关系模型，得到器件‑节点矩阵，根据器件‑节点矩阵进行串联器件识别，根据得到的串联组构建串联器件矩阵和串联数量矩阵，再基于这两个矩阵进行串联关系合并，得到最终的串联器件集合；根据器件‑节点矩阵进行并联器件识别，得到并联器件集合，最后基于串联器件集合和并联器件集合进行等效故障压缩。本发明对集成电路中全部器件的串、并联关系进行识别，进而实现等效故障压缩，从而减少故障注入的次数，缩短故障诊断时间。
智能电表集成电路串并联等效故障压缩方法

[发明专利]基于三路并联微晶器件的小型化电源模块-CN202111623796.2在审
发明人：吴迪;张凯;刘智华;高飞;吕奕铭 -专利权人：中国航天科工集团八五一一研究所
申请日： 2021-12-28 - 公布日： 2022-04-05 - 主分类号： H02M3/07 文献下载
摘要：本发明公开了一种基于三路并联微晶器件的小型化电源模块，包括外置时钟、射随电路、第一微晶器件子模块、第二微晶器件子模块和第三微晶器件子模块，三个微晶器件子模块并联，采用1主2从的工作模式；外置时钟连接在并联的三个微晶器件子模块一端，射随电路并联在三个微晶器件子模块另一端。本发明通过增加微晶器件的并联数量，提高其最大输出电流，为电子器件提供足额能量。
基于并联器件小型化电源模块

[发明专利]一种共源共栅氮化镓器件及其应用-CN201711352714.9在审
发明人：卓放;朱田华;王丰;王海林;贺鑫露;史书怀 -专利权人：西安交通大学
申请日： 2017-12-15 - 公布日： 2018-05-22 - 主分类号： G06F17/50 文献下载
摘要：本发明公开了一种新型的共源共栅氮化镓器件及其应用，包括硅器件和若干并联的氮化镓器件，所述硅器件与若干并联的氮化镓器件串联连接形成共源共栅结构；若干并联的氮化镓器件的源极均与硅器件的漏极相连接，若干并联的氮化镓器件的栅极均与硅器件的源极相连接，若干并联的氮化镓器件的漏极共接作为整个共源共栅氮化镓器件的漏极。本发明仅需使用一个驱动芯片，即可达到现有氮化镓器件两倍及以上的通流能力，从而可增大功率密度、提高系统效率和节省成本。
一种共源共栅氮化器件及其应用

[发明专利]一种开关器件筛选系统及方法-CN201711260643.X有效
发明人：孙鹏;柯俊吉;邹琦;黄华震;赵志斌;崔翔 -专利权人：华北电力大学
申请日： 2017-12-04 - 公布日： 2019-12-06 - 主分类号： G01R31/327 文献下载
摘要：本发明公开了一种开关器件筛选系统及方法。该系统包括驱动电路、开关电路、并联电路、测量电路以及示波器；驱动电路，与并联电路连接，用于产生驱动电压，驱动待筛选的开关器件；开关电路，与并联电路连接，用于为待筛选的开关器件提供直流偏置电压，产生导通状态下的稳态电流和开关过程中的暂态电流；并联电路，用于并联待筛选的开关器件，使待筛选的开关器件的驱动电压和直流偏置电压均相同；测量电路，与并联电路连接，用于测量所述待筛选的开关器件中流过的暂态电流和稳态电流；示波器，与测量电路连接，用于显示电流波形本系统和本方法能够快速精确的对开关器件进行筛选，保证开关器件的均一性，避免开关器件的损坏。
一种开关器件筛选系统方法

[发明专利]一种开关式交错DC-DC变换器-CN201711110789.6在审
发明人：周宇;许洪华 -专利权人：北京科诺伟业科技股份有限公司
申请日： 2017-11-08 - 公布日： 2018-04-24 - 主分类号： H02M3/158 文献下载
摘要：一种开关式交错DC‑DC变换器，其第一开关器件SW1和第二开关器件SW2并联，第三开关器件SW3和第四开关器件SW4并联。变换器输入电压端Vin的正极连接电感L1的一端，电感L1的另一端连接并联的第一开关器件SW1和第二开关器件SW2，并联的第一开关器件SW1和第二开关器件SW2的另一端接入输入电压端Vin的负极；并联的第一开关器件SW1和第二开关器件SW2再串连第三开关器件SW3和第四开关器件SW4并联支路；第三开关器件SW3和第四开关器件SW4并联支路的另一端和变换器的输出电压端Vout的正极；输出电压端Vout的正负极间并联滤波电容本发明将PWM的一个时间周期分为2组，控制2个开关器件，在PWM频率不变的情况下通过电感以及电容的电流和电压频率增加一倍，电流和电压纹波值减少一倍。
一种开关交错 dc 变换器

[发明专利]一种快速确定并联电路电子器件短路的检测方法-CN201910958398.2有效
发明人：马建敏 -专利权人：复旦大学
申请日： 2019-10-10 - 公布日： 2022-04-12 - 主分类号： G01R31/52 文献下载
摘要：本发明属于电子技术领域，具体为一种快速确定并联电路电子器件短路的检测方法。本发明利用LCR数字电桥阻抗档测量并联电路的阻抗，阻抗最小点即为短路器件在电路中所在位置；所述并联电路为多个纯电阻、多个纯电容或多个纯电感并联的电路，或者为电阻、电容、电感混合并联的电路，或者为其它能通过阻抗大小判定器件短路与否的并联电路本发明检测速度快，且不受并联器件数量及类型的限制。
一种快速确定并联电路电子器件短路检测方法

[发明专利]一种SiC/Si混合并联开关器件及其优化控制方法-CN201610396071.7有效
发明人：赵海伟;秦海鸿;朱梓悦;谢昊天 -专利权人：南京航空航天大学
申请日： 2016-06-07 - 公布日： 2018-08-24 - 主分类号： H02M1/088 文献下载
摘要：本发明公开了一种SiC/Si混合并联开关器件及其优化控制方法，包括连接于开关器件的输入端和输出端之间的SiC器件组及并联连接于SiC器件组两端的Si器件组；所述SiC器件组由m个SiC器件并联组成，其中m为1以上的正整数；所述Si器件组由n个Si器件并联组成，其中n为1以上的正整数；根据所述开关器件的输入端和输出端之间负载电流大小，控制SiC器件组和Si器件组开通或关断。本发明可最大程度的减小功率变换器的损耗，提高过载工作能力，扩大混合并联器件的安全工作区；并且，在提高功率变换器功率处理能力的同时使得功率器件的损耗尽可能小，同时降低系统的损耗和成本，并满足功率变换器的过载要求
一种 sic si 混合并联开关器件及其优化控制方法

[发明专利]一种高集成度多芯片并联氮化镓半桥功率模块-CN202310028709.1在审
发明人：王来利;王振宇;齐志远;姚乙龙;温浚铎;张轶凡;孔航;汪岩;甘永梅 -专利权人：西安交通大学
申请日： 2023-01-09 - 公布日： 2023-04-25 - 主分类号： H01L25/065 文献下载
摘要：本发明涉及电力电子器件封装集成技术领域，尤其涉及一种高集成度多芯片并联氮化镓半桥功率模块，包括GaN器件、功率回路解耦电容Cin、PCB电路板、DBC板和驱动芯片，GaN器件设置于PCB电路板与DBC板之间；驱动芯片均设置于PCB电路板上；GaN器件包括第一GaN器件S1、第二GaN器件S2、第三GaN器件S3和第四GaN器件S4，第一GaN器件S1和第二GaN器件S2并联形成上半桥；第三GaN器件S3和第四GaN器件S4并联形成下半桥。本发明利用并联垂直结构降低功率回路和驱动回路的寄生电感，同时通过功率回路和驱动电路的对称设计保证布局对称，实现器件的并联均流效果。
一种集成度芯片并联氮化镓半桥功率模块

[实用新型]并联支路具有高耐压能力的天线调谐开关-CN202021809491.1有效
发明人：李志 -专利权人：无锡中普微电子有限公司
申请日： 2020-08-26 - 公布日： 2021-04-09 - 主分类号： H04B1/18 文献下载
摘要：本实用新型涉及一种并联支路具有高耐压能力的天线调谐开关。其包括天线ANT以及射频通路，每条射频通路均包括一串联支路以及一并联支路；并联支路包括若干依次串接的MOSFET器件以及并联支路控制端组，并联支路内所有MOSFET器件的栅极端均与并联支路控制端组内的并联支路栅极控制端VGSH1适配连接；并联支路内，在每个MOSFET器件的源极端与所述MOSFET器件的漏极端之间均连接有并联支路电容以及并联支路源漏电阻。本实用新型在不增加版图面积的情况下，增加并联支路的耐压能力，提高天线调谐开关的稳定性与可靠性。
并联支路具有耐压能力天线调谐开关

[实用新型]一种电子元器件并联连接线-CN201120139837.6有效
发明人：朱茂华 -专利权人：朱茂华
申请日： 2011-05-05 - 公布日： 2011-12-21 - 主分类号： H01R25/16 文献下载
摘要：本实用新型提供了一种电子元器件并联连接线，属于电子元器件接线技术领域。它解决了现有的电子元器件并联数量较多时，接线错综复杂的问题。本电子元器件并联连接线包括一根电缆线，所述电缆线上依次设有若干个接线头，所述的接线头采用导电材料制成且与电缆线电连接。本电子元器件并联连接线可以大大简化并联连接时的接线需要，降低了接线时的工作量。
一种电子元器件并联连接线

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