[发明专利]锁频环型全数字频率综合器有效
| 申请号： | 201910967037.4 | 申请日： | 2019-10-12 |
| 公开（公告）号： | CN110581708B | 公开（公告）日： | 2022-11-11 |
| 发明（设计）人： | 李松亭;陈利虎;赵勇;杨磊;宋新;白玉铸 | 申请（专利权）人： | 中国人民解放军国防科技大学 |
| 主分类号： | H03L7/093 | 分类号： | H03L7/093;H03L7/099;H03L7/18 |
| 代理公司： | 长沙国科天河知识产权代理有限公司 43225 | 代理人： | 段盼姣 |
| 地址： | 410073 湖*** | 国省代码： | 湖南;43 |
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| 摘要： | 本申请涉及一种锁频环型全数字频率综合器。包括：鉴频器模块、频率积分模块以及频率调谐模块；鉴频器模块、频率积分模块以及频率调谐模块依次连接，频率调谐模块的输出端的输出端信号反馈至鉴频器模块，鉴频器模块包括：可变频率计数器，可变频率计数器用于与频率控制字比较得到整数频率误差；时间数字转换器用于得到小数频率误差，鉴频器模块还用于将整数频率误差与小数频率误差相加后得到系统频率误差，频率积分模块用于得到系统相位误差，频率调谐模块用于接收系统相位误差，并对系统相位误差进行处理，得到输出端信号并输出。本发明在实现锁相环型全数字频率综合器的全部功能的同时，可以避免相位误差模糊导致的无法锁定问题。 | ||
| 搜索关键词： | 锁频环型全 数字 频率 综合 | ||
【主权项】：
1.一种锁频环型全数字频率综合器，其特征在于，包括：/n鉴频器模块、频率积分模块以及频率调谐模块；/n所述鉴频器模块、所述频率积分模块以及所述频率调谐模块依次连接，所述频率调谐模块的输出端的输出端信号反馈至所述鉴频器模块；/n所述鉴频器模块包括：/n可变频率计数器，所述可变频率计数器连接所述频率调谐模块的输出端，并对所述输出端信号的输出频率进行计数，并且与频率控制字比较，得到整数频率误差；/n时间数字转换器，所述时间数字转换器用于分别标定当前时刻与上一时刻输入参考频率信号在系统同步信号上升沿时刻超前所述输出端信号的时间量，根据所述时间量的差值对所述输出端信号的周期进行归一化，得到小数频率误差；/n所述鉴频器模块还用于将所述整数频率误差与所述小数频率误差相加后得到系统频率误差；/n所述频率积分模块用于接收所述系统频率误差，对所述系统频率误差进行累加并限幅，得到系统相位误差；/n所述频率调谐模块用于接收所述系统相位误差，并对所述系统相位误差进行处理，得到输出端信号并输出。/n
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