[发明专利]一种改善闪存编程能力的方法有效
申请号: | 201810050666.6 | 申请日: | 2018-01-18 |
公开(公告)号: | CN108206190B | 公开(公告)日: | 2020-12-11 |
发明(设计)人: | 徐杰;黄冲;李志国 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L27/11524 | 分类号: | H01L27/11524 |
代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 屈蘅 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种改善闪存编程能力的方法,包括:在晶圆衬底上依次沉积耦合氧化层、浮栅多晶硅和氮化硅阻挡层;将浮栅多晶硅上方中间部分的氮化硅阻挡层去掉,保留左右侧的氮化硅阻挡层,再对浮栅多晶硅中间的裸露部分进行斜坡蚀刻;在两阻挡层、浮栅多晶硅上沉积一层隔离层;对晶圆衬底的对应浮栅多晶硅开口处的部分进行离子掺杂形成源线下方的重掺杂区,在切断的浮栅多晶硅旁形成两侧墙,并在侧墙中间空隙中填充多晶硅后进行平坦化;在平坦化后的源线多晶硅上生长一层隔离层,除去浮栅多晶硅上左右侧的氮化硅阻挡层,以浮栅上方的氧化层和源线上的隔离层作为阻挡层对剩余的浮栅多晶硅进行蚀刻得到浮栅;优化浮栅侧壁的粗糙度,得到光滑的侧壁。 | ||
搜索关键词: | 一种 改善 闪存 编程 能力 方法 | ||
【主权项】:
1.一种改善闪存编程能力的方法,包括如下步骤:步骤S1,在晶圆衬底(10)上依次沉积耦合氧化层(20)、浮栅多晶硅(30)和氮化硅阻挡层(40);步骤S2,将浮栅多晶硅(30)上方中间部分的氮化硅阻挡层(40)去掉,保留左侧的氮化硅阻挡层(401)和右侧的氮化硅阻挡层(402),再对浮栅多晶硅(30)中间的裸露部分进行斜坡蚀刻;步骤S3,在左侧的氮化硅阻挡层(401)、浮栅多晶硅(30)、右侧的氮化硅阻挡层(402)上沉积一层隔离层(50);步骤S4,对晶圆衬底(10)的对应浮栅多晶硅(30)开口处的部分进行离子掺杂形成源线下方的重掺杂区(801),在切断的浮栅多晶硅(30)旁形成侧墙(701)和(702),并在侧墙(701)和(702)中间的空隙中填充多晶硅(802)后进行平坦化;步骤S5,在平坦化后的源线多晶硅(802)上生长一层SiO2隔离层(90),除去浮栅多晶硅(30)上左侧的氮化硅阻挡层(401)和右侧的氮化硅阻挡层(402),然后以浮栅上方的氧化层即侧墙(501)、(502)和源线上的SiO2隔离层(90)作为阻挡层对剩余的浮栅多晶硅(30)进行蚀刻得到浮栅(301)和(302);步骤S6,优化浮栅侧壁的粗糙度,得到光滑的侧壁。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
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