[发明专利]基于逐次逼近算法的ADC自校正电路有效

专利信息
申请号: 201710320936.6 申请日: 2017-05-09
公开(公告)号: CN107147393B 公开(公告)日: 2019-06-25
发明(设计)人: 胡蓉彬;王永禄;张正平;王健安;陈光炳;付东兵;王育新;蒋和全;胡刚毅 申请(专利权)人: 中国电子科技集团公司第二十四研究所
主分类号: H03M1/10 分类号: H03M1/10
代理公司: 重庆乐泰知识产权代理事务所(普通合伙) 50221 代理人: 刘佳
地址: 400060 *** 国省代码: 重庆;50
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摘要: 发明公开一种基于逐次逼近算法的ADC自校正电路,包括:编码电路、分压电阻串、比较器阵列、多路选择开关、第一数模转换器、基准电路、控制寄存器及数据寄存器,编码电路的输入端与比较器阵列的输出端相连,比较器阵列中每一比较器的正相输入端均与多路选择开关的动端相连,比较器阵列中每一比较器的反相输入端对应连接于分压电阻串中每两相邻的电阻之间,比较器阵列的使能端与控制寄存器相连,多路选择开关的第一不动端用于接收一模拟信号、第二不动端与第一数模转换器的输出端相连、控制端与控制寄存器相连,所述基准电路与分压电阻串及比较器阵列均相连,用于将分压电阻串的中间电平和电压范围校正到和第一数模转换器的输出一致。
搜索关键词: 基于 逐次 逼近 算法 adc 校正 电路
【主权项】:
1.一种基于逐次逼近算法的ADC自校正电路,包括:编码电路、分压电阻串、比较器阵列、多路选择开关、第一数模转换器、基准电路、控制寄存器及数据寄存器,所述比较器阵列包括若干比较器,所述分压电阻串包括若干串联连接的电阻,所述编码电路的输入端与比较器阵列的输出端相连,所述比较器阵列中每一比较器的正相输入端均与多路选择开关的动端相连,所述比较器阵列中每一比较器的反相输入端对应连接于分压电阻串中每两相邻的电阻之间,所述比较器阵列的使能端与控制寄存器相连,所述多路选择开关的第一不动端用于接收一模拟信号、第二不动端与第一数模转换器的输出端相连、控制端与控制寄存器相连,所述控制寄存器用于控制多路选择开关的输出,所述第一数模转换器的输入端对应与数据寄存器相连,所述基准电路与分压电阻串及比较器阵列均相连,用于将分压电阻串的中间电平和电压范围校正到和第一数模转换器的输出一致。
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