[实用新型]继电器驱动芯片及电表有效
| 申请号： | 201621373803.2 | 申请日： | 2016-12-14 |
| 公开（公告）号： | CN206294148U | 公开（公告）日： | 2017-06-30 |
| 发明（设计）人： | 傅代军;王甲;石飞;陈立军 | 申请（专利权）人： | 上海贝岭股份有限公司 |
| 主分类号： | H03K19/018 | 分类号： | H03K19/018 |
| 代理公司： | 上海弼兴律师事务所31283 | 代理人： | 薛琦,张冉 |
| 地址： | 200233 *** | 国省代码： | 上海;31 |
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| 摘要： | 本实用新型公开了一种继电器驱动芯片及电表，其中继电器驱动芯片包括IO输入管脚、第一继电器控制输出管脚和第二继电器控制输出管脚；还包括组合逻辑电路；所述组合逻辑电路的输入端与所述IO输入管脚连接，所述组合逻辑电路的第一输出端与所述第一继电器控制输出管脚连接，所述组合逻辑电路的第二输出端与所述第二继电器控制输出管脚连接。本实用新型仅采用1个IO口就能完成对继电器拉合控制，节省了MCU的IO口资源，便于电表内的功能扩展；本实用新型中继电器驱动芯片集成度更高，取代现有的继电器控制电路，使其可以减少元件，降低设计难度，降低成本，缩减布板面积。 | ||
| 搜索关键词： | 继电器 驱动 芯片 电表 | ||
【主权项】：
一种继电器驱动芯片，其特征在于，所述继电器驱动芯片包括：IO输入管脚、第一继电器控制输出管脚和第二继电器控制输出管脚；所述继电器驱动芯片还包括：组合逻辑电路；所述组合逻辑电路的输入端与所述IO输入管脚连接，所述组合逻辑电路的第一输出端与所述第一继电器控制输出管脚连接，所述组合逻辑电路的第二输出端与所述第二继电器控制输出管脚连接；所述IO输入管脚用于接收外部输入的IO控制信号，并将接收的IO控制信号传输至所述组合逻辑电路的输入端；所述组合逻辑电路的第一输出端用于输出第一控制信号至所述第一继电器控制输出管脚，所述组合逻辑电路的第二输出端用于输出第二控制信号至所述第二继电器控制输出管脚。
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- 本实用新型公开了一种电平转换设备，包括第一双极型晶体管、第二双极型晶体管、二极管、第一电阻和电容；第二双极型晶体管的第二发射极连接参考电压端；二极管包括阳极和阴极，二极管的阳极连接第二双极型晶体管的第二发射极，二极管的阴极连接第二双极型晶体管的第二集电极；电容与第一电阻串联，电容的一端连接于第一双极型晶体管的第一发射极；第一电阻的一端连接电容的另一端，第一电阻的另一端连接第二双极型晶体管的第二基极。通过以上方式，本实用新型提高了马达的兼容性，确保了数字卫星电视接收机能够正确接收并理解指令。
- 绝缘门极双极型晶体管驱动电路-200920135843.7
- 刘元恒 - 深圳市科陆变频器有限公司
- 2009-03-24 - 2010-11-24 - H03K19/018
- 本实用新型涉及一种绝缘门极双极型晶体管驱动电路，包括驱动隔离电路、放大输出电路，所述驱动隔离电路由PC929门极驱动光耦合器进行驱动隔离，所述PC929门极驱动光耦合器接收所述脉冲宽度调制信号输入电路输出的信号，所述PC929门极驱动光耦合器与放大输出电路连接。本实用新型通过采用PC929门极驱动光耦合器进行驱动隔离，输入输出隔离电压高。通过设计简单的电路实行欠压锁定保护、故障记忆电路、死区设置电路、关断延迟、上下桥互锁电路、驱动放大电路、开关电源电路，该电路成本低、可靠性高的驱动电路。
- 用于将输入信号转换成不同电压范围的输出信号的装置-200880008921.5
- 哈尔·汉森 - NXP股份有限公司
- 2008-03-19 - 2010-01-27 - H03K19/018
- 一种用于接收第一电压范围的输入信号并产生第二电压范围的输出信号的装置。转换检测电路(230)检测输入信号从高电平向低电平的转换，控制电路(245)操作第一FET以产生低电平的输出信号。第二FET由高电平的输入信号操作以输出高电平的输出信号。
- 自举电路及使用该电路的移位寄存器和显示装置-200910202814.2
- 音濑智彦;下田雅通 - NEC液晶技术株式会社
- 2009-05-26 - 2009-12-02 - H03K19/018
- 一种自举电路及使用该电路的移位寄存器和显示装置，能够降低控制信号线数量，提高晶体管的漏电流耐性。具有：晶体管(Tr7、Tr1)，串联在电源端子和第1时钟信号端子之间，将连接点作为输出端子；晶体管(Tr6、Tr4、Tr3)，串联在电源端子和第2时钟信号端子之间；晶体管(Tr5)，连接在电源端子和晶体管(Tr1)的栅极之间；晶体管(Tr2)，源极连接到晶体管(Tr1)的栅极，晶体管(Tr2、Tr6)的栅极与输入端子连接，逆变器的输出连接到晶体管(Tr4)的栅极，晶体管(Tr5、Tr7)的栅极连接到晶体管(Tr6、Tr4)的连接点，晶体管(Tr1)的栅极连接到晶体管(Tr5、Tr2)的连接点。
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