[发明专利]存储单元及其形成方法有效
申请号: | 201610079607.2 | 申请日: | 2016-02-03 |
公开(公告)号: | CN107039447B | 公开(公告)日: | 2019-09-27 |
发明(设计)人: | 洪波;张帅 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 |
主分类号: | H01L27/11519 | 分类号: | H01L27/11519;H01L27/11524 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 徐文欣;吴敏 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 一种存储单元及其形成方法,形成方法包括:提供衬底,衬底内具有阱区;在衬底的阱区表面形成分立的选择栅结构、浮栅结构和伪栅结构;以选择栅结构、浮栅结构和伪栅结构为掩膜,在衬底的阱区内形成第一轻掺杂区、第二轻掺杂区和第三轻掺杂区,第一轻掺杂区和第二轻掺杂区位于选择栅结构两侧,且第二轻掺杂区位于相邻选择栅结构和浮栅结构之间,第三轻掺杂区位于相邻浮栅结构和伪栅结构之间;之后,在选择栅结构、浮栅结构和伪栅结构的侧壁表面以及部分衬底表面形成侧墙;以浮栅结构、伪栅结构和侧墙为掩膜,在第三轻掺杂区内形成源区,第三轻掺杂区包围源区。所形成的存储单元漏电流减少、性能提高。 | ||
搜索关键词: | 存储 单元 及其 形成 方法 | ||
【主权项】:
1.一种存储单元的形成方法,其特征在于,包括:提供衬底,所述衬底内具有阱区;在所述衬底的阱区表面形成分立的选择栅结构、浮栅结构和伪栅结构,且所述选择栅结构和伪栅结构分别位于所述浮栅结构两侧;以所述选择栅结构、浮栅结构和伪栅结构为掩膜,在所述衬底的阱区内形成第一轻掺杂区、第二轻掺杂区和第三轻掺杂区,所述第一轻掺杂区和第二轻掺杂区位于所述选择栅结构两侧,且所述第二轻掺杂区位于相邻选择栅结构和浮栅结构之间,所述第三轻掺杂区位于相邻浮栅结构和伪栅结构之间;在形成所述第一轻掺杂区、第二轻掺杂区和第三轻掺杂区之后,在所述选择栅结构、浮栅结构和伪栅结构的侧壁表面以及部分衬底表面形成侧墙;以所述选择栅结构、浮栅结构、伪栅结构和侧墙为掩膜,在所述第一轻掺杂区内形成字线区,在所述第三轻掺杂区内形成源区,所述第三轻掺杂区包围所述源区,所述第三轻掺杂区和源区掺杂有第二类型离子,且所述源区内的第二类型离子的掺杂浓度大于所述第三轻掺杂区内的第二类型离子的掺杂浓度。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
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