[发明专利]浮栅的制作方法有效
申请号: | 201410310911.4 | 申请日: | 2014-07-01 |
公开(公告)号: | CN105336591B | 公开(公告)日: | 2018-10-23 |
发明(设计)人: | 姜立维;李雪 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/28 | 分类号: | H01L21/28 |
代理公司: | 北京康信知识产权代理有限责任公司 11240 | 代理人: | 吴贵明;张永明 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 本申请提供了一种浮栅的制作方法。该制作方法包括:提供半导体基底,半导体基底具有存储单元区和外围电路区,存储单元区具有第一STI和第一有源区,外围电路区具有最小宽度≥A的第二STI和第二有源区以及最小宽度<A的第三STI和第三有源区;在半导体基底上沉积多晶硅,形成第一多晶硅层;在位于第二有源区的第一多晶硅层上形成多晶硅保护层;在裸露的第一多晶硅层表面上、多晶硅保护层表面上沉积多晶硅,形成第二多晶硅层;对第二多晶硅层与第一多晶硅层进行CMP至第一STI与第三STI裸露;对CMP后的第一多晶硅层与多晶硅保护层进行回刻;以及去除多晶硅保护层。该方法避免了第二有源区处凹陷的产生,去除残留多晶硅的效果。 | ||
搜索关键词: | 制作方法 | ||
【主权项】:
1.一种浮栅的制作方法,其特征在于,所述制作方法包括:步骤S1,提供半导体基底,所述半导体基底具有存储单元区和外围电路区,所述存储单元区具有第一STI和第一有源区,所述外围电路区具有最小宽度≥A的第二STI和第二有源区以及最小宽度<A的第三STI和第三有源区;步骤S2,在所述半导体基底上沉积多晶硅,形成第一多晶硅层;步骤S3,在位于所述第二有源区的所述第一多晶硅层上形成多晶硅保护层;步骤S4,在裸露的所述第一多晶硅层表面上、所述多晶硅保护层表面上沉积多晶硅,形成第二多晶硅层;步骤S5,对所述第二多晶硅层与所述第一多晶硅层进行CMP至所述第一STI与所述第三STI裸露;步骤S6,对CMP后的所述第一多晶硅层与所述多晶硅保护层进行回刻;以及步骤S7,去除所述多晶硅保护层,所述步骤S3包括:步骤S31,在所述第一多晶硅层上沉积多晶硅预保护层;步骤S32,在位于所述第二有源区的多晶硅预保护层上形成光刻胶掩膜;步骤S33,刻蚀去除裸露的所述多晶硅预保护层;以及步骤S34,去除所述光刻胶掩膜。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造