[发明专利]一种验证方法、装置及芯片有效
| 申请号： | 201310344218.4 | 申请日： | 2013-08-08 |
| 公开（公告）号： | CN103439648A | 公开（公告）日： | 2013-12-11 |
| 发明（设计）人： | 王思佳 | 申请（专利权）人： | 北京华大信安科技有限公司 |
| 主分类号： | G01R31/317 | 分类号： | G01R31/317;H03K5/13 |
| 代理公司： | 北京弘权知识产权代理事务所(普通合伙) 11363 | 代理人： | 郭放;许伟群 |
| 地址： | 100015 北京市朝阳区*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明实施例公开了一种验证方法、装置及芯片。所述方法包括：芯片接收配置指令；根据所述配置指令模拟专用集成电路ASIC的环境；对应所述芯片中每个功能模块生成门控时钟信号；将预设时钟信号和所述门控时钟信号布置在全局时钟树上；使用所述全局时钟树对所述芯片进行验证。本发明实施例还提供了验证装置及芯片。本发明实施例所提供的验证方法、装置及芯片，对应每个功能模块单独实现门控时钟控制，使延时在可控的范围内，对FPGA的逻辑时序不会造成影响，同时，将实现门控时钟控制的功能模块布置在全局时钟树的模式下进行验证，也在不影响FPGA逻辑时序的情况下解决了FPGA无法搭建动态全局时钟树的问题。 | ||
| 搜索关键词： | 一种 验证 方法 装置 芯片 | ||
【主权项】：
一种验证方法，其特征在于，包括：芯片接收配置指令；根据所述配置指令模拟专用集成电路ASIC的环境；对应所述芯片中每个功能模块生成门控时钟信号；将预设时钟信号和所述门控时钟信号布置在全局时钟树上；使用所述全局时钟树对所述芯片进行验证。
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