[发明专利]半导体装置以及其制造方法有效

专利信息
申请号: 201210071069.4 申请日: 2012-03-16
公开(公告)号: CN103000529A 公开(公告)日: 2013-03-27
发明(设计)人: 奥村秀树;三沢宽人;河野孝弘 申请(专利权)人: 株式会社东芝
主分类号: H01L21/336 分类号: H01L21/336;H01L29/41
代理公司: 永新专利商标代理有限公司 72002 代理人: 徐殿军
地址: 日本*** 国省代码: 日本;JP
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摘要: 一种半导体装置的制造方法,具备:在第1导电型的半导体基板的上表面形成多个沟槽的工序;在上述沟槽的内面上形成栅绝缘膜的工序;在上述沟槽内的下部埋入栅电极的工序;在上述沟槽内的上部埋入绝缘部件的工序;将上述半导体基板的上层部除去从而使上述绝缘部件从上述半导体基板的上表面突出的工序;以覆盖突出的上述绝缘部件的方式形成掩模膜的工序;将在上述掩模膜的在上述绝缘部件的侧面上形成的部分作为掩模而向上述半导体基板注入杂质从而形成第2导电型的载流子排出层的工序。
搜索关键词: 半导体 装置 及其 制造 方法
【主权项】:
一种半导体装置的制造方法,具备以下工序:在第1导电型的半导体基板的上表面形成多个沟槽的工序;在上述沟槽的内面上形成栅绝缘膜的工序;在上述沟槽内的下部埋入栅电极的工序;在上述沟槽内的上部埋入绝缘部件的工序;将上述半导体基板的上层部除去从而使上述绝缘部件从上述半导体基板的上表面突出的工序;向上述半导体基板导入杂质从而形成第2导电型的基底层的工序,该第2导电型的基底层形成在上述半导体基板的比上述栅电极的下端靠上方的部分;以覆盖突出的上述绝缘部件的方式形成掩模膜的工序;向上述基底层导入杂质从而形成第1导电型的第1半导体层的工序,该第1导电型的第1半导体层形成在上述基底层的上层部且下表面是比上述栅电极的上端靠下方的部分;将上述掩模膜的在上述绝缘部件的侧面上形成的部分作为掩模、向上述半导体基板注入杂质从而形成第2导电型的载流子排出层的工序,该第2导电型的载流子排出层形成在上述基底层的一部分以及上述第1半导体层的一部分,且实际有效的杂质浓度比上述基底层的实际有效的杂质浓度高;以与上述半导体基板的上表面连接的方式形成第1电极的工序;以及以与上述半导体基板的下表面连接的方式形成第2电极的工序。
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