[发明专利]半导体装置及制作外延层的方法有效

专利信息
申请号: 201110358501.3 申请日: 2011-11-14
公开(公告)号: CN103107070B 公开(公告)日: 2017-11-07
发明(设计)人: 廖晋毅;宣腾竣;简金城 申请(专利权)人: 联华电子股份有限公司
主分类号: H01L21/20 分类号: H01L21/20;H01L21/336;H01L21/8234
代理公司: 北京市柳沈律师事务所11105 代理人: 陈小雯
地址: 中国台湾新竹*** 国省代码: 台湾;71
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摘要: 发明公开一种半导体装置及制作外延层的方法。该半导体装置包括一半导体基底以及多个晶体管。半导体基底具有至少一宽疏区域(iso region)或称为开放区域(open region)及至少一密集区域(dense region)。多个晶体管分别设置于宽疏区域及密集区域,且各晶体管包括至少一源极/漏极区,其中源极/漏极区均包括一具有底部厚度以及一侧边厚度的第一外延层,且第一外延层的底部厚度实质上大于或等于第一外延层的侧边厚度。
搜索关键词: 半导体 装置 制作 外延 方法
【主权项】:
一种制作外延层的方法,包括:提供一半导体基底,且该半导体基底包括至少一凹槽;进行一第一选择性外延成长(selective epitaxial growth,SEG)制作工艺,在该凹槽内形成一第一外延层,其中该第一选择性外延成长制作工艺包括:一操作压力,且该操作压力实质上小于或等于10托耳(torr);以及通入一气体,该气体包括二氯硅烷(Dichlorosilane,DCS)、锗烷(GeH4)以及氯化氢(HCl)等,且二氯硅烷、锗烷以及氯化氢等气体具有一浓度比是(0.5‑2.1):(1.5‑3.3):1,以及设置一第二外延层于该第一外延层之上,该第一外延层不包括导电型掺质,该第二外延层包括导电型掺质,其中该第一外延层包括一底部厚度以及一侧边厚度,该底部厚度与该侧边厚度的比值实质上大于或等于1.4。
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