专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种柴油型无轨胶轮车用尾气处理装置-CN202310617979.6在审
  • 李志荣;赵宝平;李任伟;高雄雄;李亨 - 陕西神北康晨矿用装备有限公司
  • 2023-05-29 - 2023-08-04 - F01N3/04
  • 本发明涉及尾气处理领域,尤其涉及一种柴油型无轨胶轮车用尾气处理装置。本发明提供一种能够提高对车尾气的处理效率且使得储水箱内始终有充足的水与车尾气进行充分反应的柴油型无轨胶轮车用尾气处理装置。一种柴油型无轨胶轮车用尾气处理装置,包括有车厢和安装架等;所述安装架上开有若干个螺纹孔,所述车厢上也开有若干个螺纹孔,所述车厢上通过四个安装螺钉连接有安装架。车尾气通过通气管内的滤网能过滤尾气中的颗粒物,然后启动电动推杆,使得挡板上下摆动时处理箱内处理后的车尾气间歇性排出,让水与车尾气有足够的时间进行充分接触,从而使得车尾气和水进行充分反应,使得车尾气能够达到排放标准从而排放。
  • 一种柴油无轨胶轮尾气处理装置
  • [发明专利]一种保护开发程序的方法以及处理器-CN202210489011.5有效
  • 冯新华;周沈刚;李任伟 - 北京中科昊芯科技有限公司
  • 2022-05-06 - 2023-07-28 - G06F21/60
  • 本申请实施例提供一种保护开发程序的方法以及处理器,该处理器包括:加密模块,被配置为生成密钥信息并根据所述密钥信息对待加密的开发程序进行加密,得到加密开发程序;解密模块,被配置为根据所述密钥信息对所述加密开发程序进行解密,得到解密开发程序。本申请的实施例在处理器内部加解密模块中加密之后的数据只能在加密处理器中使用,其他处理器无法解密,实现开发程序的保护,也就是说由于本申请实施例的加解密信息均在处理器内部实现,任何加解密信息都无法通过外部器件或者测试设备获取。
  • 一种保护开发程序方法以及处理器
  • [发明专利]一种柴油型无轨胶轮车散热装置-CN202310449687.6在审
  • 李志荣;赵宝平;李任伟;高雄雄;李亨 - 陕西神北康晨矿用装备有限公司
  • 2023-04-25 - 2023-07-04 - F01N3/04
  • 本发明涉及车辆尾气散热领域,尤其涉及一种柴油型无轨胶轮车散热装置。本发明提供一种能够使得高温尾气与水的接触更加充分,使得尾气降温的速度更快,还有利于循环用水并且含有污染物的水汽不容易进入外界环境,进而能够减少环境污染的柴油型无轨胶轮车散热装置。一种柴油型无轨胶轮车散热装置,包括有车身架、柴油发动机、水箱和水泵等;车身架顶部固定连接有柴油发动机和水箱,水箱外壁的一侧下部固定连接有水泵。接触空心板外壁会吸收高温尾气的热量,从而能够对高温尾气进行冷却降温,使得柴油发动机排放的尾气温度在合适范围内,进而使得无轨胶轮车在地下矿洞中工作更加安全。
  • 一种柴油无轨胶轮散热装置
  • [发明专利]一种片上系统可配置装置-CN202210664379.0有效
  • 刘硕;周沈刚;李任伟 - 北京中科昊芯科技有限公司
  • 2022-06-13 - 2023-04-14 - G06F15/78
  • 本申请实施例提供一种片上系统的可配置装置以及片上系统,所述可配置装置包括:可配置的逻辑模块,被配置为用于实现目标时序逻辑功能以及目标组合逻辑功能;以及高阶控制器模块,至少被配置为基于输入的目标事件触发一系列与所述目标事件对应的预定义操作,其中,所述目标事件包括由所述可配置的逻辑模块输出的事件。本申请实施例的片上系统内部内部包含了数个功能不同的子可配置模块。这些模块既有时序逻辑功能,也有组合逻辑功能,它们的具体功能都是可配置的,并且可以通过软件配置互联,以实现定制的数字逻辑功能。通过这样的方式,其可以被用来增强现有外设并且摆脱了现有方案对FPGA的依赖。
  • 一种系统配置装置
  • [发明专利]一种片上外部总线通信的方法以及装置-CN202210488202.X有效
  • 冯新华;周沈刚;李任伟 - 北京中科昊芯科技有限公司
  • 2022-05-06 - 2023-03-24 - G06F15/78
  • 本申请实施例提供一种片上外部总线通信的方法以及装置,所述方法包括:接收来自于芯片上目标设备的数据传输指令,其中,所述数据传输指令用于访问外部存储设备;为外部总线配置目标读写时序,并通过所述外部总线向所述外部存储设备发送所述数据传输指令。一方面,本申请的一些实施例中的外部总线通信协议支持多种数据通信协议,通过支持多种协议,满足不同场景下数据通信的需要,另一方面,本申请的一些实施例通过使用动态可配的外部总线读写时序可优化和解决在芯片的实际应用中由于不同电路板的差异导致数据传输需要的建立和保持时间不同的技术问题。
  • 一种外部总线通信方法以及装置
  • [发明专利]一种检测波特率的方法、装置、设备和介质-CN202111274910.5有效
  • 庄晓青;周沈刚;李任伟 - 北京中科昊芯科技有限公司
  • 2021-10-29 - 2023-03-10 - H04L43/0876
  • 本申请实施例提供一种检测波特率的方法、装置、设备和介质,该方法包括:在确认波特率检测功能打开的情况下,获取发送设备发送的起始位;根据接收设备的工作时钟,获取起始位的传输时间;根据传输时间确定发送设备传输一比特的时长,获得待验证波特率;根据待验证波特率接收由发送设备发送的验证数据,并确认正确接收验证数据;锁存待验证波特率作为自动检测的波特率,能够使接收设备根据发送设备发送的起始位来更新接收设备的波特率,从而有效避免了为接收设备预先配置的波特率不能适应发送设备波特率改变的技术问题,从而使接收设备的波特率与发送设备的波特率一致。
  • 一种检测波特率方法装置设备介质
  • [发明专利]一种时钟切换电路、时钟系统、芯片和电子设备-CN202111274894.X有效
  • 李任伟;庄晓青;周沈刚 - 北京中科昊芯科技有限公司
  • 2021-10-29 - 2022-11-15 - G06F1/04
  • 本申请实施例提供一种时钟切换电路、时钟系统、芯片和电子设备,该时钟切换电路包括:第一级联电路,包括由第一时钟信号驱动的多个第一寄存器,且第一级联电路被配置为当多个第一寄存器中任意一个第一寄存器的采样值为零值时,则启动关闭第一时钟信号的动作;第二级联电路,包括由第二时钟信号驱动的多个第二寄存器,且第二级联电路被配置为当多个第二寄存器中所有第二寄存器的采样值为非零值时,则确定将系统时钟信号切换为第二时钟信号;其中,第一时钟信号和第二时钟信号属于频率不同的时钟信号。借助于上述技术方案,本申请实施例能够解决现有技术中存在着的由于时钟切换存在毛刺导致的系统错误的问题。
  • 一种时钟切换电路系统芯片电子设备
  • [发明专利]一种多功能仲裁器、仲裁方法、芯片以及产品-CN202111275497.4有效
  • 陈祖玎;周沈刚;李任伟 - 北京中科昊芯科技有限公司
  • 2021-10-29 - 2022-07-08 - G06F15/78
  • 本申请实施例提供一种多功能仲裁器、仲裁方法、芯片以及产品,所述多功能仲裁器包括:逻辑操作单元,被配置为将当前掩码和总线请求序列的相同位分别进行逻辑操作,得到逻辑操作结果;第一仲裁单元,被配置为根据所述逻辑操作结果,得到第一路仲裁结果,其中,所述总线请求序列用于表征当前时刻芯片上多个模块分别发出的对总线的使用请求,所述逻辑操作结果用于屏蔽已经响应过高优先级的总线请求;第二仲裁单元,被配置为根据所述总线请求序列获取第二路仲裁结果;仲裁策略选择器,被配置为从所述第一路仲裁结果和所述第二路仲裁结果中选择一路作为目标仲裁结果。通过本申请一些实施例实现固定优先级和公平轮询相结合的仲裁策略。
  • 一种多功能仲裁方法芯片以及产品
  • [发明专利]一种解压缩方法及装置-CN201911126193.4有效
  • 李任伟;周沈刚;田志兴 - 中国科学院自动化研究所
  • 2019-11-18 - 2022-02-08 - H03M7/30
  • 本发明涉及解压缩技术领域,具体涉及一种解压缩方法和装置。为了解决现有解压缩电路硬件资源开销大的问题,本发明提出一种解压缩方法,所述方法包括获取预先存储的待解压缩数据,所述待解压缩数据预先存储在预处理缓冲单元中;从所述待解压缩数据中获取前缀编码,对前缀编码进行译码得到第一数据和第二数据,所述第一数据控制解压缩后数据的发送模式,所述第二数据用于控制解压缩后数据的数据发送量;根据所述第一数据和第二数据控制解压缩后数据的发送过程。利用本发明的解压缩方法和装置能够有效改善解压缩电路硬件资源开销大的问题。
  • 一种解压缩方法装置
  • [发明专利]针对FPGA配置码流的压缩方法、系统、装置-CN201910697788.9有效
  • 李任伟;周沈刚;田志兴 - 中国科学院自动化研究所
  • 2019-07-31 - 2021-10-29 - G06F16/174
  • 本发明属于压缩算法技术领域,具体涉及了一种针对FPGA配置码流的压缩方法、系统、装置,旨在解决传统FPGA的压缩算法压缩比不够高、电路开销大的问题。本发明方法包括:依次判断获取的FPGA配置码流的比特文件的预设位数的比特数据,若不均为0,将数据压缩为m;若均为0且连续次数小于设定阈值,将数据压缩为p;若均为0且连续次数等于设定阈值,将数据压缩为q。本发明针对FPGA配置码流的特点进行设计,压缩比方面的得到较大的提升,相比于传统的算法,本发明方法提高了14%‑30%的压缩比,另外,本发明压缩算法结构简单、电路开销小。
  • 针对fpga配置压缩方法系统装置
  • [发明专利]一种异步中断处理方法及中断控制器-CN201611257170.3有效
  • 周沈刚;李任伟 - 青岛专用集成电路设计工程技术研究中心
  • 2016-12-30 - 2020-08-14 - G06F9/48
  • 本发明公开了一种异步中断处理方法及中断控制器,所述中断处理方法包括以下步骤:(11)、内核判断当前状态是否允许中断,若允许,则发出中断向量请求信号;(12)、中断控制器接收到中断向量请求信号,根据当前中断控制器中的状态,作出回应;(13)、若所述内核检测到所述中断控制器发出的中断向量请求反馈信号,则采样中断向量iv,并将中断向量请求信号置为无效;(14)、当中断返回指令执行完毕后,内核向中断控制器发出中断返回握手信号,中断控制器接收到该信号之后,返回握手信号。本发明的异步中断处理方法采用由内核请求中断控制器的通信方式,并且直接请求中断向量和向内核给出中断向量,极大地加快了异步中断控制器中断的响应速度。
  • 一种异步中断处理方法控制器

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