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[发明专利]NBTI和工艺波动影响下的门级延时机器学习预测方法-CN202210621689.4在审
发明人：卜爱国;王嵘柯;贾书昊 -专利权人：东南大学
申请日： 2022-06-01 - 公布日： 2022-07-29 - 主分类号： G06F30/33 文献下载
摘要：本发明提出了一种NBTI和工艺波动影响下的门级延时机器学习预测方法，本方法分析了门单元延时在工艺波动影响下的延时分布特征，并同时考虑了NBTI带来的影响。根据门单元延时分布的复杂特征，本方法采用了高斯过程回归(GaussianProcessRegression,GPR)捕捉多种影响门延时的因素并预测出最终的门级单元延时分布。相比较显式地写出计算表达式，利用合适核函数的高斯过程回归算法可以更准确捕捉其之间的关系，得到更准确的门级延时统计特征值，对于流片成功和设计鲁棒性更高的集成电路具有重要意义。
nbti 工艺波动影响延时机器学习预测方法

[发明专利]触发器延时的内建测试方法及电路-CN201010546850.3有效
发明人：马纪丰;梁浩 -专利权人：北京中电华大电子设计有限责任公司
申请日： 2010-11-16 - 公布日： 2012-05-23 - 主分类号： G01R31/317 文献下载
摘要：本发明提供一种触发器延时的内建测试方法，该方法包括：积累待测触发器的延时，使之与参考时钟的周期相比，产生由该比较关系决定的检测信号；将检测信号进行转换并输出，使其可以从芯片外部被直观地观测；通过连续改变参考时钟的周期，并检测可观测信号的变化，来确定待测触发器的积累延时，并最终计算出单个待测触发器的精确延时。另外，本发明还提供了一种触发器延时的内建测试系统，该系统包括：可调时钟发生器、触发器延时积累电路、延时比较电路和可观测信号产生电路。
触发器延时测试方法电路

[发明专利]一种基于机器学习的电路路径延时波动预测方法-CN201810940335.X有效
发明人：曹鹏;徐冰倩;郭静静;李梦潇;杨军 -专利权人：东南大学
申请日： 2018-08-17 - 公布日： 2023-04-07 - 主分类号： G06F30/3308 文献下载
摘要：本发明公开了一种基于机器学习的电路路径延时波动预测方法，包括以下步骤：S1：通过分析电路特征与路径延时的关系选择合适的样本特征量；S2：通过枚举随机化参数的值生成随机路径，通过对随机路径进行蒙特卡洛仿真获得路径最大延时，通过3σ标准选取可靠路径，将可靠路径的样本特征量以及路径延时作为样本集；S3：建立路径延时预测模型，调整模型参数；S4：验证路径延时预测模型的精度和稳定性；S5：得到路径延时。
一种基于机器学习电路路径延时波动预测方法

[发明专利]一种基于动态臂力估计的人机协作方法-CN202211004170.8在审
发明人：张铁;初虎波;邹焱飚;孙韩磊 -专利权人：华南理工大学
申请日： 2022-08-22 - 公布日： 2022-12-06 - 主分类号： G06K9/00 文献下载
摘要：采集手臂多个位置上的表面肌电信号sEMG；对多个sEMG进行自适应幅值提取；然后对多个通道的sEMG幅值进行自适应平滑处理；将平滑后的多个通道的sEMG幅值通过融合神经网络对多个通道的sEMG幅值依此进行延时补偿、通道融合、时序捕捉，得到对应多个通道的sEMG幅值的融合特征，然后将融合特征输入估计神经网络，获得融合特征与操作员臂力的映射关系；根据映射关系进行协作控制，驱动协作机械臂做出协作动作。本发明相比现有技术，能同时解决表面肌电信号的延时、多通道融合、特征时序关系捕捉这三个人机协同的瓶颈，实现低延时高精度的人机协作效果。
一种基于动态臂力估计人机协作方法

[发明专利]一种基于芯片-PCB延时的混合型PUF电路及生成响应方法-CN202210093880.6有效
发明人：贺章擎;鲁犇;陈备;曹文君;柯涛;万美琳 -专利权人：湖北工业大学
申请日： 2022-01-26 - 公布日： 2023-07-04 - 主分类号： G06F21/75 文献下载
摘要：本发明涉及集成线路板防伪认证领域，具体为一种基于芯片‑PCB延时的混合型PUF电路及生成响应方法。包括：片内可配置瞬态效应环形振荡器(TERO PUF)电路：用于产生含有芯片“延时指纹”信息的振荡次数，并将内外延时信息进行混合建立起耦合关系，最终产生用于芯片‑PCB系统级防伪认证的数字ID；片外延时电路：串联在所述TERO PUF反馈环之间，用于提取印制电路板特有的“延时指纹”信息。本发明对外部资源的消耗很小，仅需要用到4个Pad引脚和两条延时电路，即可生成大量的激励响应对。
一种基于芯片 pcb 延时混合 puf 电路生成响应方法

[发明专利]电压控制的模拟延时锁定回路及其操作方法-CN200410096537.9无效
发明人：维翰D亥特利;史蒂夫S伊顿 -专利权人：茂德科技股份有限公司
申请日： 2004-11-30 - 公布日： 2005-08-17 - 主分类号： H03L7/08 文献下载
摘要：本发明是关于一种电压控制的模拟延时锁定回路及其操作方法，该用于接收基准时钟信号并产生延时输出时钟信号的模拟延时锁定回路，包括一个电压控制的延时线路、一个固定延时线路、一个延时电压控制、一个快速/慢速锁存器快速/慢速锁存器产生三个由延时电压控制接收的信号：一个“锁定的慢速信号”、一个“锁定的快速信号”、一个“锁定的快速到慢速的信号”。相位监测器产生由快速/慢速锁存器接收的“变快”和“变慢”信号。模拟延时锁定回路开启时在其最小值或接近最小值处设定延时线路的初始延时。然后延时被迫从最小值开始增加，直至达到不依赖于基准和延时时钟信号间相位关系的锁定状态。
电压控制模拟延时锁定回路及其操作方法

[发明专利]一种可关闭的数控振荡器-CN200910184796.X有效
发明人：陈鑫;杨军;刘新宁;时龙兴 -专利权人：东南大学
申请日： 2009-08-14 - 公布日： 2010-01-27 - 主分类号： H03L7/099 文献下载
摘要：本发明披露了一种可关闭的数控振荡器，设有奇数个可调延时模块首尾相连形成闭环，并设置与可调延时模块数量相同并一一对应的延时控制电压信号产生模块，每个可调延时模块的延时控制电压信号的输入端与对应的每个延时控制电压信号产生模块的延时控制电压信号输出端相连接，将各个可调延时模块开关信号输入端连接在一起为总开关信号，即构成完整的可关闭的数控振荡器，从电路上保证该数控振荡器频率和控制码之间是单调变化关系。
一种关闭数控振荡器

[发明专利]一种全网动态感知的拓扑发现方法-CN202310369126.5在审
发明人：史翔;陈志刚;王铭;高鹤;胡鹏飞;高杉;王如意;蔡雪梅;乔志;刘俊;杨志达;刘菲;柴继森;李海涛;葛鹏;王舒;耿巧曼 -专利权人：北京航天拓扑高科技有限责任公司
申请日： 2023-04-07 - 公布日： 2023-06-27 - 主分类号： H04L41/12 文献下载
摘要：本发明公开了一种全网动态感知的拓扑发现方法，包括以下步骤：初始化全网节点信息；初始化节点邻居关系矩阵；进行邻居关系发现；通过邻居关系矩阵的对角线将矩阵分割成主从区域；从区域复制主区域数据，在从区域更新发生变动的节点，并切换主从区域；从区域复制主区域数据，添加新增节点信息和其邻居关系信息，切换主从区域；创建延时队列，更新新增或者有改动的节点信息；将延时队列中超时节点重新进行邻居关系发现并更新到注册中心；注册中心与各节点发送心跳同步全局邻居关系信息
一种动态感知拓扑发现方法

[发明专利]数据包处理方法、装置、系统、电子设备和介质-CN202211050560.9有效
发明人：朱敏;李桧 -专利权人：无锡沐创集成电路设计有限公司
申请日： 2022-08-30 - 公布日： 2022-11-25 - 主分类号： H04L49/90 文献下载
摘要：对于第一装置，该方法包括：接收该待处理数据包，获取映射关系信息，该映射关系信息用于指示该待处理数据包与该内存块之间的映射关系，基于该映射关系信息，将该待处理数据包拷贝到第二装置的该内存块中。对于第二装置，该方法包括：接收该待处理数据包，获取映射关系信息，基于该映射关系信息，将该待处理数据包拷贝到对应内存块，将该内存块对应的内存地址发送给该第一装置。本发明解决了数据包处理过程中的延时问题，通过减少第一装置与第二装置之间交互实现降低延时的技术效果。
数据包处理方法装置系统电子设备介质

[发明专利]延时任务处理方法、装置、计算机设备及存储介质-CN202210707035.3在审
发明人：蒋再武 -专利权人：中国平安财产保险股份有限公司
申请日： 2022-06-21 - 公布日： 2022-10-18 - 主分类号： G06F9/48 文献下载
摘要：本申请实施例属于云技术领域，涉及一种延时任务处理方法，包括解析接收的延时任务请求得到推送时间；确定第一延时任务和第二延时任务，将第一延时任务存储至时间轮，将第二延时任务存储到关系数据库以得到任务数据表；将任务数据表同步至大数据；筛选任务数据表中的任务消息得到第三延时任务，并将第三延时任务存储至时间轮；当时间轮驱动至当前时间槽，则匹配与当前时间槽对应的到期的延时任务，组成延时任务列表；将延时任务列表推送至消息中间件本申请还提供一种延时任务处理装置、计算机设备及存储介质。此外，本申请还涉及区块链技术，延时任务列表可存储于区块链中。本申请可以实现动态设定延时时间，支持高精度触发，不受时间跨度限制。
延时任务处理方法装置计算机设备存储介质

[发明专利]高压电容器不平衡保护动态段和静态段延时配合方法-CN201410462114.8有效
发明人：郑伟;卢志良;张楠;周全;邬乾晋;甘振宁 -专利权人：中国南方电网有限责任公司超高压输电公司检修试验中心
申请日： 2014-09-11 - 公布日： 2014-12-31 - 主分类号： H02H7/22 文献下载
摘要：本发明公开了高压电容器不平衡保护动态段和静态段延时配合方法，其包括以下步骤：步骤1：确定具体直流工程直流滤波器高压电容器不平衡保护已有的动态段定值△1、静态段定值△2、以及时间参数TI；步骤2：得到∫ITD/ITS由△2下降至△1的时间T3；步骤3：将时间T3乘以一可靠系数K1(K1>1)得到T4＝T3*K1该时间T4即为满足直流滤波器高压电容器不平衡保护动态段和静态段延时配合关系的动态段动作延时。本发明根据已有的动态段定值△1、静态段定值△2、以及积分模块INT的时间参数TI确定满足直流滤波器高压电容器不平衡保护动态段和静态段延时配合关系的动态段动作延时T4，避免ITD/ITS扰动消失后因不平衡保护动态段、静态段延时配合不当造成的动态段误动作。
高压电容器不平衡保护动态静态延时配合方法

[发明专利]一种基于FPGA的SC-FDE定时粗同步实现方法和装置-CN202011295097.5有效
发明人：纪苏远;张明利;李阿明;施菊;周戌初;马景馨 -专利权人：上海无线电设备研究所
申请日： 2020-11-18 - 公布日： 2022-12-23 - 主分类号： H04L7/04 文献下载
摘要：本发明公开了一种基于FPGA的SC‑FDE定时粗同步实现方法和装置，该方法包括S1、数据缓存模块将未经过延时的输入数据和经过延时的输入数据分别送到相关窗口能量计算模块和延迟相关能量计算模块；S2、延迟相关能量计算模块对未经过延时的输入数据和经过延时的输入数据进行处理，得到简化后的未经过延时的输入数据和经过延时的输入数据的相关系数；S3、相关窗口能量计算模块计算延时窗口长度内接收数据的能量值；S4、帧搜索模块统计度量函数连续大于阈值的点数，找出数据帧的起始位置。
一种基于 fpga sc fde 定时同步实现方法装置

[发明专利]射电日像仪数字相关系统和同步方法-CN202211516174.4在审
发明人：范秋香;蒿杰;舒琳;赵美婷 -专利权人：中国科学院自动化研究所;广东人工智能与先进计算研究院
申请日： 2022-11-29 - 公布日： 2023-06-23 - 主分类号： H04J3/06 文献下载
摘要：本发明涉及射电天文信号采集处理技术领域，尤其涉及一种射电日像仪数字相关系统和同步方法。本发明的日像仪数字相关系统通过授时信号接收模块接收授时信号，对授时信号进行解码得到绝对时间信息，并将绝对时间信息分别发送给显控单元模块、信号采集处理模块和存储服务器模块；显控单元模块用于根据绝对时间信息向信号采集处理模块下发延时补偿参数，同时向信号采集处理模块和存储服务器模块下发启动和停止控制指令；信号采集处理模块用于模拟信号的采集和处理，并根据绝对时间信息确定对应的延时补偿参数，采用对应的延时补偿参数对信号采集处理模块对应的采集通道进行延时补偿
射电日像仪数字相关系统同步方法

[发明专利]一种数字阵列模块接收延时测试方法及装置-CN201310547616.6有效
发明人：丁志钊;吴家亮;张龙;刘忠林 -专利权人：中国电子科技集团公司第四十一研究所
申请日： 2013-11-07 - 公布日： 2014-02-19 - 主分类号： H04L12/26 文献下载
摘要：本发明公开了一种数字阵列模块接收延时测试方法及装置，方法包括步骤：建立一个状态控制模块；状态控制模块对数字阵列模块的工作状态进行控制，并使其输出一路与数字阵列模块工作状态同步的脉冲信号，以该同步信号为纽带，在数字阵列模块和接收通道测试所需的激励信号之间建立起同步关系；将对应的同步信号产生的时间戳信息打包在接收通道I/Q数据数据包中，利用状态控制模块取出初始时间戳信息，根据初始时间戳和I/Q数据接收时间的对应关系进行相关运算，得到接收延时测试结果。本发明将接收延时的测试转换为信号之间绝对时间之差的运算，不需复杂的数字信号处理，只需要获得接收到的I/Q数据时间及解析出初始时间戳信息，即得到接收延时测试结果。
一种数字阵列模块接收延时测试方法装置

[发明专利]高速时钟产生电路-CN201710229934.6有效
发明人：温带豪;朱仁波 -专利权人：海信视像科技股份有限公司
申请日： 2017-04-10 - 公布日： 2020-10-16 - 主分类号： H03K5/156 文献下载
摘要：本申请提供一种高速时钟产生电路，包括相互连接的控制模块和环路振荡模块，其中，该控制模块用于根据转化信号与晶振信号之间的周期比例关系判断环路振荡模块输出的转化信号的周期是否满足预设周期范围，并在不满足时调整延时控制信号的周期以及采样信号中高低电平宽度的比例关系，输出延时控制信号和采样信号，该环路振荡模块用于在采样信号的低电平期间根据延时控制信号的周期调整转化信号的周期，并将输出的转化信号反馈给控制模块，且满足预设周期范围的转化信号为待求时钟信号。该技术方案中的高速时钟产生电路结构简单、功耗低，而且其能够自动调整内部延时以产生满足预设周期范围的待求时钟信号，能够得到持续产生的高速时钟信号。
高速时钟产生电路