专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种PWM信号抗干扰电路及芯片-CN202211653261.4有效
  • 梅平;尹棋烽;王吉;张天舜 - 无锡麟聚半导体科技有限公司
  • 2022-12-22 - 2023-03-28 - H03K7/08
  • 本发明提供一种PWM信号抗干扰电路及芯片,包括:频率随机化模块、时钟模块及比较模块,其中:时钟模块为PWM信号抗干扰电路提供时钟基准,并对时钟进行计数;频率随机化模块通过设置阈值区间,进而生成随机化的频率阈值;比较模块的输入端连接于时钟模块及频率随机化模块的输出端,通过对比时钟计数值与频率阈值以确定PWM信号的频率,并通过对比时钟计数值与比较模块设置的翻转阈值以确定PWM信号的占空比,进而生成频率随机分布的通过频率随机化模块生成频率随机分布的PWM信号,将次谐波信号进行离散化,从而提高对次谐波噪声的抗干扰能力。结构简单,操作简便,具有广泛的适用性。
  • 一种pwm信号抗干扰电路芯片
  • [发明专利]一种基于多时钟源的ASIC自动分频方法及装置-CN202110187163.5在审
  • 杨滔;梁敏学 - 北京欣博电子科技有限公司
  • 2021-02-18 - 2021-05-11 - H03L7/085
  • 本说明书实施例公开了一种基于多时钟源的ASIC自动分频方法及装置,方案包括:预先分析配置文件,得到所有不重复的待分频目标外设时钟频率;以所述第一基准频率为基准,将所述所有不重复的待分频目标外设时钟频率分为第一组待分频目标外设时钟频率和第二组待分频目标外设时钟频率;进行多轮迭代计算,迭代计算分组后时钟时钟频率,使得各外设分频误差绝对值总和最小,得到待分频目标外设时钟频率的最优分组,然后对不同组内的时钟进行配置。本发明技术方案基于配置文件自动分组,自动计算最优分组源的时钟频率,且计算结果精确度,能够科学地解决SoC多时钟源时各外设时钟自动化分频问题。
  • 一种基于多时asic自动分频方法装置
  • [发明专利]振荡电路-CN201210007861.3有效
  • 阿部真喜男;井上文裕;木村顺一 - 三美电机株式会社
  • 2012-01-11 - 2016-01-27 - H03K3/012
  • 本发明的目的在于提供一种通过简单的结构降低振荡频率低时的消耗功率的振荡电路。该振荡电路具有根据频率选择信号切换振荡频率,输出主时钟时钟振荡器(23)和、根据所述频率选择信号切换分频比,输出对所述主时钟进行分频而得的子时钟的分频电路(24),在所述振荡频率的时候和低的时候,使所述子时钟频率恒定理想的是还具有使所述频率选择信号与所述子时钟同步变化的同步部(22)。
  • 振荡电路
  • [发明专利]时钟校准方法及装置-CN202011074390.9在审
  • 段欣;孙继刚;宗少雷;孙伟 - 京东方科技集团股份有限公司;北京京东方显示技术有限公司
  • 2020-10-09 - 2021-01-05 - H03K5/156
  • 本申请公开了一种时钟校准方法及装置,属于显示技术领域。在本申请提供的方案中,由于目标驱动芯片包括多个时钟校准电路,每个时钟校准电路均配置有一个时钟频率。因此,控制器在发送校准时钟信号之前,可以先通过配置指令向驱动芯片发送参考时钟频率,使得该驱动芯片可以根据该配置指令,确定用于进行时钟校准的目标时钟校准电路。并且可以通过将该参考时钟频率设置为与该第一目标时钟频率相等或相近,确保目标时钟校准电路能够从与该第一目标时钟频率相等或相近的时钟频率开始进行时钟校准。由此,能够快速完成时钟校准,提高时钟校准的效率,满足刷新率的显示装置的要求。
  • 时钟校准方法装置
  • [发明专利]图像形成装置-CN201410412306.8有效
  • 伊藤隆行 - 柯尼卡美能达株式会社
  • 2014-08-20 - 2017-05-31 - G03G15/00
  • 一种图像形成装置,具备时钟供应电路,切换时钟频率而供应时钟信号;第一CPU,与时钟信号同步而处理图像数据;以及第二CPU,与时钟信号同步而进行计时处理,决定一系列的控制的动作定时,在图像数据的处理负荷时提高时钟频率,在图像数据的处理负荷低时降低时钟频率。第二CPU切换计时方法,使得不会由于时钟频率的切换而动作定时发生变动,并且在时钟频率的切换前完成一系列的控制之中的一个控制,在切换之后开始下一个控制。
  • 图像形成装置
  • [发明专利]一种干扰抑制的方法和装置-CN201310227472.6有效
  • 胡敏杰 - 华为技术有限公司
  • 2013-06-08 - 2013-09-11 - H03K5/08
  • 本发明实施例提供了一种干扰抑制的方法和装置,能够消除数字电路对模拟电路的干扰问题,并且方案有继承性,不需要多相时钟,物理布局简单。该方法包括:接收系统时钟,所述系统时钟当前的频带为第一频带;将所述系统时钟转化成当前敏感频带的优选时钟,所述优选时钟及所述优选时钟次谐波不落在所述敏感频带的接收带内,其中,所述优选时钟是根据所述第一频率,确定至少一个规划时钟,并结合所述敏感频带,从所述系统时钟和所述至少一个规划时钟中选取的,所述至少一个规划时钟频率为第二频率,所述第二频率相对所述第一频率频率增量小于等于预设阈值。
  • 一种干扰抑制方法装置
  • [发明专利]一种去毛刺频率锁定电路-CN201611142338.6在审
  • 何文明;廖英豪 - 深圳市紫光同创电子有限公司
  • 2016-12-12 - 2017-05-24 - H03L7/087
  • 本发明公开了一种去毛刺频率锁定电路,该电路包括频率锁定电路、相位锁定电路、锁定去毛刺电路,频率锁定电路和相位锁定电路分别与锁定去毛刺电路连接;频率锁定电路对输入时钟和反馈时钟频率进行比较得到频率锁定信号输出到锁定去毛刺电路,相位锁定电路对输入时钟和反馈时钟的相位进行比较得到相位锁定信号输出到锁定去毛刺电路;锁定去毛刺电路在相位锁定信号和频率锁定信号均为高电平时,对输入时钟进行计数,当计数值达到预设计数值后,锁定输入时钟频率和相位本发明完成输入时钟和反馈时钟频率比较和相位比较,并且对比较后的锁定信号进行脉冲滤除,去除不正确的锁定信号,提高了系统的稳定。
  • 一种毛刺频率锁定电路
  • [实用新型]实时时钟频率合成器-CN200720032107.X无效
  • 和康元;刘长虹 - 中国科学院国家授时中心
  • 2007-06-22 - 2008-09-17 - H03L7/197
  • 一种实时时钟频率合成器,单片锁相环电路;小数分频电路,该电路与单片锁相环电路相连接;50分频电路,该电路的输入端接单片锁相环电路。本实用新型将稳定度频率源变换为可供实时时钟使用的频率信号,克服了实时时钟使用普通32.768KHz石英晶体振荡常期计时准确性低的缺点,使实时时钟长期计时准确性随频率源稳定度的提高而提高。采用了单片锁相环电路,具有结构简单、成本低、制作调试方便的优点,可作为将稳定度频率振荡源转换为适合实时时钟频率频率合成器。
  • 实时时钟频率合成器
  • [发明专利]信号处理电路-CN00128673.0有效
  • 迈克尔·R·梅 - 摩托罗拉公司
  • 2000-09-20 - 2001-04-11 - H03M1/66
  • 为转换器提供时钟信号,其频率为fs。频率fs是从频率为fs/N的晶体频率导出的,导出中使用了一种边沿触发的时钟倍频器,时钟倍频器将晶体频率乘以因子N。其结果是一种低成本时钟的解决方案,将时钟抖动集中在局部频率fs/N处。然后,使用Σ-Δ处理电路在时钟抖动噪声的相同频率处设置量化噪声的零点,从而抵消了这两种类型噪声的不利的积累效果。
  • 信号处理电路
  • [实用新型]一种降低基带时钟信号次谐波干扰的电路-CN200820092338.4无效
  • 马丹;赵晨飞 - 中兴通讯股份有限公司
  • 2008-02-26 - 2008-12-17 - H04B1/40
  • 本实用新型公开了一种降低基带时钟信号次谐波干扰的电路,包括时钟信号发生器、信号接收电路,所述时钟信号发生器与信号接收电路之间串联一电感。所述时钟信号发生器所发出时钟信号的次谐波干扰信号对应的频率在所使用的通讯频段范围内,电感的自谐振频率为所述次谐波干扰信号所对应的频率。本实用新型在基带时钟信号传输链路上串联一电感,在低频段基带时钟信号可正常通过;而在高频段,可将干扰信号直接阻隔抑制掉,降低对射频接收信号的干扰,接收掉话电平与不受干扰的情况下差异大幅度降低,很好地解决了基带时钟信号产生的次谐波干扰射频信号的问题
  • 一种降低基带时钟信号谐波干扰电路

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