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[发明专利]针对模块的时钟限制系统及其方法-CN201910728323.5有效
发明人：顾雪春 -专利权人：南京芯驰半导体科技有限公司
申请日： 2019-08-08 - 公布日： 2021-05-28 - 主分类号： G06F1/04 文献下载
摘要：一种针对模块的时钟限制系统及其方法，包括时钟源装置和功能模块；还包括：时钟限制机构；所述时钟源装置和功能模块通过时钟限制机构连接；所述时钟限制机构用于对所述功能模块运行的时钟频率进行限制。所述时钟限制机构包括频率限制模块和门控时钟模块；所述频率限制模块和所述门控时钟模块均与所述时钟源装置通信连接；所述门控时钟模块与所述功能模块通信连接；所述频率限制模块用于根据所述时钟源装置传输来的信号，以此控制所述门控时钟模块来让所述功能模块运行的时钟频率得到限制。有效避免了现有技术中无法防止客户通过软件配置来超频让功能模块取得在允许范围外的时钟频率、常常使得功能模块运行的时钟频率无序而混乱的缺陷。
针对模块时钟限制系统及其方法

[发明专利]实现磁共振谱仪时钟同步的磁共振谱仪系统-CN202111051428.5在审
发明人：吴林;张涛;王燕燕;邱胜顺 -专利权人：上海电气（集团）总公司智惠医疗装备分公司
申请日： 2021-09-08 - 公布日： 2021-11-19 - 主分类号： G01R33/36 文献下载
摘要：本发明的实现磁共振谱仪时钟同步的磁共振谱仪系统，所述系统包括：时钟源模块以及与所述时钟源模块连接的一或多个功能模块；其中，所述时钟源模块，用于向各功能模块供给同步时钟信号；每个功能模块，包括：工作时钟同步子模块，用于接收对应该功能模块的同步时钟信号，并基于该同步时钟信号获得一或多路与所述时钟源模块同步且低时钟抖动的工作时钟信号。本发明针对谱仪系统的整体时钟同步提出一揽子的解决方案，将实现谱仪系统各个组成单元之间的时钟同步，解决了谱仪各组成单元获取跟谱仪时钟源单元时钟信号同步且低抖动的时钟需求，从而为谱仪系统服务于磁共振高质量扫描成像奠定坚实的基础
实现磁共振时钟同步系统

[实用新型]时钟发生电路、时钟发生器及通信总线系统-CN202022235015.X有效
发明人：高有平 -专利权人：深圳市圣诺科技有限公司
申请日： 2020-10-09 - 公布日： 2021-06-22 - 主分类号： H03L7/18 文献下载
摘要：本实用新型属于时钟发生器技术领域，公开了一种时钟发生电路、时钟发生器及通信总线系统，该时钟发生电路包括低速时钟模块、高速时钟模块、时钟监控模块、低速备用时钟模块及高速备用时钟模块，时钟监控模块接收低速时钟模块的低速时钟电信号并判断低速时钟模块是否中断，在低速时钟模块中断时，将系统时钟源切换至低速备用时钟模块；时钟监控模块接收高速时钟模块的高速时钟电信号并判断高速时钟模块是否中断，在高速时钟模块中断时，将系统时钟源切换至高速备用时钟模块。本实用新型中，通过设置不同类型的时钟模块提供多种时钟方式，由时钟监控模块来监控两个不同类型的时钟模块时钟源的状况，而且有独立的使能和中断控制设置。
时钟发生电路时钟发生器通信总线系统

[发明专利]一种时钟系统-CN200610036880.3无效
发明人：冯健;崔英利 -专利权人：华为技术有限公司
申请日： 2006-08-02 - 公布日： 2007-02-07 - 主分类号： G06F1/04 文献下载
摘要：本发明公开了一种时钟系统，包括：第一时钟驱动模块，用于提供至少一条第一源时钟信号线，该第一源时钟信号线中至少一个为主用源时钟信号线或备用源时钟信号线；第二时钟驱动模块，提供至少一条第二源时钟信号线，该第二源时钟信号线中至少一个为主用源时钟信号线或备用源时钟信号线；同步时钟模块，与第一源时钟信号线和第二源时钟信号线相连接，提供时钟信号；其中，在所述第一时钟源信号线和第二时钟源信号线的总和中，包括3个以上的主用源时钟信号线和3个以上的备用源时钟信号线。本发明可将ATCA规范中提供最多3套时钟信号扩充至最多6套时钟信号；可更好地实现时钟备份功能，提高系统可靠性；且系统时钟信号的输出阻抗匹配容易实现。
一种时钟系统

[发明专利]同步以太网中时钟信息分发的方法和装置-CN201210379698.3无效
发明人：杨曙军 -专利权人：盛科网络（苏州）有限公司
申请日： 2012-10-09 - 公布日： 2013-01-09 - 主分类号： H04L7/00 文献下载
摘要：本发明揭示了一种同步以太网中时钟信息分发的方法和装置，其通过各网元的邻居关系管理模块根据网元标识建立各网元的邻居关系表，由时钟源信息管理模块将时钟源产生的时钟标识及时钟质量信息发送给所述邻居关系表中的各邻居网元，建立各网元的时钟源信息数据库，并根据时钟源信息数据库中的信息，由时钟源有效路径计算模块计算出各网元的同步路径，从而得到各网元对时钟源的同步路径；且在网络拓扑发生变化或时钟源不可用时，通过路径切换模块及时钟切换模块重新计算得到各网元新的同步路径，本发明能够有效的防止时钟成环，从而保证了同步网络的同步精度。
同步以太网时钟信息分发方法装置

[实用新型]时间基准单元-CN201620592491.8有效
发明人：熊文贤 -专利权人：云南电网有限责任公司昭通供电局
申请日： 2016-06-17 - 公布日： 2016-12-07 - 主分类号： H04W56/00 文献下载
摘要：本实用新型提出了一种时间基准单元，包括：输入模块、核心模块、输出模块，所述输入模块包括授时模块、时间源模块，所述核心模块包括本地时钟、时间源控制模块、中心控制模块、显示模块、扩展控制模块、时间源检测模块，所述本地时钟接时间源控制模块，所述时间源控制模块接中心控制模块，所述时间源控制模块的信号输入端接输入模块，其信号输出端接输出模块，所述中心控制模块分别与显示模块、输入模块、输出模块、扩展控制模块、时间源检测模块连接本实用新型通过控制本地时钟来控制时间输出连续准确，即使时间源输入出现偏差，也不影响时钟输出。
时间基准单元

[实用新型]一种时钟信号产生系统及装置-CN202020187868.8有效
发明人：郭要强;曹旭钊;王创;阮联波 -专利权人：深圳驼人生物医疗电子股份有限公司
申请日： 2020-02-19 - 公布日： 2020-09-04 - 主分类号： H03L7/18 文献下载
摘要：本申请适用于信号处理技术领域，提供了一种时钟信号产生系统及装置，包括基础时钟源模块、时钟信号产生模块和配置模块；所述时钟信号产生模块分别与所述基础时钟源模块和所述配置模块相连；所述基础时钟源模块产生初始时钟信号，并将所述初始时钟信号传输至所述时钟信号产生模块；所述配置模块产生配置信号，并将所述配置信号传输至所述时钟信号产生模块；所述时钟信号产生模块接收所述初始时钟信号和所述配置信号，并根据所述配置信号将所述初始时钟信号通过倍频和/或分频处理成不同频率的目标时钟信号。本申请可以满足不同设备对不同频率的时钟信号的要求，提高了设备的可靠性。
一种时钟信号产生系统装置

[发明专利]一种基于双路飞腾处理器的差分同步时钟的生成装置及方法-CN202210073602.4在审
发明人：夏显忠;闵应涛;陈龙;金广涛;胡龙 -专利权人：湖南航天捷诚电子装备有限责任公司
申请日： 2022-01-21 - 公布日： 2022-03-29 - 主分类号： G06F1/10 文献下载
摘要：本发明公开了一种基于双路飞腾处理器的差分同步时钟的生成装置及方法，公开的基于双路飞腾处理器的差分同步时钟的生成装置晶振模块、处理模块，所述晶振模块输出单端时钟，作为时钟源输入给处理模块；所述处理模块将输入时钟源处理后生成两组时钟组分别输出给两个飞腾处理器，所述时钟组包括一路单端时钟和一路差分时钟。晶振模块作为时钟源，产生单端时钟给处理模块；处理模块产生双路飞腾处理器所需的同步时钟，即两路单端时钟和两路差分时钟提供给两个飞腾处理器，实现由同一时钟源为两路飞腾处理器提供多路不同频率的时钟。
一种基于飞腾处理器同步时钟生成装置方法

[发明专利]时钟源系统、时钟同步系统和时钟同步方法-CN202011123143.3有效
发明人：刘君 -专利权人：哲库科技（北京）有限公司
申请日： 2020-10-20 - 公布日： 2023-08-22 - 主分类号： H04J3/06 文献下载
摘要：本申请提供一种时钟源系统、时钟同步系统和时钟同步方法、电子设备和计算机可读存储介质，时钟源系统包括第一定时器模块，用于分别获取时钟源系统的第一时钟信号和子系统的第二时钟信号；偏差获取模块，用于根据第一时钟信号和第二时钟信号获取时钟偏差；其中，第一定时器模块还用于获取时钟偏差，并向子系统发送时钟偏差以指示子系统对第二时钟信号进行校准，以与该时钟源系统的本地时钟同步，从而保证时钟源系统与子系统之间的通讯完全同步，可以有效解决具有不同时钟源或时间基准的模块间数据传输不同步问题，同时保证时钟源系统与子系统之间数据传输的实时性和一致性。
时钟系统同步方法

[发明专利]一种本地时钟同步的保持方法及装置-CN202011621257.0有效
发明人：张长淼 -专利权人：锐捷网络股份有限公司
申请日： 2020-12-31 - 公布日： 2023-03-24 - 主分类号： H04J3/06 文献下载
摘要：本发明公开了一种本地时钟同步的保持方法及装置，该方法包括：根据所述GNSS的同步时钟源的频率，通过同步串行总线I2C总线对时钟模块的晶振频率进行调节；当所述时钟模块输出的信号频率在所述同步时钟源的预设振荡范围内时，获取所述时钟模块的当前环境温度和第一晶振频率并保存；当所述GNSS的同步时钟源丢失，则获取所述时钟模块的当前环境温度，并根据环境温度和输出频率关系以及所述第一晶振频率，通过I2C总线调节所述时钟模块以输出与所述GNSS同步时钟源在预设振荡范围内的同步时钟源。本发明实施例能够解决现有技术同步时钟源消失时，如何同时保持本地时钟同步稳定性及精度且实现成本较低的问题。
一种本地时钟同步保持方法装置

[发明专利]驱动芯片及显示装置-CN202010652790.7有效
发明人：魏玉娜;徐福根;沈振天 -专利权人：昆山龙腾光电股份有限公司
申请日： 2020-07-08 - 公布日： 2022-08-26 - 主分类号： G09G3/20 文献下载
摘要：本发明属于显示技术领域，涉及驱动芯片及显示装置，其中，驱动芯片包括时钟信号生成模块和时钟信号调整模块。时钟信号生成模块的输出端与时钟信号调整模块相连，用于输出时钟信号至时钟信号调整模块。时钟信号调整模块还包括延时单元，延时单元的一端与时钟信号生成模块的输出端相连，延时单元的另一端分别与源极驱动电路和栅极驱动电路相连，时钟信号调整模块用于根据控制信号调整与时钟信号生成模块的输出端串接的延时单元的电阻的阻值以延时时钟信号，并输出延时后的时钟信号。其中，延时后的时钟信号的输出时间与源极驱动电路输出源极驱动信号的输出时间不同步。因此，能够减小时钟信号和源极输出信号之间的耦合影响以降低面板噪声。
驱动芯片显示装置

[发明专利]一种OTN支路板卡的时钟处理装置及方法-CN201710861355.3有效
发明人：毛晓波 -专利权人：烽火通信科技股份有限公司
申请日： 2017-09-21 - 公布日： 2019-04-26 - 主分类号： H04J3/16 文献下载
摘要：本发明公开了一种OTN支路板卡的时钟处理装置及方法，涉及光通信应用技术领域。该装置的Framer芯片包括SFP模块和与SFP模块相连的8K时钟处理模块。该8K时钟处理模块能从用户指定的客户业务端口提取时钟到系统的时钟单元，并当所在OTN支路板卡作为时钟源时实时监测客户业务端口，一旦监测到故障告警，则输出中断电平信号给FPGA处理模块，同时向系统的时钟单元发出时钟源切换信号该装置的FPGA处理模块收到中断电平信号后，将关闭时钟提取通道，系统的时钟单元收到时钟源切换信号后，则进行时钟源的切换。本发明不但能在时钟源发生故障丢失时进行及时切换，而且能在1ms以内进行响应，达到了系统TIE指标要求，用户体验好。
一种 otn 支路板卡时钟处理装置方法

[发明专利]可校准时钟的存储控制器、时钟校准方法、装置-CN202310628611.X在审
发明人：温佳强;赖鼐;龚晖 -专利权人：珠海妙存科技有限公司
申请日： 2023-05-30 - 公布日： 2023-08-08 - 主分类号： G11C29/12 文献下载
摘要：本发明公开了一种可校准时钟的存储控制器、时钟校准方法、装置，该存储控制器包括时钟模块，时钟模块用于为芯片提供时钟；时钟模块包括时钟源模块、时钟控制模块和时钟检测模块；时钟源模块用于根据接收到的时钟控制字生成所需频率的目标时钟；时钟检测模块用于根据目标时钟与参考时钟的大小，生成程序指令；时钟控制模块用于根据程序指令，对时钟控制字进行更新；时钟源模块还用于若程序指令的幅度为零，生成校准后的目标时钟。本发明实施例中的存储控制器不需要晶振模块的参与，也能够实现时钟的校准，有利于减少存储控制器的部件，降低封装难度，从而提升存储控制器的可靠性，可广泛应用于芯片存储控制器技术领域内。
校准时钟存储控制器方法装置

[发明专利]一种嵌入式设备时钟源的调整方法-CN201010500155.3有效
发明人：牟伦荣;夏军 -专利权人：重庆重邮信科通信技术有限公司
申请日： 2010-09-30 - 公布日： 2012-05-09 - 主分类号： G06F1/08 文献下载
摘要：本发明公开了一种嵌入式设备时钟源的调整方法，设备实时获取各模块所需要的时钟频率；如果有模块所需要的时钟频率发生变化时，设备根据各模块所需的时钟频率重新配置所有模块的时钟源；设备根据重新配置的时钟源对应的电压等级对设备电压进行调整本发明的技术方案在模块时钟频率需求发生变化时，根据时钟频率需求对整个设备的时钟源进行重新调整，使设备在满足工作需求的前提下，尽量处于较小的工作频率或尽量保证时钟源开启数量最少，从而大大降低嵌入式设备的动态功耗
一种嵌入式设备时钟调整方法

[发明专利]具有时钟转换能力的时钟电路和方法-CN200880110598.2无效
发明人：斯里尼瓦桑·R·博马雷迪;乌代·帕德马纳班;萨米尔·J·索尼;科伊奇·E·诺姆拉;尼古拉斯·F·金格尔斯;维维克·班 -专利权人：飞思卡尔半导体公司
申请日： 2008-09-16 - 公布日： 2010-09-01 - 主分类号： H03K19/00 文献下载
摘要：一种装置(10)，包括复用器(20)，该复用器(20)被配置为提供从源时钟、目标时钟、和过渡时钟之中选择的输出时钟。该装置进一步包括：相位差计算模块(22)，被配置为计算源时钟和目标时钟之间的相位；以及时钟生成模块(12)，被配置为生成多个时钟。该装置进一步包括：时钟选择模块(14)，被配置为选择多个时钟中的一个时钟作为过渡时钟；以及控制电路(16)，被配置为提供：(1)去往时钟选择模块的信号，用于基于源时钟和目标时钟之间的相位差，选择多个时钟中的一个时钟作为过渡时钟，以及(2)去往复用器的信号，用于提供源时钟、目标时钟、或过渡时钟中的一个作为输出时钟。
具有时钟转换能力电路方法