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[实用新型]一种微型多环式锁相频率合成器-CN201320668888.7有效
发明人：宁涛;王润洪;肖聪;吴伟冬;马刚 -专利权人：成都九华圆通科技发展有限公司
申请日： 2013-10-29 - 公布日： 2014-04-02 - 主分类号： H03L7/18 文献下载
摘要：本实用新型公开了一种微型多环式锁相频率合成器，它由控制器、结构对称的至少两组单环锁相环路，以及至少一组混频锁相环路组成，控制器分别与单环锁相环路、混频锁相环路连接，两组单环锁相环路之间通过晶体振荡器互连，两组单环锁相环路的输出端分别与混频锁相环路连接。本实用新型提供一种微型多环式锁相频率合成器，采用结构对称的至少两组单环锁相环路，两组单环锁相环路可互换，简化了电路结构和空间布局，减小了体积，降低了生产成本和使用成本，易于集成，电路结构灵活，易于扩展，通过混频锁相环路使得两组单环锁相环路互相嵌套，可根据具体需要设置各环路中分频器个数，确保满足捷变频、高分辨率、低杂散和低相噪等方面的要求。
一种微型多环式锁相频率合成器

[发明专利]一种混合锁相环-CN201610563146.6有效
发明人：白旭;胡辉;付劲松;张超 -专利权人：北华航天工业学院
申请日： 2016-07-18 - 公布日： 2019-01-08 - 主分类号： H03L7/085 文献下载
摘要：本发明提出一种混合锁相环及锁相环频率锁定方法，包括时钟产生器、鉴频鉴相器、模拟比较器、压控振荡器、分频器、模/数转换器、微控制器、数/模转换器及环路滤波电路、固定增益放大器及电平调理电路、程控增益放大电路，该混合锁相环结构及频率锁定方法结合了全数字式锁相环和模拟锁相环的部分优点，使得本发明专利解决了锁相环的失锁问题，该结构的锁相环使得压控振荡器(VCO)处于任何工作频率条件下锁相环均可以进入锁定状态。基于该结构的锁相环结构简单，易于实现。
混合锁相环频率锁定方法

[发明专利]一种基于锁相环的分布式发电系统的孤岛检测方法-CN201711045372.6在审
发明人：项基;邱稳斌;陈安伟;李继红;王敏 -专利权人：浙江大学;国网浙江省电力公司
申请日： 2017-10-31 - 公布日： 2018-04-06 - 主分类号： G01R31/00 文献下载
摘要：本发明公开了一种基于锁相环的分布式发电系统的孤岛检测方法，包括以下步骤步骤1锁相环集成在所述分布式发电系统的逆变器中，通过锁相环检测分布式发电系统中公共点电压的频率；步骤2判断锁相环输出频率与大电网频率是否匹配，是则判定不确定发生孤岛；否则判定为发生孤岛；步骤3根据上述步骤得到的结果，判断所述分布式发电系统发生孤岛效应情况；本发明的基于锁相环的分布式发电系统的孤岛检测方法通过引入锁相环技术，提供了一种新的孤岛检测方法
一种基于锁相环分布式发电系统孤岛检测方法

[发明专利]一种基于锁相环和矩阵开关的S波段快跳频率源-CN201711138434.8在审
发明人：吴昱程;陈林辉;刘志哲;刘晓东;聂利鹏;曹玉雄 -专利权人：北京遥感设备研究所
申请日： 2017-11-16 - 公布日： 2018-04-13 - 主分类号： H03L7/07 文献下载
摘要：本发明公开了一种基于锁相环和矩阵开关的S波段快跳频率源，包括变频电路、五功分器、分频器、倍频器、滤波器A、滤波器B、混频器和放大器，还包括锁相环A、锁相环B、锁相环C、锁相环D、锁相环E和5X2矩阵开关本发明采用锁相环A、锁相环B、锁相环C、锁相环D、锁相环E、5X2矩阵开关搭建快速跳频源，采用变频电路产生基准频率，大大降低了成本；锁相环A、锁相环B、锁相环C、锁相环D、锁相环E保证了高带外抑制度且为跳频间隔提供了自由度
一种基于锁相环矩阵开关波段频率

[发明专利]间歇式锁相环频率综合器-CN201610594381.X有效
发明人：阴亚东;施隆照 -专利权人：福州大学
申请日： 2016-07-27 - 公布日： 2019-03-12 - 主分类号： H03L7/10 文献下载
摘要：本发明涉及一种间歇式锁相环频率综合器，包括时钟同步单元、锁相环单元以及模式控制单元；时钟同步单元分别与模式控制单元以及锁相环单元相连；模式控制单元与所相环单元相连；时钟同步单元以及模式控制单元作为输入端，分别接收参考时钟信号以及模式控制信号；模式控制单元接收时钟同步单元发送的同步时钟信号；锁相环单元接收模式控制信号发送的第一复位信号以及第二复位信号，接收时钟同步单元发送的同步时钟信号，并分别发送反馈时钟信号至时钟同步单元以及模式控制单元；锁相环单元作为输出端，输出一高频时钟信号。本发明所提出的一种间歇式锁相环频率综合器，其能够工作在开启时间短于锁相环锁定时间的间歇工作模式。
间歇式锁相环频率综合

[发明专利]一种高可靠性的锁相环模块及其输出时钟的切换方法-CN202010940406.3在审
发明人：耿晓祥;周建;林明杰;马肖祥;王建中 -专利权人：苏州云途半导体有限公司
申请日： 2020-09-09 - 公布日： 2020-12-18 - 主分类号： H03L7/085 文献下载
摘要：一种高可靠性锁相环模块，所述锁相环模块包括锁相环单元、锁相环监测单元、时钟切换单元，所述锁相环单元连接至所述锁相环监测单元，所述锁相环监测单元的输出和所述锁相环单元的输出分别连接至所述时钟切换单元，所述锁相环监测单元用于对所述锁相环单元的工作状态或参数进行监测，所述时钟切换单元根据所述锁相环监测单元的监测结果对所述锁相环模块的输出时钟进行切换。上述技术方案中能够实现锁相环输出时钟的自动切换，降低了功耗，节约了成本，且能够避免因锁相环失锁以及锁相环输入参考时钟发生抖动所导致的系统故障、崩溃等问题，极大地提高了系统的稳定性和可靠性。
一种可靠性锁相环模块及其输出时钟切换方法

[实用新型]一种内插混频器的DDS激励PLL的微波频率合成器-CN201120101571.6无效
发明人：司朝良;刘清来;初广前 -专利权人：山东交通学院
申请日： 2011-04-09 - 公布日： 2011-09-21 - 主分类号： H03L7/22 文献下载
摘要：本实用新型的内插混频器的DDS激励PLL的微波频率合成器，包括主锁相环PLL和直接数字式频率合成器DDS，其特征在于：包括辅助锁相环PLL、混频器和控制单元；直接数字式频率合成器DDS的输出信号接到主锁相环PLL中鉴相器的输入端，主锁相环PLL的输出信号经N分频后输入到混频器的输入端；辅助锁相环PLL的输出信号输入到混频器，混频器的输出信号输入到鉴相器；所述控制单元与直接数字式频率合成器DDS和辅助锁相环本实用新型保证了主锁相环输出的微波信号具有较宽的频率范围和很高的频率分辨率；且实现了输出信号的频率微调和粗调的有效结合，具有输出频带宽、分辨率高和调节方便的优点。
一种内插混频器 dds 激励 pll 微波频率合成器

[发明专利]环路增益校准方法-CN201210229664.6有效
发明人：张湘辉;汪炳颖;詹景宏;谢秉谕 -专利权人：联发科技股份有限公司
申请日： 2008-10-16 - 公布日： 2012-10-17 - 主分类号： H03L7/085 文献下载
摘要：本发明提供全数字锁相环、环路频宽校准方法与环路增益校准方法。一种环路频宽校准方法，用于全数字锁相环。环路频宽校准方法包含根据全数字锁相环的时间数字转换器的增益、数控振荡器的增益或时间数字转换器的增益与数控振荡器的增益二者的组合，通过调整全数字锁相环的比例式路径模块的放大器的增益，来校准全数字锁相环的环路频宽上述环路频宽校准方法达到精确校准全数字锁相环的环路频宽的效果。
环路增益校准方法

[发明专利]全数字锁相环、环路频宽校准方法与环路增益校准方法-CN200810169984.0有效
发明人：张湘辉;汪炳颖;詹景宏;谢秉谕 -专利权人：联发科技股份有限公司
申请日： 2008-10-16 - 公布日： 2009-04-22 - 主分类号： H03L7/08 文献下载
摘要：本发明提供全数字锁相环、环路频宽校准方法与环路增益校准方法。一种环路频宽校准方法，用于全数字锁相环。环路频宽校准方法包含根据全数字锁相环的时间数字转换器的增益、数控振荡器的增益或时间数字转换器的增益与数控振荡器的增益二者的组合，通过调整全数字锁相环的比例式路径模块的放大器的增益，来校准全数字锁相环的环路频宽上述环路频宽校准方法达到精确校准全数字锁相环的环路频宽的效果。
数字锁相环环路频宽校准方法增益

[实用新型]利用乒乓环实现的锁相式快跳源-CN201320413392.5有效
发明人：宋烨曦;杨光;孙敏 -专利权人：四川九洲电器集团有限责任公司
申请日： 2013-07-12 - 公布日： 2014-02-12 - 主分类号： H03L7/099 文献下载
摘要：本实用新型提出了一种利用乒乓环实现的锁相式快跳源，由两个锁相环电路、一个单刀双掷开关、晶体振荡器、CPLD控制电路、放大滤波电路构成，其中晶体振荡器连接两个锁相环电路，所述两个锁相环电路连接到所述单刀双掷开关；CPLD控制电路与锁相环电路中的锁相环和单刀双掷开关连接；单刀双向开关连接到放大滤波电路，放大滤波电路的输出作为所述锁相式快跳源的输出。本实用新型是用两个独立的锁相环相互切换来实现快跳，可以很容易的实现跳频时间小于1μs。本实用新型相比以传统方式实现的快跳源，其体积更小、功耗更小、成本更低。
利用乒乓实现锁相式快跳源

[发明专利]时钟系统、电子装置、处理方法-CN201780091708.4在审
发明人：刘敬波;刘俊秀;王雅君;石岭 -专利权人：深圳开阳电子股份有限公司
申请日： 2017-12-08 - 公布日： 2020-07-14 - 主分类号： H03L7/08 文献下载
摘要：本发明公开了一种时钟系统(100)，时钟系统(100)包括参考时钟模块(110)、锁相环模块(120)、锁相环电源模块(130)、锁相环故障监测模块(140)和锁相环故障处理模块(150)。锁相环模块(120)用于根据参考时钟信号输出处理时钟信号。锁相环电源模块(130)用于为锁相环模块(120)供电。锁相环故障监测模块(140)用于根据锁相环电源模块(130)的供电电压和处理时钟信号确定锁相环模块(120)的工作状态。锁相环故障处理模块(150)用于根据锁相环模块(120)的工作状态控制锁相环模块(120)和/或锁相环电源模块(130)及确定输出时钟信号。本发明还公开了一种处理方法和一种电子装置。
时钟系统电子装置处理方法

[实用新型]一种基于FPGA的频综接收机快速跳频电路-CN201920247721.0有效
发明人：付泉斌;蔡楚才 -专利权人：武汉博畅通信设备有限责任公司
申请日： 2019-02-27 - 公布日： 2019-09-13 - 主分类号： H04B1/16 文献下载
摘要：本实用新型提出了一种基于FPGA的频综接收机快速跳频电路，通过设置第一锁相环和第二锁相环组成并行双锁相环，在FPGA在捕捉到跳频控制字后，开启第一锁相环和第二锁相环，射频开关选通第一锁相环，第一锁相环进入频率f1锁定等待状态，第二锁相环进入频率f2的预锁定状态，第一锁相环的频率f1锁定后，射频开关选通第二锁相环，第一锁相环进入频率f3的预锁定状态，第二锁相环进入频率f2的锁定等待状态，如此循环，实现并行双锁相环的快速锁定；使用锁相环锁定自校准功能，锁相环的锁定时间达到36us以内；通过设置射频开关，可以突破频综接收机跳频时间受到锁相环芯片稳定时间的限制，实现锁相环的锁定时间达到18us以内。
锁相环锁定频综接收机射频开关等待状态快速跳频跳频相环选通并行电路本实用新型锁相环芯片快速锁定控制字自校准捕捉

[发明专利]一种锁相环电路及其工作方法-CN201110441754.7有效
发明人：唐佳捷;史爱焕 -专利权人：国民技术股份有限公司
申请日： 2011-12-26 - 公布日： 2017-09-22 - 主分类号： H03L7/099 文献下载
摘要：本发明公开一种锁相环电路，其包括锁相环核心单元和锁相环控制单元，当所述锁相环电路处于发射状态时，所述锁相环核心单元在所述锁相环控制单元的控制下通过整数分频开环模式输出信号；当所述锁相环电路处于接收状态时，所述锁相环核心单元在所述锁相环控制单元的控制下通过小数分频闭环模式输出信号。本发明通过以上技术方案，提供一种更加完善的锁相环电路。
一种锁相环电路及其工作方法

[发明专利]一种多锁相环高速跳频本振电路-CN202011188155.4在审
发明人：肖姗姗;苗尧飞;于猛;吴迪;杨博;周扬;巩执欢;莫晓婷;王武志 -专利权人：天津光电通信技术有限公司
申请日： 2020-10-30 - 公布日： 2020-12-29 - 主分类号： H03L7/099 文献下载
摘要：本发明创造提供了一种多锁相环高速跳频本振电路，包括：锁相环单元，所述锁相环单元包括至少两个锁相环，用于读出数据，并分别输出相应的频率；晶振单元，所述晶振单元用于为所述锁相环单元提供时钟；高速开关阵列，所述高速开关阵列用于定时切换所述锁相环单元中的锁相环，并根据所述锁相环输出的频率输出相应的本振频率；电源单元，用于分别为所述锁相环单元、晶振单元和高速开关阵列提供电源；所述晶振单元与所述锁相环单元电连接，所述高速开关阵列与所述锁相环单元电连接，所述电源单元分别与所述锁相环单元可以利用多个锁相环切换来提高跳频速率。
一种多锁相环高速电路

[实用新型]一种多锁相环高速跳频本振电路-CN202022480628.X有效
发明人：肖姗姗;苗尧飞;于猛;吴迪;杨博;周扬;巩执欢;马彤鑫;莫晓婷 -专利权人：天津光电通信技术有限公司
申请日： 2020-10-30 - 公布日： 2021-04-30 - 主分类号： H03L7/099 文献下载
摘要：本实用新型提供了一种多锁相环高速跳频本振电路，包括：锁相环单元，所述锁相环单元包括至少两个锁相环，用于读出数据，并分别输出相应的频率；晶振单元，所述晶振单元用于为所述锁相环单元提供时钟；高速开关阵列，所述高速开关阵列用于定时切换所述锁相环单元中的锁相环，并根据所述锁相环输出的频率输出相应的本振频率；电源单元，用于分别为所述锁相环单元、晶振单元和高速开关阵列提供电源；所述晶振单元与所述锁相环单元电连接，所述高速开关阵列与所述锁相环单元电连接，所述电源单元分别与所述锁相环单元可以利用多个锁相环切换来提高跳频速率。
一种多锁相环高速电路

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