[发明专利]含有两个缓冲器的帧同步器无效
| 申请号： | 98102801.2 | 申请日： | 1998-07-02 |
| 公开（公告）号： | CN1206285A | 公开（公告）日： | 1999-01-27 |
| 发明（设计）人： | 高桥秀彰;西谷和雄 | 申请（专利权）人： | 日本电气株式会社 |
| 主分类号： | H04N5/10 | 分类号： | H04N5/10 |
| 代理公司： | 中科专利代理有限责任公司 | 代理人： | 刘晓峰 |
| 地址： | 日本国*** | 国省代码： | 暂无信息 |
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| 摘要： | 在一种帧同步器中,一串行/并行转换器(1)将输入串行数据信号(Din)转换为一并行数据信号(S1)。第一缓冲器接收第一并行数据信号产生第一并行数据信号,及第二缓冲器接收第一并行数据信号产生第二并行数据信号。选择器选择第一和第二并行数据信号中的一个以产生第三并行数据信号。串行/并行转换器将第三并行数据信号转换为输出串行数据信号。还包括一缓冲器控制电路及一选择器控制电路。 | ||
| 搜索关键词： | 含有 两个 缓冲器 同步器 | ||
【主权项】：
1、一种帧同步器，其特征在于包含：一串行／并行转换器(1)，用于接收输入串行数据信号(Din)及将所述输入串行数据信号转换为第一并行数据信号(S1)；第一缓冲器(2-1)，与所述串行／并行转换器相连，用于接收所述第一并行数据信号以产生一第一并行数据信号(S2)；一第二缓冲器(2-2)，与所述第一缓冲器相连，用于接收所述第一并行数据信号以产生一第二并行数据信号(S3)；一选择器(3)，与所述第一和第二缓冲器相连，用于选择所述第一和第二并行数据信号中的一个以产生第三并行数据信号(S4)；一并行／串行转换器(4)，其与所述选择器相连，用于接收所述第三并行数据信号并将所述第三并行数据信号转换为输出串行数据信号(Dout)；一缓冲器控制电路(5)，与所述第一和第二缓冲器相连，用于根据输入帧相位信号(FPin)在不同的相位时间操作第一和所述第二缓冲器；及一选择器控制电路(6)，其与所述选择器相连，用于根据所述输入帧相位信号与输出帧相位信号(FPout)间的相位差操作所述选择器。
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