[发明专利]一种实现时钟同步的方法及装置在审
| 申请号： | 202310051718.2 | 申请日： | 2023-02-02 |
| 公开（公告）号： | CN116258106A | 公开（公告）日： | 2023-06-13 |
| 发明（设计）人： | 肖慧;张吉锋;邵中尉 | 申请（专利权）人： | 上海思尔芯技术股份有限公司 |
| 主分类号： | G06F30/34 | 分类号： | G06F30/34;G06F30/347 |
| 代理公司： | 北京清大紫荆知识产权代理有限公司 11718 | 代理人： | 黎飞鸿;郑纯 |
| 地址： | 201306 上海市浦东新区中国（上海）自由*** | 国省代码： | 上海;31 |
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| 摘要： | 本申请提供了一种实现时钟同步的方法及装置，用于包含多个FPGA的原型验证系统，其中方法包括：先获取用户芯片设计中原有的时钟模块，在芯片设计被分割后，将所述时钟模块复制至分割后不包含所述时钟模块的FPGA中并建立正确的连接关系，同时将时钟生成器与每个FPGA中的时钟模块进行等长连接，从而可以使每个FPGA都能够接收到相位相同的时钟信号。本申请实施例通过对时钟模块等逻辑资源进行全局自动化的复制，可以为每个FPGA提供等相位的时钟，从而解决了芯片设计被分割后时钟信号跨FPGA传播而带来的时钟相位偏差问题，实现了分割后各FPGA时钟信号相位对齐。 | ||
| 搜索关键词： | 一种 实现 时钟 同步 方法 装置 | ||
【主权项】：
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