[发明专利]一种低噪声毫米波小数分频综合器锁相环结构在审
| 申请号： | 202210600105.5 | 申请日： | 2022-05-27 |
| 公开（公告）号： | CN115001489A | 公开（公告）日： | 2022-09-02 |
| 发明（设计）人： | 王政;耿新林;叶宗霖;肖尧;谢倩 | 申请（专利权）人： | 电子科技大学 |
| 主分类号： | H03L7/197 | 分类号： | H03L7/197;H03L7/087;H03F1/32;H03L7/093 |
| 代理公司： | 电子科技大学专利中心 51203 | 代理人： | 甘茂 |
| 地址： | 611731 四川省成*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明属于数模混合电路领域，具体提供一种低噪声毫米波小数分频综合器锁相环结构，用以克服在传统基于时间误差放大器(TA)的锁相环结构中因TA动态范围较小且具有较大的非线性而恶化锁相环带内的量化噪声并产生分数分频杂散的问题；本发明在传统结构的基础上还包括：粗数字时间转换器(CDTC)、细数字时间转换器(FDTC)与数字时间转换器预失真校准电路；通过在时间误差放大器前后分别插入粗数字时间转换器与细数字时间转换器缩小时间误差放大器输入相位差的方差，以提高时间误差放大器的线性度，同时抑制分数分频产生的量化噪声；通过采用阈值优值DTC自适应预失真，降低杂散同时保持DTC的量化噪声的二阶整形。 | ||
| 搜索关键词： | 一种 噪声 毫米波 小数 分频 综合 器锁相环 结构 | ||
【主权项】：
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