[发明专利]FPGA电路TILE层级连接检查方法、装置、电子设备及存储介质在审
| 申请号： | 202210190218.2 | 申请日： | 2022-02-28 |
| 公开（公告）号： | CN114692537A | 公开（公告）日： | 2022-07-01 |
| 发明（设计）人： | 陈逸韬;张勇;温长清 | 申请（专利权）人： | 深圳市紫光同创电子有限公司 |
| 主分类号： | G06F30/3323 | 分类号： | G06F30/3323 |
| 代理公司： | 深圳国新南方知识产权代理有限公司 44374 | 代理人： | 周雷 |
| 地址： | 518000 广东省深圳市南山区粤海*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明提供了一种FPGA电路TILE层级连接检查方法、装置、电子设备及计算机可读存储介质。本发明提供的FPGA电路TILE层级连接检查方法，包括：获取TILE层级TILE BMA模型中各功能模块及CRAM单元之间的连接关系，根据该连接关系，生成第一连接检查断言文件；获取TILE层级TILE NETLIST网表中各功能模块及CRAM单元之间的连接关系，根据该连接关系，生成第二连接检查断言文件；利用所述第一连接检查断言文件先后检查所述TILE BMA模型与所述TILE NETLIST网表的连接是否正确，利用所述第二连接检查断言文件先后检查所述TILE NETLIST网表与所述TILE BMA模型的是否正确。本发明的FPGA电路TILE层级连接检查方法，提高了TILE层级验证效率。 | ||
| 搜索关键词： | fpga 电路 tile 层级 连接 检查 方法 装置 电子设备 存储 介质 | ||
【主权项】：
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