[发明专利]一种在忆阻器阵列模块的电路级验证中添加随机数的方法有效
| 申请号： | 202110494705.3 | 申请日： | 2021-05-07 |
| 公开（公告）号： | CN113257312B | 公开（公告）日： | 2022-11-15 |
| 发明（设计）人： | 吴华强;毕雨穆;吴大斌;唐建石;高滨;钱鹤 | 申请（专利权）人： | 清华大学 |
| 主分类号： | G11C13/00 | 分类号： | G11C13/00;G06F8/41 |
| 代理公司： | 北京清亦华知识产权代理事务所(普通合伙) 11201 | 代理人： | 罗文群 |
| 地址： | 100084*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明属于集成电路技术领域，尤其涉及一种在忆阻器阵列模块的电路级验证中添加随机数的方法。首先验证人员设定一个忆阻器阵列模块的寄存器传输级模型或行为级模型，对上述模型中的数据信号输出端口添加一个随机数，作为该模型的最后输出，根据SystemVerilog语言或Verilog语言中的条件编译语句，对随机数进行封装，得到一个封装模块，将封装模块的宏名称添加到用于忆阻器阵列模块的电路级验证的配置文件中。从电路级验证工作的角度来看，本发明方法使验证工作在电路级验证阶段就能提前预估了实际电路的一定随机偏差，可以更好地实现功能验证，让设计人员在芯片设计阶段进行调整。相比于已有技术，本发明减少了2个数量级的验证时间，节约了大量的人力物力成本。 | ||
| 搜索关键词： | 一种 忆阻器 阵列 模块 电路 验证 添加 随机数 方法 | ||
【主权项】：
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