[发明专利]一种相变存储器时序可重构布尔逻辑电路、方法及装置在审
| 申请号： | 202110494507.7 | 申请日： | 2021-05-07 |
| 公开（公告）号： | CN113315506A | 公开（公告）日： | 2021-08-27 |
| 发明（设计）人： | 陈成;李喜;陈后鹏;解晨晨;徐思秋;梁龙飞 | 申请（专利权）人： | 中国科学院上海微系统与信息技术研究所;上海新氦类脑智能科技有限公司 |
| 主分类号： | H03K19/0185 | 分类号： | H03K19/0185 |
| 代理公司： | 上海泰能知识产权代理事务所(普通合伙) 31233 | 代理人： | 钱文斌 |
| 地址： | 200050 *** | 国省代码： | 上海;31 |
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| 摘要： | 本发明涉及一种相变存储器时序可重构布尔逻辑电路、方法及装置，其中电路包括相变存储单元和选通器件，所述相变存储单元的第一端与第一输入电极相连，第二端与所述选通器件的漏端相连，所述选通器件的源端与第二输入电极相连，栅端与控制端相连；通过控制所述第一输入电极、第二输入电极、控制端的输入信号以及所述相变存储单元的初始状态实现逻辑运算操作。本发明能够在单个相变存储单元中实现多种逻辑计算。 | ||
| 搜索关键词： | 一种 相变 存储器 时序 可重构 布尔 逻辑电路 方法 装置 | ||
【主权项】：
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