[发明专利]一种基于FPGA的数据包精准延时方法及系统有效
| 申请号： | 202010693273.4 | 申请日： | 2020-07-17 |
| 公开（公告）号： | CN111831606B | 公开（公告）日： | 2023-03-31 |
| 发明（设计）人： | 陈红艳;陈世霖;马上;王剑;胡剑浩 | 申请（专利权）人： | 电子科技大学;成都信息工程大学 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78 |
| 代理公司： | 四川力久律师事务所 51221 | 代理人： | 韩洋 |
| 地址： | 611731 四川省成*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开了一种基于FPGA的数据包精准延时方法及系统，包括：响应数据包写入请求，确定当前数据链路状态，并根据所述当前数据链路状态判断所述数据包能否被写入，若能，则利用分配算法给所述数据包分配一个存储子空间，并给所述数据包打上时间戳后写入所分配的存储子空间中进行存储，以及，根据当前时间值与数据包的时间戳持续判断每个数据包的存储时间是否满足该数据包的时延要求，若是，则将该数据包输出至其对应的目标端口；若否，则继续判断不满足时延要求的数据包。本发明通过设置计时器记录时间、并给每个可以被写入的数据包打上写入时间戳，由此判断模块能够根据数据包的时间戳以及计时器记录的当前时间值来精准控制每个数据包的延时取出。 | ||
| 搜索关键词： | 一种 基于 fpga 数据包 精准 延时 方法 系统 | ||
【主权项】：
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