[发明专利]数据路径的修复方法、FPGA电路、FPGA电路设计装置在审
| 申请号： | 202010681863.5 | 申请日： | 2020-07-15 |
| 公开（公告）号： | CN111931452A | 公开（公告）日： | 2020-11-13 |
| 发明（设计）人： | 谢鑫;雷阳;夏炜 | 申请（专利权）人： | 深圳市紫光同创电子有限公司 |
| 主分类号： | G06F30/394 | 分类号： | G06F30/394;G06F30/392;G06F30/34;G06F30/3312 |
| 代理公司： | 深圳市智圈知识产权代理事务所(普通合伙) 44351 | 代理人： | 周献 |
| 地址： | 518000 广东省深圳市南山区粤海*** | 国省代码： | 广东;44 |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | 本申请实施例提供了一种数据路径的修复方法、FPGA电路、FPGA电路设计装置，涉及FPGA电路设计技术领域，可增大数据信号的延时，避免因违例时序电路影响FPGA电路的功能。该数据路径的修复方法，包括：当FPGA电路中的时序路径为违例时序路径时，重新对所述时序路径中的至少一条布线路径进行迭代布线，以延长所述时序路径的长度，直至所述时序路径修复成功或达到预设迭代次数。 | ||
| 搜索关键词： | 数据 路径 修复 方法 fpga 电路 电路设计 装置 | ||
【主权项】：
暂无信息
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