[发明专利]一种基于FPGA的PCIe接口设计方法在审
| 申请号： | 201910997757.5 | 申请日： | 2019-10-21 |
| 公开（公告）号： | CN110851376A | 公开（公告）日： | 2020-02-28 |
| 发明（设计）人： | 张为;邹述铭 | 申请（专利权）人： | 天津大学 |
| 主分类号： | G06F13/10 | 分类号： | G06F13/10;G06F13/42;G06F15/17 |
| 代理公司： | 天津市北洋有限责任专利代理事务所 12201 | 代理人： | 程毓英 |
| 地址： | 300072*** | 国省代码： | 天津;12 |
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| 摘要： | 本发明涉及一种基于FPGA的PCIe接口设计方法，建立FPGA工程并导入PCIe IP核将其实例化，对相应的需求进行配置，同时加入PIO设计的源文件；PIO模块内部主要包括RX接收模块、TX发送模块、存储器连接模块、存储器模块；EP端TX模块实现的是事务层TLP包的发送，是向Endpoint的PCIe IP核回传数据的发送模块，数据会最终发送至RC；在EP接收到Non‑Posted TLP，TX通过发送CplD或Cpl来响应操作，TX模块实现的是组包的过程；EP端RX模块实现的是事务层TLP包的接收，是用于接收和分析从外部发送来的读写TLP包的模块；PIO设计中的Mem Access模块实现数据的软硬件交互存储与读取；将PIO模块与PCIe的IP核模块相连接，PCIe的IP核模块负责将传输的事务层报文数据进行以PCIe协议为结构的拆包或组包。 | ||
| 搜索关键词： | 一种 基于 fpga pcie 接口 设计 方法 | ||
【主权项】：
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