[发明专利]一种DRAM内存行扰动错误解决方法在审

专利信息
申请号: 201910744955.0 申请日: 2019-08-13
公开(公告)号: CN110706733A 公开(公告)日: 2020-01-17
发明(设计)人: 章铁飞;朱继祥 申请(专利权)人: 浙江工商大学
主分类号: G11C29/44 分类号: G11C29/44;G11C29/50
代理公司: 33201 杭州天正专利事务所有限公司 代理人: 王兵;黄美娟
地址: 310018 浙江*** 国省代码: 浙江;33
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摘要: 一种DRAM内存行扰动错误解决方法,包括以下的步骤:S1:每个DRAM内存行采用两位的最近访问计时器,追踪其最近的被动激活信息;S2:当某内存行发生读写访问时,按概率N对其相邻行产生主动激活命令;S3:主动激活命令确定产生后,再根据内存行的最近访问计时器信息,决定是否实行主动激活操作;本发明的优点是:在存储代价可忽略的前提下,能准确发送主动激活命令到受害内存行,同时避免不必要的主动激活命令,最小化对性能的不利影响。
搜索关键词: 主动激活 内存行 计时器 计时器信息 存储代价 错误解决 读写访问 激活信息 命令确定 相邻行 最小化 扰动 发送 访问 追踪 概率
【主权项】:
1.一种DRAM内存行扰动错误解决方法,包括以下的步骤:/nS1:每个DRAM内存行采用两位的最近访问计时器,追踪其最近的被动激活信息;/nS2:当某内存行发生读写访问时,按概率N对其相邻行产生主动激活命令;/nS3:主动激活命令确定产生后,再根据内存行的最近访问计时器信息,决定是否实行主动激活操作;/n其中S1步骤具体为:每个内存行配备一两位的最近访问计时器,当内存行发生被动激活操作时,其对应的最近访问计时器初始化为11,并且按照11,10,01,00的顺序周期性更新,直至最终变为00;令内存行出现扰动错误的相邻行频繁激活的次数阀值为R,激活R次所需的时间T决定了最近访问计时器更新周期;两位的最近访问计时器的更新周期为T/3,因此从11更新至00需要周期T;/n其中S2步骤具体为:每次发生数据访问时,内存控制器中的随机数生成器产生一[0,n)之间的随机数r,概率N等价于随机数r的值在[0,rN)之间;如果r小于等于nN,说明概率为N的事件发生,即产生对相邻行的主动激活命令;否则,不产生主动激活命令;/n其中S3步骤具体为:主动激活命令产生后,查看将被激活内存行的最近访问计时器值,如果值为00,则发送主动激活命令至DRAM内存;否则,主动激活命令取消。/n
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