[发明专利]一种FPGA芯片互连并行接口的验证系统及设备在审
| 申请号： | 201910577770.5 | 申请日： | 2019-06-28 |
| 公开（公告）号： | CN110299975A | 公开（公告）日： | 2019-10-01 |
| 发明（设计）人： | 石广;王硕 | 申请（专利权）人： | 苏州浪潮智能科技有限公司 |
| 主分类号： | H04L1/24 | 分类号： | H04L1/24 |
| 代理公司： | 北京集佳知识产权代理有限公司 11227 | 代理人： | 王云晓 |
| 地址： | 215100 江苏省苏州市吴*** | 国省代码： | 江苏;32 |
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| 摘要： | 本申请公开了一种FPGA芯片互连并行接口的验证系统，包括：发送端，用于根据预设位宽和预设翻转率生成目标信号，并通过并行接口发送目标信号，以及目标信号对应的时钟信号至接收端；接收端，用于将接收到的目标信号转换为第一目标数据；根据预设位宽和预设翻转率生成信号，并将生成的信号转换为第二目标数据；判断第一目标数据和第二目标数据是否一致；若是，则并行接口正常；若否，则并行接口异常。该系统中的发送端和接收端通过并行接口进行通信，若并行接口正常，则其功能性良好；若并行接口异常，则其功能性受损，其电通性也就可能存在问题。相应地，本申请公开的一种FPGA芯片互连并行接口的验证设备，也同样具有上述技术效果。 | ||
| 搜索关键词： | 并行接口 目标数据 预设 目标信号 接收端 互连 验证系统 发送端 翻转 发送目标 技术效果 生成信号 时钟信号 信号转换 验证设备 申请 受损 转换 通信 | ||
【主权项】：
1.一种FPGA芯片互连并行接口的验证系统，其特征在于，包括：发送端，用于根据预设位宽和预设翻转率生成目标信号，并通过并行接口发送所述目标信号，以及所述目标信号对应的时钟信号至接收端；所述接收端，用于将接收到的目标信号转换为第一目标数据；根据所述预设位宽和所述预设翻转率生成信号，并将生成的信号转换为第二目标数据；判断所述第一目标数据和所述第二目标数据是否一致；若是，则所述并行接口正常；若否，则所述并行接口异常。
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- 校准嵌入在高速电缆中的增强装置的系统、增强装置和自校准高速电缆-201410036492.X
- J·M·霍兰;J·A·基恩;G·D·古斯里 - 雷德米尔技术有限公司
- 2008-07-25 - 2017-05-10 - H04L1/24
- 提供了一种用于校准嵌入在高速电缆中的增强装置的系统、一种耦合到高速电缆的增强装置和一种自校准高速电缆，所述高速电缆包括多个高速通道、低速控制总线、输入连接器以及输出连接器，所述系统包括校准固定装置，包括用于将所述高速通道从所述输出连接器环接到所述输入连接器的馈通连接；校准控制装置，被连接到所述低速控制总线，用于校准所述高速通道。
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