[发明专利]提高片上定时不确定性测量的分辨率在审
| 申请号： | 201880034889.1 | 申请日： | 2018-06-07 |
| 公开（公告）号： | CN110679087A | 公开（公告）日： | 2020-01-10 |
| 发明（设计）人： | C·维兹耶尔特兹斯;P·奥瓦克扎尔克兹雅克 | 申请（专利权）人： | 国际商业机器公司 |
| 主分类号： | H03K5/14 | 分类号： | H03K5/14 |
| 代理公司： | 11038 中国国际贸易促进委员会专利商标事务所 | 代理人： | 李颖 |
| 地址： | 美国*** | 国省代码： | 美国;US |
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| 摘要： | 一种系统包括以链配置逻辑上耦合的延迟电路集合、分别逻辑上耦合到延迟电路中的每一个的延迟输出的多个触发器电路、形成触发器电路的层、分别逻辑上耦合到触发器电路的每一层的时钟电路，并且其中多个触发器电路被逻辑上配置成响应于延迟电路集合中的第一延迟电路的延迟输入从可编程延迟电路接收输出并且响应于从时钟电路接收偏差时钟信号，指示在多个触发器电路内从延迟电路中的每一个的延迟输出传输的边沿信号分别传播多远。 | ||
| 搜索关键词： | 触发器电路 延迟电路 时钟电路 延迟输出 耦合到 集合 可编程延迟电路 边沿信号 配置逻辑 时钟信号 耦合的 响应 延迟 传输 输出 传播 配置 | ||
【主权项】：
1.一种系统，包括：/n以链式配置逻辑上耦合的延迟电路集合，/n其中每个延迟电路包括延迟输入和延迟输出，其中集合中的第一延迟电路的延迟输入逻辑耦合到可编程延迟电路的可编程延迟电路输出，/n其中集合中的第二延迟电路的延迟输入逻辑上耦合到第一延迟电路的延迟输出，/n其中集合中的剩余每个延迟电路的延迟输入逻辑上耦合到集合中的紧接在先的延迟电路的延迟输出；/n多个触发器电路，分别逻辑上耦合到每个延迟电路的延迟输出，形成触发器电路的层，/n其中每个触发器电路包括触发器输入、时钟输入和触发器输出，/n其中多个触发器电路的每一个的触发器输入分别逻辑上耦合到每个延迟电路的延迟输出；/n时钟电路，其分别逻辑上耦合到触发器电路的每一层，/n其中时钟电路的时钟输出逻辑上耦合到触发器电路的每一层中的每个触发器电路的时钟输入，/n其中时钟电路被逻辑上配置以将包括可编程延迟的偏差时钟信号从时钟电路的时钟输出传输到触发器电路的每一层中的每个触发器电路的时钟输入，导致包括对应的可编程延迟的偏差时钟信号由时钟电路分别传输到触发器电路层；以及/n其中多个触发器电路被逻辑上配置，响应于在多个触发器电路的每一个的触发器输入上从每个延迟电路的延迟输出接收到输出，其响应于延迟电路集合中的第一延迟电路的延迟输入，接收来自可编程延迟电路的可编程延迟电路输出的输出，并且响应于在触发器电路的每一层中的每个触发器电路的时钟输入上从时钟电路接收偏差时钟信号，以经由多个触发器电路的触发器输出，指示从每个延迟电路的延迟输出传输的边沿信号在多个触发器电路内分别传播多远。/n
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