[发明专利]一种通用电子对抗设备控制架构有效
| 申请号： | 201811328982.1 | 申请日： | 2018-11-09 |
| 公开（公告）号： | CN109542817B | 公开（公告）日： | 2022-04-08 |
| 发明（设计）人： | 胡瑾贤;黎仁刚;李宏圆;朱业腾;张生凤 | 申请（专利权）人： | 中国船舶重工集团公司第七二三研究所 |
| 主分类号： | G06F13/40 | 分类号： | G06F13/40;G06F13/20 |
| 代理公司： | 南京理工大学专利中心 32203 | 代理人： | 孟睿 |
| 地址： | 225001*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提出一种通用电子对抗设备控制架构。包括DSP控制板和若干FPGA处理板；FPGA处理芯片内部设置若干功能子模块以及协处理CPU、EMIF总线收发模块、RapidIO总线收发模块；DSP处理芯片与FPGA处理芯片之间采用RapidIO总线和EMIF总线完成信息交互；FPGA处理芯片内部互联总线由三个主控作为命令发起者，分别为RapidIO总线、EMIF总线、协处理CPU；所述FPGA处理板包括若干FPGA处理芯片和一个RapidIO交换机；FPGA处理芯片之间采用互联总线桥接，各FPGA处理芯片均与FPGA处理板内部的RapidIO交换机连接；各FPGA处理板内部的RapidIO交换机通过光纤或者背板与DSP控制板中的RapidIO交换机连接。本发明提高了电子对抗控制系统的通用性与可扩展性，降低控制信息延迟。 | ||
| 搜索关键词： | 一种 通用 电子对抗 设备 控制 架构 | ||
【主权项】：
1.一种通用电子对抗设备控制架构，包括DSP控制板和若干FPGA处理板，其特征在于，所述DSP控制板包括DSP处理芯片、FPGA处理芯片以及RapidIO交换机；FPGA处理芯片内部设置若干功能子模块以及协处理CPU、EMIF总线收发模块、RapidIO总线收发模块；功能子模块以及协处理CPU、EMIF总线收发模块、RapidIO总线收发模块均与FPGA处理芯片的内部互联总线连接；DSP处理芯片与FPGA处理芯片之间采用RapidIO总线和EMIF总线完成信息交互；FPGA处理芯片内部互联总线由三个主控作为命令发起者，分别为RapidIO总线、EMIF总线、协处理CPU；所述FPGA处理板包括若干FPGA处理芯片和一个RapidIO交换机；各FPGA处理芯片内部设置若干功能子模块以及协处理CPU、RapidIO总线收发模块；各功能子模块、协处理CPU以及RapidIO总线收发模块均与FPGA处理芯片的内部互联总线连接；FPGA处理芯片之间采用互联总线桥接，各FPGA处理芯片均与FPGA处理板内部的RapidIO交换机连接；各FPGA处理板内部的RapidIO交换机通过光纤或者背板与DSP控制板中的RapidIO交换机连接。
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